与外部网络通信是Arduino项目的一项重要功能，并且对许多项目来说是强制性的。在本教程中，我们将创建一个ArduinoWiFi项目，该项目允许您向它发送命令以打开/关闭通过WiFi从计算机连接到Arduino的LED。开发周期如下：我们将使用ArduinoMega+ESP8266WiFi板进行开发和调试一旦它正常工作，我们就会将该项目移至ArduinoUno+ESP8266WiFiShield这个教程也很容易适应其他硬件，比如ESP8266WiFi使用Arduino上的主要“串行”设备与其交互-例如许多蓝牙模块。Arduino通信有很多选择，我经常使用有线以太网或USB，因为我有可用的基础设施，它通常易于使用并且对我有用。但有时无线方法会容易得多。有许多无线连接选项可用，例如LoRa、蓝牙、IR、WiFi等。它们每个都有不同的属性和理想的用例。可以说最普遍的是WiFi，这就是本文要讨论的内容。然而，我拥有的所有适用于Arduino的WiFi解决方案（ESP-8266解决方案）和我在网上阅读的其他解决方案，恕我直言，使用起来非常乏味（即痛苦）。Arduino项目开发周期需要硬件黑客和/或DIP开关的不断切换才能使用它们。我提到的乏味是因为Arduino和WiFi硬件之间的交互是通过Arduino的“串行”设备进行的。默认情况下，Arduino串行设备用于两件事：Arduino和WiFi对Serial的共享使用在所有意图和目的上都是一个冲突-也就是说，Serial是用于将新程序（/sketch）上传到Arduino，还是用于向WiFi发送命令或它是否用于输出调试消息？在许多WiFi板上实现的这种冲突的解决方案是使用一系列DIP开关或需要额外的硬件来解决串行端口的用途的困境。这意味着当您正在开发您的Arduino程序并希望在更改后上传它时，您需要将DIP开关设置为“特定配置”（串行设备连接到USB）以允许上传更新的程序.当您完成上传并想要运行您的新代码时，您需要将DIP开关设置为不同的“特定配置”（串行设备连接到WiFi）并重置您的Arduino以重新启动程序-或者有一些导致程序在开始发出WiFi指令之前等待的其他机制（例如，延迟让您有时间重置开关或按下按钮等）。当然，如果您的程序中有调试消息通常会输出到串行设备并因此在ArduinoIDE的串行监视器中可见，那么您就不走运了，因为这些调试消息将被发送到您猜对了的WiFi不太可能处理它们的设备。测试后，您确定新的代码更改、添加新功能或任何需要重置开关以进行上传的内容，然后重新重置开关以运行修改后的ode。每次更改代码时都需要重复此循环-无论更改有多小。对我来说，这非常乏味，并且在某些板上，如果您不小心，开关的切换有损坏它的风险-或者换句话说，恕我直言，这是非常痛苦的！一种选择是使用SoftwareSerial或者如果你有它，另一个串行端口（例如Leonardo上的Serial1）用于调试消息或WiFi交互，但这需要某种转换器（例如另一个Arduino、FTDIUSB串行转换器等）将SoftwareSerial/Serial1“端口”连接到PC等等。并且没有解决主要串行设备用于程序上传以及与WiFi模块通信的主要问题。我在使用SoftwareSerial时遇到的另一个潜在问题，我发现特别令人沮丧的是，对于与WiFi板的每次通信，我经常需要输出几个调试消息来隔离问题。这可能（并且已经）导致数据丢失、串行监视器上的消息损坏和其他问题。这意味着您可能正在尝试调试一个真正不存在的问题，因为它只是由通过SoftwareSerial传递的负载引起的。在我的测试中，当通过硬件串行端口发送相同的调试消息时，这个“数据溢出”问题似乎没有发生。所以这篇文章是关于如何避免痛苦并拥有正常的代码开发周期，上传，测试，根据需要重复-没有DIP开关痛苦来解决串行冲突问题。零件清单：本项目主要使用ArduinoMega+WiFi进行开发项目完成后，我们会将代码移植到ArduinoUno+WiFi（或任何其他带有ESPWiFi扩展板的Arduino）ArduinoMega+WiFi板（可从JaycarXC-4421获得）一个中型面包板3个LED3个限流电阻(440+ohm)连接线可选ArduinoDuinotechESP13WiFishieldArduinoUno+Wifi板第1步：连接组件在这个项目中，我们将在Mega上构建软件，然后将代码（和测试电路）迁移到Uno。您将需要以下组件：ArduinoMega+WiFi面包板3个LED和限流电阻连接线电路相当简单（参见图表），所以我不会详细解释它。确保将带有扁平侧/短腿的LED连接到电阻器，电阻器又接地。测试程序使用数字I/O引脚5、6和7，因此将LED（通过长腿）连接到ArduinoMega上的这些引脚。我使用了不同颜色的LED，但如果您没有多种颜色，则不必这样做。此外，如果您有不同的颜色，顺序并不重要，只需将一个LED（+限流电阻）连接到DIO引脚5、6和7中的每一个。照片、面包板和电路图说明了如何进行连接。第2步：在Mega上设置DIP开关在ArduinoMega+WiFi上，您应该找到我在照片中突出显示的2组开关。在我的板上，一个开关是一个8路DIP开关块（带有需要工具（例如小螺丝刀）才能移动的微小开关）。另一个开关是一个更大的开关，它是一个滑块的形式。为了尽量减少混淆，我将所有Arduino板上可用的主串行端口称为Serial(0)。在代码中，这是名为Serial的串行设备，通常连接到Arduino板上的USB端口。第一块8个开关控制板上的主要通信路径。选项包括：将Mega的串行端口连接到ESP（打开1和2）将USB连接到Mega的串行（0）端口（打开3和4）将USB连接到ESP（打开5和6）使ESP在下次复位时进入编程模式（开关7打开）开关8未使用第二个大开关决定了Mega如何（即通过哪条路径）连接到ESP（开关1和2）。此开关控制使用Mega的哪个串行端口与ESP通信。选项为Serial(0)或Serial3。这意味着我们可以：使用Mega的Serial3端口与ESP通信，从而利用其WiFi功能。和以传统方式使用USB将代码上传到Mega并通过串行监视器与Mega的程序交互，而无需在编程和测试时不断调整开关1&2和开关3&4。简而言之，此开关解决了与我在步骤1中概述的Serial(0)端口相关的硬件冲突。要进行设置，请按如下方式配置开关：转动开关1、2、3和4->ON转动开关5,6,7&8->OFF大滑块应设置在TXD3和RXD3端（即远离USB连接器和8路DIP开关的位置）电路图显示了我如何相信两个开关很可能连接。我这样说是因为我在网上发现了很多图表（我怎么能这么说？）似乎并没有准确反映板上的实际电路-有些人可能会说我发现的图表“完全错误”。我通过广泛的测试/反复试验制作了这个电路图。在我的图中，每个开关对上的TX和RX线可能颠倒了，但这应该无关紧要，因为开关应始终成对使用（即开关1和2应该设置相同的方式，类似地3和4应该设置方式与开关5和6相同）。第3步：开发您的ArduinoWiFi应用程序由于我将提供Arduino代码，因此不会有太多的开发周期，但我将尝试通过建议更改来说明开发周期，以说明我们可以在下一步中轻松重新上传和运行修改后的代码.关键的一点是，我们可以做到这一点，而无需经常更换开关，也无需额外的支持硬件。我们将看到如何配置ArduinoMega+WiFi，以便您可以使用ArduinoPCUSB连接来：上传编译代码通过串行监视器与运行在Arduino上的代码进行交互使用无线网络话虽如此，我们需要对ArduinoMega+WiFi上的开关进行初始设置以支持此开发过程（如上一步所述）。如果您尚未设置开关，请返回上一步并立即设置我们将用于开发的代码可以从我的GitHub下载或从下面复制粘贴注意有两个文件。第一个文件可以任意命名（我叫我的ArduinoESPInteractive.ino）。第二个文件必须命名为NullSerial.h只需在ArduinoIDE中创建一个新项目，并使用下面显示的两个文件中的代码或来自GitHub的代码如果您手动输入代码或复制/粘贴，那么您还需要手动添加第二个文件。要添加第二个文件，只需单击ArduinoIDE编辑器右上角的小向下箭头，然后选择“新选项卡”，然后将其命名为NullSerial.h确保您已按照上一步所述设置Mega+WiFi上的DIP开关照常上传代码。打开串行监视器，将波特率设置为115200，观察一些我将在下一步中描述的启动消息这是主程序（ArduinoESPInteractive.ino）：*MegaESPInteractive*------------------**ThisprogramisdesignedforusewithanArduinoMega+ESP8266comboboard.*Itallowsyouto:*-interactwiththeESP8266viatheArudino*and*-uploadprogramstotheArduino*withoutconstantlyswitchingtheDIPswitchestoconnecttheArduinototheESP*and/ortheUSB.**IfyouwanttouploadaprogramtotheESP,youwillstillneedtosettheDIP*switches.**TheabilitytohaveadevelopmentcyclethatdoesnotinvolveswitchingDIP*switchesexpeditestheprogram/debugcycleofWiFibasedappsbecausethevery*tediousandfiddlystepofconstantlyhavingtochangethemiseliminated.This*willalsoprobablyextendthelifeoftheboardasyoudon'thaveasmuch*mechanicalwearandtearonthem.**Hardwarerequired:*-ArduinoMega+ESP8266wificomboboardsuchastheJaycarXC4421:*https://www.jaycar.com.au/mega-with-wi-fi/p/XC4421.*-optionallyanFTDIUSB-SerialboardsuchastheJaycarXC4672:*https://www.jaycar.com.au/isp-programmer-for-arduino-and-avr/p/XC4627)**Thedevelopmentcycleworksasfollows:*1)DevelopyourcodeanduploadusingthestandardArduinoIDEuploadmechanism.*2)useSerial3(viaapreprocessor#defineconstant)forinteractionwiththe*ESP.*2)OptionallyinteractwithyourArduinoprogramviaSerial2orSerial(alsovia*apreprocessorconstant)*3)OutputDebugmessagestoSerial(viaapreprocessorconstant).**PreprocessorsymbolsareusedtorepresentthetwoSerialportsusedasfollows:*ESP->Serial3*HOST->SerialorSerial2**Onceyourprogramiscompleteandcanoperatestandalone,youcantransfertoa*smallerdevice(e.g.theArduinoUNO+Wifiboard).Simplyredefinetheconstants*sothatESPisSerialandHOSTisaninstanceofsoftwareSerial.**Tousethisprogram,twosetsofswitchesontheArduinoMega+ESP8266Wifimust*besetasfollows:**ThelargeDPDTswitchwithlabelsRXD0&TXD0atoneendandRXD3&TXD3mustbe*settotheRXD3&TXD3end.ThisenablestheMegaSerial3portforcommunications*withtheESP.**The8positionDIPswitchmustbesetasfollows:**onoooo*offoooo*Number12345678**Thatis,switches1,2,3&4arebeturnedonand*switches5,6,7&8areturnedoff.*Theseswitchconfigurations:*-ConnecttheMegaSerial3totheESP(forWiFiaccess)*-ConnecttheMegaSerialtotheUSB(forprogramminganddebugging).*/#include"NullSerial.h"#defineVERSION"1.1.0.1"/**Revisions.*1.1.0.1*CorrectedbugforLEDon/offdebugmessages.**1.1.0.0*Addedconceptofdebugmessages.*AddedinitialisationofWiFitostationmodeandconnecttoWiFiboiler*platecode.**/#ifdefined(ARDUINO_AVR_MEGA2560)#defineHOST_BAUD115200#defineHOST_RX"USB(0)"#defineHOST_TX"USB(1)"#defineHOSTSerial#defineDEBUGSerial//NullSerial_debug(1,2);//#defineDEBUG_debug#defineESP_BAUD115200#defineESP_RX15#defineESP_TX14#defineESPSerial3#elseifdefined(ARDUINO_AVR_UNO)/**OnUno,weonlyhaveonehardwareserialdevice.*So,wewilluseSoftwareSerialforanyinteractionsthatmayberequiredwith*thehost.*/#include#defineHOST_BAUD115200#defineHOST_RX10#defineHOST_TX11SoftwareSerial_host(HOST_TX,HOST_RX);/*(my_RX,my_TX)*/#defineHOST_hostNullSerial_debug(HOST_TX,HOST_RX);#defineDEBUG_debug//#defineDEBUG_host#defineESP_BAUD115200#defineESP_RX"USB(0)"#defineESP_TX"USB(1)"#defineESPSerial#endif/*Apairofmacrosthatallowsthevalueofsymbolsdefinedin#define*preprocessordirectives(e.g.HOST)tobeoutputasstrings(e.g.in*printfunctioncalls).*/#define_STRING(x)(#x)#defineSTRING(x)_STRING(x)/******************************ThehasEOLJustBeenSentisusedtotrackwhetheranendoflinehasbeensentto*theESP.*TheversionofcodeshippedwiththedevicerequiresaCarriageReturn(CR)*followedbyaLineFeed(LF)-inthatorder-tomarktheendofaline(EOL).*Thatis,theESPrequiresaCRLFendofline(EOL)sequence.**Thisprogramallowsyouconsiderableflexibilityofwindowsterminalprograms*(IusePutty,CoolTerm,theArduinoSerialmonitorandothers)intheirdefault*configurations.Theseprogramsallgeneratevariouscombinationsofthecommon*lineendingsCRonly,LFonlyandCRLF.*WhenitseesaCR('\r')orLF('\n'),theprogramwillsendanEOLtotheESP.*ToallowforterminalprogramsthatsendbothaCRandaLF,the*hasEOLJustBeenSentisusedtotrackthatanEOLhasbeensentwheneithertheCR*orLFisreceivedfromtheHOST.*TopreventdoublinguponEOL's,ifwehavejustreceivedaCRorLF,andthe*nextcharacterisalsoaCRorLF,thenitwillsimplybeignored.*/booleanhasEOLJustBeenSent=false;charbuf[100];intbufPtr=0;booleanOKseen=false;booleanERRORseen=false;booleanFAILseen=false;booleanTIMEOUTseen=false;/**processInput(msg)*-----------------**ProcessesamessagereceivedfromtheESP.*Thisincludesprocessingresponsestocommands(e.g.OK,FAILetc)*Processinginputfromaclient.*Processingclientconnection/disconectionmessages.*Andothersasrequired.**/voidprocessInput(constchar*msg){DEBUG.println();//DEBUG.print(F("Received:"));//DEBUG.println(msg);OKseen=false;ERRORseen=false;FAILseen=false;if(strncmp(msg,"+IPD",4)==0){//Clientmessage?DEBUG.println(F("Receivedinputfromclient"));charled=msg[9];//ExtracttheLEDnumbercharsetting=msg[10];//Extractthesetting(on/off)if(led>='1'&&ledled=led-'1';//ifvalid,converttoaninteger.}else{//OtherwiseprintanerrormessagetotheUSB.HOST.print(F("InvalidLED:"));HOST.println(led);return;}DEBUG.print(F("SettingLED"));DEBUG.print(led);DEBUG.print(F("onDIO"));DEBUG.print(led+5);DEBUG.println(setting=='+'?"on":"off");//FInally,turntherequestedLEDonoroffdigitalWrite(led+5,setting=='+');//dependinguponthevaluein"setting".//Theled+5adjuststheLEDvalue(0,1or2)//tothecorrespondingArduinodigitalI/Opins//whichthathaveLED'sconnectedwhihcarepins5,6&7.}OKseen=strcmp(msg,"OK")==0;ERRORseen=strcmp(msg,"ERROR")==0;FAILseen=strcmp(msg,"FAIL")==0;}/*accumulateESPData*=================**CheckifacharacterisavailableontheESPSerialport.*Ifitis,accumultatethecharacterinabuffer.*Whenanewlineisobserved,processtheinput.**ReturnstruewhenanewLinehasbeenseenandtheinputprocessed.*falseotherwise*/booleanaccumulateESPData(){booleannewLineSeen=false;if(ESP.available()){charch=ESP.read();HOST.write(ch);if(ch=='\r'||ch=='\n'){buf[bufPtr]='\0';//Nullterminatetheinput;if(bufPtr>0){processInput(buf);newLineSeen=true;}bufPtr=0;}else{if(bufPtrbuf[bufPtr++]=ch;//theinputbufferifspacepermits.}}}returnnewLineSeen;}/***sendESP(msg)*============*SendthesuppliedmsgtotheESPalongwithaCRLFlineending.*WaitforaresponseofOK,ERROR,FAILoraTIMEOUT.*ThetimeoutperiodisspecifiedbythetoPeriodconstantvalue.*/constunsignedlongESP_TO_PERIOD=30000;//millistowaitforreply(30secs).voidsendESP(constchar*msg){ESP.print(msg);ESP.print("\r\n");OKseen=false;ERRORseen=false;FAILseen=false;TIMEOUTseen=false;//Establishtheinitialtimoutperiod.unsignedlongtimeout=millis()+ESP_TO_PERIOD;//Loopuntilwegetoneoftheexpectedreplies//oratimeoutoccurs(withoutgettingoneoftheexpectedreplies)while(!OKseen&&!ERRORseen&&!FAILseen&&!TIMEOUTseen){if(accumulateESPData()){//Aresponsehasbeenrecieved.//DebugoutputthestatusoftheexpectedrepliesDEBUG.print(F("O,E,F="));DEBUG.print(OKseen);DEBUG.print(ERRORseen);DEBUG.println(FAILseen);timeout=millis()+ESP_TO_PERIOD;//messagercvd,resetthetimer.}if(millis()>=timeout){TIMEOUTseen=true;DEBUG.println(F("***TimeoutwaitingforESPreply"));}}}/***AccumulateHOSTData*==================**Checkfordatabeingavailablefromthehost.Ifthereisdata,simplypassiton*totheESP.*IfaCRoraLFisobservedintheHOSTdata,sendtheESPaCRLF.*/voidaccumulateHOSTData(){if(HOST.available()){charch=HOST.read();//HOST.write(ch);//PerformlocalechotoHOST(ornot)if(ch=='\n'||ch=='\r'){//DowehaveaLForCR?if(!hasEOLJustBeenSent){//Yep,didwejustsendone?ESP.write('\r');//Nope,sosendaCRLFtotheESP.ESP.write('\n');hasEOLJustBeenSent=true;//Trackthatwe'vesentanEOL}}else{//NotaCR¬aLF,soESP.write(ch);//WritethecharactertotheESPhasEOLJustBeenSent=false;//SincenotaCR¬aLF,trackthat//wedidn'tjustsendanEOLtoESP.}}}/***setup*-----**InitialiseourSerialdevices,outputsomeconfigurationinformation*andsettheBUILTIN_LEDforoutput.*/voidsetup(){ESP.begin(ESP_BAUD);HOST.begin(HOST_BAUD);while(!HOST){delay(1);}HOST.print(F("Version:"));HOST.println(F(VERSION));HOST.print(F("ESPReadyon:"));HOST.print(STRING(ESP));HOST.print(F("@"));HOST.print(ESP_BAUD);HOST.print(F("bps.RX,TX:"));HOST.print(ESP_RX);HOST.print(F(","));HOST.println(ESP_TX);HOST.print(F("HOSTReadyon:"));HOST.print(STRING(HOST));HOST.print(F("@"));HOST.print(HOST_BAUD);HOST.print(F("bps.RX,TX:"));HOST.print(HOST_RX);HOST.print(F(","));HOST.println(HOST_TX);DEBUG.println(F("****Debugmessagesenabled****"));HOST.println();pinMode(5,OUTPUT);//SetsomepinstooutputforLEDs.pinMode(6,OUTPUT);pinMode(7,OUTPUT);DEBUG.println(F("SendingGetVersion"));sendESP("AT+GMR");//GetVersionInfo.//OnceoffsetmodeandjointheWiFi.DEBUG.println(F("Settingthemode"));sendESP("AT+CWMODE=1");//Setoperatingmodeto"station"DEBUG.println(F("ConnecttomyWiFi"));sendESP("AT+CWJAP=\"YourWiFi\",\"yourpassword\"");DEBUG.println(F("SendingMaxConnections=1"));sendESP("AT+CIPMUX=1");//EnableServerDEBUG.println(F("SendingStartServeronPort80"));sendESP("AT+CIPSERVER=1,80");//Openport80HOST.println(F("Ready"));HOST.println();}/*Loop*====**AccumulatecharactersfromtheHOSTandESP.*Processthemasnecessary.*/voidloop(){accumulateHOSTData();accumulateESPData();}这是第二个文件，它必须命名为NullSerial.h并且与主程序（从上面）位于同一文件夹中。当我们将项目移至ArduinoUno+WiFi时，我将解释此文件的用途。NullSerial*----------**AnemptyimplementationofaSerialInterface.**TheideaforthisNullSerialclassisto,viaconditionalcompilation,*eliminateanyDebugmessagesfromreleasedcode.**/#ifndefNullSerial_h#defineNullSerial_hclassNullSerial{public:NullSerial(uint16_treceivePin,uint16_ttransmitPin,boolinverse_logic=false){}NullSerial(){}voidbegin(longspeed){}boollisten(){returnfalse;}voidend(){}boolisListening(){returnfalse;}boolstopListening(){returnfalse;}booloverflow(){returnfalse;}intpeek(){return-1;}voidprintln(){}voidprint(){}voidprintln(constvoid*msg){}voidprint(constvoid*msg){}voidprintln(constinti){}voidprint(constinti){}};#endif//NullSerial_h第4步：连接到WiFi如果上一步中的一切顺利，您应该在计算机上（在串行监视器中）看到类似以下内容。Version:1.0.0.0ESPReadyon:Serial3@115200bps.RX,TX:15,14HOSTReadyon:Serial@115200bps.RX,TX:USB(0),USB(1)****Debugmessagesenabled****SendingGetVersionAT+GMROK,ERROR,FAIL=000ATversion:0.21.0.0OK,ERROR,FAIL=000SDKversion:0.9.5OK,ERROR,FAIL=000OKOK,ERROR,FAIL=100Ready上面显示的消息是调试消息，显示了Arduino的配置和ESP上运行的软件版本。如果您愿意，您可以通过将其输入到串行监视器的输入文本框中并单击“发送”按钮来向Arduino发送一些文本。您发送的任何文本都将直接发送到ESP。因此，最好发送AT命令，例如“AT+GMR”（不带引号），它要求ESP报告它正在运行的软件版本。我将在本Instructable的其余部分展示一些有用的命令。如果您对上述输出的含义不是特别感兴趣，只是想连接，请跳到下一个名为“连接到您的WiFi”的部分。初始调试消息的分析上述输出的前几行显示了Arduino用于与您和ESP交互的配置。这些是以“ESP”和“HOST”开头的行。内容是：正在使用的串行端口“OK,ERROR,FAIL...”消息是Arduino代码在从ESP收到消息时生成的调试消息。这些消息显示Arduino程序中维护的3个标志的状态，这些标志的设置或清除取决于是否从ESP接收到消息“OK”、“ERROR”或“FAIL”。通常，ESP会以OK、ERROR或FAIL消息结束其输出，因此这些消息用作标记来确定ESP何时完成对命令的响应并准备好下一个命令。我们可以在OK位设置为1的“Ready”消息之前看到这一点。其他消息“AT版本：0.21.0.0”和“SDK版本：0.9.5”是ESP生成的实际输出。Arduino程序将从ESP接收到的所有内容中继到IDE的串行监视器ESP8266WiFi由AT命令驱动。如果您对此历史感兴趣，可以在Wikipedia上找到一篇很好的文章。ESP8266WiFi解决方案使用与维基百科文章中提到的命令集不同的命令集，主要是因为它不是拨号调制解调器——这正是维基百科文章所讨论的内容。但是，AT命令的结构与文章中描述的类似。参考维基百科文章，ESP8266WiFi似乎只在命令模式下运行。将ESP置于“站模式”-“AT+CWMODE=1”命令加入您的WiFi网络-“AT+CWJAP=...”命令进入网络后，我们将要使用以下命令建立服务：开启“服务器模式”——“AT+CIPMUX=1”开始监听端口-"AT+CIPSERVER=1,80"请注意，每次重置ESP时都必须执行最后两个命令（打开服务器模式并开始侦听端口）。最简单的方法是在Arduino的setup()函数中运行它们。ESP会在重置时“记住”前两个命令（站模式和加入WiFi）中的设置。所以一旦成功运行，如果你想这样做，你可以将它们注释掉。每次Arduino重置时都运行它们没有坏处，当我们移动到Uno和/或如果出于某种原因更换了WiFi硬件（例如，有故障的WiFi屏蔽被替换为不错的）。因此，我倾向于不将它们注释掉并在每次Arduino启动时运行它们，以确保我们拥有预期的操作环境。在主Arduino程序的setup函数中，大约在第330行，您会注意到以下代码：DEBUG.println(F("SendingGetVersion"));sendESP("AT+GMR");//GetVersionInfo.//OnceoffsetmodeandjointheWiFi.DEBUG.println(F("Settingthemode"));sendESP("AT+CWMODE=1");//Setoperatingmodeto"station"DEBUG.println(F("ConnecttomyWiFi"));sendESP("AT+CWJAP=\"YourWiFi\",\"YourPassword\"");DEBUG.println(F("SendingMaxConnections=1"));sendESP("AT+CIPMUX=1");//EnableServerDEBUG.println(F("SendingStartServeronPort80"));sendESP("AT+CIPSERVER=1,80");//Openport80您需要通过替换YourWifi和YourPassword来修改“AT+CWJAP”行（如下所示）以包含您的WiFi和密码：sendESP("AT+CWJAP=\"YourWiFi\",\"YourPassword\"");注意不要去掉围绕YourWiFi和YourPassword的反斜杠或双引号。这些是确保编译器将双引号插入到发送到sendESP函数的字符串中所必需的。完成此操作后，重新上传程序。记住这里的关键要点是您只需在以正常方式编辑后上传代码，您不必调整任何开关，也不需要任何额外的硬件来调试您的程序。上传完成后，您应该会在串行监视器上看到更多消息。我们正在寻找的主要两条消息是对加入WiFi网络(AT+CWJAP=...)并开始侦听端口(AT+CIPSERVER=...)的命令的“OK”响应。如果一切顺利，您可以尝试在串口监视器中输入以下“查询网络配置命令”（AT+CIFSR）。您应该会看到如下内容：AT+CIFSR+CIFSR:STAIP,"192.168.3.160"+CIFSR:STAMAC,"18:fe:34:2c:70:45"OK重要的部分是包含文本“+CIFSR:STAIP”的行，它是我们的IP地址。我们将在下一步打开和关闭一些LED时需要IP地址！就我而言，地址是192.168.3.160-您的IP地址几乎肯定会有所不同。记下您的IP地址，而不是我的。第5步：通过WiFi与应用的互动现在我们已经连接到WiFi并开始我们的服务，我们将尝试联系它并让这些LED跳舞-可能不是很跳舞，但肯定会打开和关闭在我们开始之前，让我们检查“开始监听端口”命令（AT+CIPSERVER=1,80）的结构这个命令的意思可以分解如下：AT+-所有命令所需的前导码。CIPSERVER=开始（或停止）侦听指定的网络端口。即启动（或停止）服务/服务器。1、--开始监听（使用0，停止监听）80-我们想要侦听传入连接请求的网络端口-特别是端口80。您可以在此处使用任何有效的端口号。请注意，许多端口号通常用于特定功能（端口80通常由Web服务器使用），如这篇Wikipedia文章中所述。因此，从上一步中，我们知道连接到Arduino所需的IP地址（我的是192.168.3.160），现在我们也知道在建立连接时必须使用端口80。以下使用netcat的脚本显示了使用我的IP地址与Arduino的连接。您需要将192.168.3.160替换为您的IP地址。如果您还没有，可以在步骤1的底部找到有关获取netcat的信息。在Shell（Mac、Linux或Cygwin）提示符或Windows命令提示符中输入以下内容。请记住，使用您的IP地址代替192.168.3.160。如果一切顺利，此时netcat中不会发生任何其他事情。所有的动作都在Arduino上结束。在串行监视器中，您应该看到如下内容以响应netcat命令：这意味着一个客户端已经连接，并且它被分配了会话ID0。如果另一个客户端连接，您将看到“1,CONNECT”形式的消息。这意味着客户端已连接并将被分配会话ID1。接下来，翻回netcat并输入文本“1+”（无引号）并按Enter。您的终端会话现在应如下所示：再一次，不是非常令人兴奋，但再一次，Arduino串行监视器和面包板上的动作都结束了。如果一切顺利，连接到DIO端口5的LED将亮起，您将在串行监视器中看到类似以下内容。文本“+IPD,0,3:1+”是ESPWiFi发送给Arduino的内容。这可以解释如下：+IPD-已从客户端接收到传入数据。0-数据是从会话ID为0的客户端接收的。3:-已从客户端接收到三个字节的数据。实际数据跟在“:”字符之后。1+（后跟一个不显示的换行符）是来自客户端的数据-即您输入到netcat中的数据。Arduino程序对数据的解释如下：+打开LED（或-关闭LED）1（或2或3）打开第1个(DIO5)、第2个(DIO6)或第3个(DIO7)LED。如果需要，您可以通过在Arduino串行监视器中输入AT+CIPSEND=命令将数据发送回netcat。请注意，需要两行输入。第一个是将一些数据连同数据长度一起发送到会话0的命令，然后是要发送的实际文本（将给出“>”提示）。在串行监视器的输出中，您应该看到如下内容：AT+CIPSEND=0,5命令的细分是请求向会话ID0标识的客户端发送5个字节的数据。在您的计算机上的netcat会话中，您应该看到如下内容：第6步：发布您的应用您已经完成了构建应用程序的艰苦工作，现在您可以发布它了。您想将其移动到（物理上）较小的平台，例如ArduinoUno，甚至是自定义电路。所以现在我们需要将代码迁移到该硬件。这是一个可选步骤，但这是本文的全部内容。具体来说，如何相对轻松地开发您的ArduinoWiFi应用程序，并在完成后将其移至较小的平台。一个平台，如果您用于原始开发，则需要您在每次上传代码时不断切换开关，在您想要运行它时重置这些开关以及将需要额外的硬件来观察调试消息。实际上，由于我在WiFiShield和Arduino无法正常通信时遇到的一些头痛问题，因此编写这一步比其他所有步骤加起来花费的时间更长，因此不得不通过将Uno上的DIP开关切换为单调乏味的方式进行调试试着弄清楚发生了什么。问题是ESP软件以某种方式自我损坏并不断重启。解决方案是重新映像ESP模块。请注意，您可能仍然会像我一样在较小的硬件平台上遇到问题，这需要一些故障排除以及我刚刚提到的“痛苦的事情”，但在这个阶段，大部分开发工作已经完成。因此，与在较小平台上进行完整开发的痛苦相比，最终的故障排除痛苦或至少应该大大减少。在这一步中，我们将我们的应用程序迁移到带有WiFi屏蔽的ArduinoUno。但是，您也可以使用ArduinoUno+WiFi集成板，例如JaycarXC-4411或其他组合。子步骤大致如下：将我们的测试电路连接到Uno+WiFi板。将代码上传到我们的ArduinoUno+WiFi。计算分配给此设备的IP地址（此步骤）享受您闪亮的新应用程序，让这些LED发光！连接测试电路对于此子步骤，只需按照步骤1中所述将测试电路连接到UNO。连接与步骤1中所述相同。具体而言，将3个LED连接到DIO引脚5、6和7。然后连接地线到Arduino板上的GND引脚之一。上传代码-MCU到USB此子步骤（“上传代码”）和以下子步骤（“运行代码”）对时间至关重要，因此请在开始之前完整阅读这两个步骤。对于这一步，我假设您没有注释掉设置操作模式和加入WiFi的代码（第4步）。如果这样做，请在继续之前取消注释。使用Uno成功加入WiFi后，可以重新注释掉工作模式的设置（AT+CWMODE=1）和WiFi的加入（AT+CWJAP="...","...”），因为即使断电，ESP也会记住这些设置。同样，我建议不要对此进行评论，但如果您真的想要，请在新硬件上成功运行后进行评论。在Uno上，唯一的硬件串行端口用于上传代码、与串行监视器交互-或-与ESP通信-但并非同时进行。这是一个冲突。为了解决这个冲突，我们需要使用WiFiSheild（或Uno+WiFi）板上的DIP开关告诉电路板我们正在做什么（上传或与ESP对话）。简而言之，我们设置开关以允许通过USB上传Arduino代码。上传完全完成后，我们需要重置开关以允许Arduino与ESP通信（这是时间关键位）。要设置上传开关，请握住ArduinoUno+ESPWiFi扩展板，使USB位于左侧，您会注意到电路板右上角的DIO引脚1和2附近有2个DIP开关。将这两者都切换到关闭位置。参考图中蓝色电路板仅包含2个DIP开关。如果您使用的是Uno+WiFi集成板，则在与集成Mega+WiFi板上的位置类似的位置有一个8路拨码开关。请参阅带有包含8个DIP开关的黑色电路板的图像。将代码上传到Arduino时，您必须按如下方式切换开关：开关1和2-关闭开关3和4-打开开关5、6、7和8-关闭。以正常方式上传代码。除非打开调试模式，否则您将看不到与发送AT+GMR命令相关的任何内容-然而，它已经发送，Arduino将等待回复-永远不会到来。我们需要在Arduino超时等待AT+GMR响应之前将DIP开关重置为运行代码模式。这是时间关键点，所以请继续阅读......运行代码-MCU到ESP在Arduino等待AT+GMR响应超时之前，我们需要重新配置开发板以运行代码。作为替代方案，您可以按照此处所述设置开关并重新启动Arduino（使用Arduino重置，而不是ESP重置-或者只是将其关闭然后再次打开）。如果您使用的是ArduinoUno+WiFi扩展板，请将上面提到的2个DIP开关转到打开位置。如果您使用的是集成的ArduinoUno+WiFi板，请按如下方式设置8个DIP开关块：开关1和2-打开开关3和4-关闭开关5、6、7和8-关闭-即与前一个子步骤没有变化。如果您足够快，或者您使用了替代方案（设置开关并重新启动），您的Arduino应该加入您的WiFi网络。最后一个Arduino子步骤是访问我们的ArduinoLED服务。为此，您需要找出分配给您设备的IP地址。就我而言，我可以访问WiFi路由器管理控制台。我只是记下分配地址列表中出现的新设备（有点像确定Arduino在ArduinoIDE中分配的通信端口的过程）。这相对容易，因为对于我拥有的WiFi模块，系统名称要么是WiFi硬件的MAC地址，要么是名称中包含字母ESP。这两个示例可以从我的WiFi路由器管理控制台的屏幕截图中看到。注意：有时这里的内嵌图片似乎消失了，但我已将它们包含在此步骤的标题中。请注意，第一个包含Mega(192.168.3.160)的IP地址，因此另一个(192.168.3.94)是Uno。和以前一样，我们可以使用netcat在端口80上联系Uno并发出命令来点亮或关闭LED。第7步：后续步骤希望本文对您有所帮助，并使您能够轻松构建基于Arduino的WiFi应用程序。如果你这样做了，请点击“我构建了这个”链接让我知道。还有任何可以改进文章的反馈——例如，根据您在尝试自己做这件事时所面临的经验和挑战，我们将不胜感激。正如开场白中提到的，当与其他使用串行通信的设备（例如蓝牙模块）一起工作时，也可以使用这种技术。最好的下一步是将这个基础提升到一个新的水平。向Arduino代码添加功能。打开或关闭LED的过程全部在processInput(...)函数中处理，大约在主Arduino代码的第166行。在这个processInput(...)函数中，您将在大约第175行看到以下代码块：if(strncmp(msg,"+IPD",4)==0){HOST.println(F("Receivedinputfromclient"));charled=msg[9];charsetting=msg[10];if(led>='1'&&ledled=led-'1';}else{HOST.print(F("InvalidLED:"));HOST.println(led);return;}/**************************************Commentout/Uncommentthisblockofprint*statementstorepresentout"developmentcycle".*************************************/DEBUG.print(F("SettingLED"));DEBUG.print(led);DEBUG.print(F("onDIO"));DEBUG.print(led+5);DEBUG.println(setting=="+"?F("on"):F("off"));digitalWrite(led+5,setting=='+');}首先识别消息是从客户端输入的。如果传入的消息(msg)以“+IPD”开头，那么我们就知道它是来自客户端的消息。if块的其余部分处理消息。注释解释了正在发生的事情，因此我建议您参阅代码以进行解释。您可以更改此设置以识别和处理您自己的消息。当您这样做时，您可以控制您想要的任何内容，包括将消息发送回客户端。最后，程序如何在不将所有调试和状态消息发送到WiFi的情况下从Mega移植到Uno。记住：Mega使用Serial3进行WiFi交互，使用Serial(0)进行调试/状态消息。Uno使用Serial(0)进行WiFi交互，因此无法生成调试/状态消息。诀窍在于使用常量DEBUG、HOST（可以在上面的代码中看到）和ESP（可以在程序的其余部分看到）。这些常量是使用条件编译预处理器指令（即编译器#if语句）在程序顶部附近定义的。这出现在主要Arduino代码的第79到116行。在为Mega编译时，DEBUG和HOST定义为Serial(0)，ESP定义为Serial3。为Uno编译时，DEBUG和Host定义为NullSerial（即对我们在步骤3中创建的额外文件中的代码的引用），ESP定义为Serial(0)。在这两种情况下，都定义了一些附加常数（例如引脚数和波特率）来定义操作环境。因此，当在Uno上运行时，调试和状态消息会转到这个NullSerial对象。NullSerial是一个C++类，它定义了一些与Arduino提供的真正串行设备定义类似的方法集。例如，NullSerial有一个println()方法。NullSerial的println方法什么都不做。因此，发送到DEBUG和HOST的调试和状态消息会被简单地丢弃，因为它们无处可发送。

在本教程中，我将向您展示如何构建一个经济实惠的自动灌溉系统，这样您就不再需要手动给植物浇水了。该系统可用于室内植物、高架床，也可用于花园或更大绿地中的植物，因为连接植物的数量是可扩展的。关于何时灌溉的决定不是根据计时器做出的，而是直接测量土壤湿度并在此基础上做出是否需要灌溉的决定。该系统具有以下功能，可通过网络应用程序进行控制：以分钟、小时、日、周和月级别监控和显示时间序列数据设置应触发自动浇水的水位设置灌溉期间泵的工作时间用按钮手动激活灌溉在不同的传感器配置文件之间切换在深色和浅色主题之间切换第1步：零件清单NodeMCUESP8266树莓派1个树莓派SD卡继电器电容式土壤湿度传感器水泵水族箱管和灌溉喷嘴零件的数量取决于泵的数量。例如，在高架床上，通常有一个泵和一个传感器就足够了。但是，如果您有不同的盆栽植物，则它们都需要单独浇水，因此您必须为每个盆栽植物配备一个泵和传感器。第2步：硬件架构为了测量土壤湿度，NodeMCUESP8266微控制器读取电容传感器的模拟信号。然后将过滤和内插的测量值通过您的本地网络发送到RaspberryPi。您可以在此处决定是否触发与传感器关联的继电器。当继电器打开时，泵的回路关闭，植物能被浇水。选择该架构是为了将泵逻辑和测量数据的记录分开。这使得可以使用RaspberryPi控制多达26个泵（默认可用的GPIO引脚数量）。也不可能用树莓本身读取电容传感器的模拟信号，因为树莓只能处理数字信号。当然可以使用MCP3008和串行接口读取传感器，但这需要更多的引脚，而且设置不像以前那么干净。泵还单独连接到电源，其电路由继电器控制。所以也可以使用12V或更高的泵。第3步：软件架构对于软件架构，使用了MERNStack。该软件由一个带有Express.js的Node.js后端、一个Mongo数据库和一个React前端组成。C++脚本运行在NodeMCUESP8266上，它将数据发送到后端的REST接口。数据在后端处理，在那里决定是否灌溉。此外，数据随后会存储在MongoDB中。对于前端，还可以通过REST从后端请求这些数据。要安装完整的软件，请按照GitHub上的说明进行操作。第4步：3D打印外壳我为RaspberryPi和NodeMCU控制器设计并打印了一个磁盒。你可以在这里下载盒子的STL文件。第5步：成品展示如果您已正确安装硬件和软件，您现在应该能够在应用程序中看到您的第一个测量数据。要在浏览器中调用该应用程序，您必须输入以下URL：http://:5000。当然得换成树莓派的IP地址。现在，您可以在应用程序的首选项下输入您已将属于传感器的泵连接到的信号引脚。之后，您应该将容量传感器插入地面并设置最小土壤湿度值，在该值时PIN和继电器应被触发。设置其他首选项后，泵将根据您设置的首选项启动。如果您连接了多个传感器，它们会在上面作为选项卡列出。选择适当的选项卡以单独设置和监控所有传感器。

ThermoPen是我在2021年1月至3月期间进行的一个物理课程项目的结果。该项目的目标是创建可用于精确用例的便携式温度计。更具体地说，是为了检查PCB上的过热电子部件和一般故障排除而创建的。在我的学校，ThermoPen是一种需求量很大的产品，因为接触电子产品的多名教师需要一个工具来快速解决学生或他们自己的项目问题。那么这支奇怪的笔究竟是如何工作的呢？它只是粘在笔上的简单温度红外传感器吗？需要明确的是，该笔具有红外线传感器，可将物体发出的红外线转换为电信号，该电信号可以通过微控制器转换为温度。通过这种方式，我制作了一个集成了Atmega328P（与ArduinoUno/Nano相同的控制器）的PCB，以控制按钮和传感器的输入和输出。用最简单的表达方式，它是一个读取温度的Ir传感器。ThermoPen与这个基本概念的不同之处在于它包含对用户非常有用的功能，外形小巧纤薄。ThermoPen特点：-显示物体温度、环境温度、最高和最低物体温度的OLED屏幕-音频反馈-按下激活按钮-可充电锂离子电池电路-作为指针的激光二极管需要部件：-ArduinoUnoouNano（ArduinoAsIsp）-用于打印外壳的3D打印机-ThermoPenPCB-PCB制作用放大镜-自动锡针分配器第1步：项目概述和准备在开始构建红外测温仪之前，了解它的工作原理很重要。首先，ThermoPen围绕定制的PCB构建，该PCB集成了类似Arduino的电路。它的灵感来自用于集成Atmega328p微控制器的ArduinoNano电路和用于为ŀi-Ion电池充电的AdafruitArduinoUno扩展板电路。当按下按钮时，电池为电路供电，微控制器内的程序开始初始化。发出开机声音。1秒后，激光二极管点亮，屏幕打印从温度计传感器读取的实时数据。Arduino代码还计算最低和最高温度，以及电池电压和容量。松开电源按钮将使ThermoPen在关闭之前工作4-5秒，这可以通过电容器实现。需要明确的是，激光二极管的唯一目的是让用户了解测量温度的位置。真正的魔法是由Melexis制造的温度传感器MLX0614实现的，它使用物理原理，即物体会根据其温度发出一定量的红外光。从那里，传感器将接收到的红外波长量转换为与温度成正比的电信号，微控制器将其处理为摄氏温度。PCB有不同的可选LED，可以焊接。当电池电量过低时，会有一个指示。在这种情况下，电池图标也将开始闪烁。幸运的是，笔包括一个带有锂离子电池充电器电路的微型USB连接器，因此无需手动为电池充电。和每个人一样，我也会犯错，并从这些错误中吸取教训。最大限度地减少错误并最大限度地提高生产力的一种方法是制定项目每天需要完成的任务时间表。尽早开始您的计划，并清楚地知道何时应该完成产品。我在这个项目上工作了大约2个月。从逻辑上讲，您应该有我的不同计划，因为我为您提供了订购PCB、购买组件和打印外壳的资源。第2步：设计原理图和PCB正如我之前所说，原理图从ArduinoNano中汲取灵感，用于Atmega328P电路，包括其电源电路和时钟选择。为方便起见，我采用了产生较低频率的晶体，因为它会提高电池效率。Oled屏幕、蜂鸣器、IR传感器和激光二极管通过模拟引脚、数字引脚或I2C通信总线连接到微控制器。对于与锂离子电池充电和放电相关的电路，我从AdafruitArduinoUno扩展板中汲取了一些用于可充电电池的重要灵感。这是产品的链接：https://learn.adafruit.com/adafruit-powerboost-500...器材使用KiCad和一些由大型电子零件零售商DigiKey提供的库完成的。您将在ThermoPenGitHub中找到完整的KiCad项目。我使用KiCad进行原理图设计以及PCB设计。对于开源项目来说，这是一款非常强大的软件，而且是免费的。第3步：购物和订购电子零件在PCB设计期间，我还花时间选择适合我的用例的正确电子部件。例如，我必须选择一个小包装尺寸，以便它适合在一个小外壳内。大多数电阻器和电容器的封装尺寸为08x05。我很幸运在学校拥有其中一些部件，例如SMD按钮和红外传感器。对于所有其他零件，我是从北美最大的电子零件零售商之一Digikey订购的。为方便起见，我制作了所需的每个组件的Excel列表，以及它们的价格和商店链接。第4步：产品设计和3D渲染现在是具有挑战性的部分：将所有内容集成到一个小而实用的容器中！3D设计是使用Solidworks完成的。为了让我的项目进行过程更加轻松，我对我知道尺寸的所有部件进行了建模，例如电池、USB连接器、PCB、二极管激光器和红外传感器。我决定选择方形，这样我就可以轻松地将电线绕过电池或其他组件。因此，电池很好地夹在外壳和PCB中。对于按钮，我做了一个巧妙的设计，它集成了一个铝制按钮，该按钮被挤压在塑料外壳上的PCB按钮之间。激光二极管正好位于红外传感器之间，以实现最大精度。当产品在手中时，激光隐藏在笔尖后面。这是一种更优雅的激光集成方式，因为在用户看来激光来自红外传感器，但事实并非如此。在笔的主要一侧，我将Oled屏幕放在按钮旁边，将ThermoPen品牌放在另一端。一侧有两个充电指示灯孔，用于指示电池何时充电和充满。如您所见，笔的背面可以通过一个滑盖进入内部。它通过塑料支架固定在原位。组装在这一侧完成，也用于更换电池。第5步：3D打印零件并加工铝制按钮对于我设计的案例的每次迭代，我都将其进行3D打印以查看哪些有效以及哪些需要重新设计。在最终原型之前打印了大约6个不同的案例。我喜欢这一步，因为我可以与我的3D设计进行物理交互。也是在这一点上，我开始操纵进入ThermoPen组成的每个组件。然后我会改进我的CAD设计，这样零件就可以很好地装入外壳中。例如，我为激光二极管设计的孔因为太小而被重新设计；手持激光二极管帮助我修改了外壳设计。我使用的3D打印机是Prusai3MK3，它在ABS塑料方面做得很好。我从未真正遇到过打印失败的情况，因为打印机每次都能成功打印每个部分。我在原型上看到的唯一问题是，打印机很难准确打印笔的锋利边缘，因为其中一个侧面需要颠倒打印。我在打印机上添加了塑料支架选项，但我会得到相同的结果。如图所示，塑料一侧很光滑，但另一侧很粗糙。对于未来的生产，我将花时间抛光塑料，并可能为它们涂漆以获得更时尚的外观。我没有从产品上拆下按钮的任何图片，但加工过程非常简单。我制作了一个模式来表示2D中圆形按钮的形状。第6步：焊接PCB该项目最大的挑战之一是焊接每个部件都不会出现任何故障，因为PCB包含50多个需要不同焊接技术和设备的部件。首先，我设计了PCB，因此需要回流焊炉的所有组件都位于同一侧。Atmaga32P以及将电池的3.7V电压转换为微控制器的5V电压的升降压电路就是这种情况。为了更好地应用锡，我使用了一个电子放大镜和一个装满锡的定时空气分配器。升降压芯片给我带来了一些严重的麻烦，因为它的所有焊盘都在封装类型下方。结果，我的第一个焊接的PCB因为这个芯片短路而被烧毁。它给了我一些时间来发现问题，这使我重新考虑了电线的质量。幸运的是，我通过焊接一个新的PCB解决了这个问题，从现在开始，电路在通电时似乎反应正常。您会注意到PCB上有许多连接器孔。这是位于PCB外部的不同组件的电线将在组装步骤中焊接的地方。自此原型以来，某些零件和PCB封装发生了变化，例如电感封装，因为我只有一次机会在项目截止日期内开发和制造PCB。从那以后，我做了各种小调整，还添加了一个二极管，防止电池反向。第7步：微控制器的编程ThermoPenGitHub项目中提供了Arduino代码文件。我不会详细解释我的代码中的内容，因为它是一个相当简单的代码。它的一般内容是：-用于Oled屏幕、显示图形和红外传感器的多个库。-执行启动声音并初始化激光二极管和红外传感器的设置序列。-阅读和打印电池寿命。-打印物体温度、环境温度、最低和最高温度。为了对Atmega328p进行编程，我将ThermoPen视为另一个ArduinoUno/Nano。使用我们的PCB和另一个称为主机的Arduino之间的SPI连接，我可以使用一种称为“ArduinoasISP”的方法对我的焊接芯片进行编程。ArduinoISP是一个在系统编程器，用于对AVR微控制器进行编程。有关ArduinoISP编程的更多信息，请访问https://www.arduino.cc/en/Guide/ArduinoISP对于电池图标，我使用了臭名昭著的MicrosoftPaint来设计适合低分辨率屏幕的非常基本的图标。对于一定的电池电压范围，会打印与电池电压对应的图标。但是，我仍然认为电池图标是“工作和进步”，因为我没有验证哪个电池百分比对应哪个电池电压。需要说明的是，锂离子电池有特定的电池电压放电曲线，并不是一条直线！此外，我尝试包括睡眠模式，以便TermoPen在激活时间过长时进入睡眠状态以防止电池放电，但我没有成功使其工作。目前，它在没有此功能的情况下运行良好，我很满意。第8步：组装ThermoPen正如标题所暗示的那样，现在是将所有内容组装在一起的时候了。我首先将Oled显示器连接到PCB。我还为电池接触垫和微型USB连接器板添加了电线。我稍后会将它们焊接到他们的电线上，因为我之前需要在机箱中安装电线和PCB。当所有电线都正确定位后，我将PCB放置到位。外壳集成了塑料夹，可将PCB很好地固定到位。激光二极管需要在红外传感器就位后从外部放置，因为内部的孔太小。从那里，我们可以将激光二极管焊接到板上。就我而言，我在将二极管安装到外壳之前错误地焊接了二极管，因此在不切断电线的情况下不可能放置它。我最终切割它们，重新焊接它们，并添加了热缩管。对于这个原型，我放置了一个负极图标，因为我在接线中犯了一个错误。在最终设计中，我在外壳上加入了一个(-)符号，它会指示您需要放置电池(+)侧的位置。第9步：验证并体验其功能恭喜，我们刚刚完成了我们自己的ThermoPen的构建！现在是验证产品性能的步骤，从充电到温度感应。首先，我通过USB将ThermoPen连接到PC，以便我可以验证它是否为电池充电。侧面应出现橙色LED，表示电池正在充电。验证功能的另一种方法是使用万用表读取进入电池的电流。请注意，随着电池充电，当电池电压达到4.2V左右时，电流会降低到0A。然后，我们可以在上面的视频中看到我通过将ThermoPen温度与热电偶进行比较来测试温度测量。请注意，传感器是从一个旧的学生项目中恢复过来的，我不知道它的状况如何。结果对于低温非常好，对于高温可以接受。这些结果仅取决于传感器，因为制造商说它们在工厂进行了校准。我还测试了超温警报，当超过温度阈值（设置为120°C）时，蜂鸣器会发出声音。我仍然对这些结果非常满意，因为我知道ThermoPen中的所有系统和组件都按预期工作！我还必须说，在轻度使用4个月后，thermoPen仍然可以正常工作，从那时起我就没有用完电量！检测到的唯一缺陷是电池在外壳内轻微移动，因此我在外壳上添加了塑料支撑以防止这种烦恼。总而言之，考虑到我从一开始的所有期望都已实现并成功融入产品中，我为ThermoPen的最终结果感到自豪。在这个项目中，我从产品设计中学到了很多东西，它给了我丰富的经验，这肯定会影响我的学习和职业道路。

在手势技术的不断发展中，人们生活变得越来越便利，因为它非常直观、易于使用，并且清楚地使您与小工具和周围事物的交互变得充满未来感！因此，为了顺应潮流，我们将使用我们在之前的教学中构建的手表并投入一些机器学习，看看我们是否可以检测到我们正在执行的手势，也许在即将到来的教学中我们可以使用这个手势基于此执行一些非常厉害的项目。第1步：故事时间！我在我的Instagram页面上发布了一篇帖子，讲述了我将在此版本的手表上实现的所有新功能，但是，我删除了“用于充电的微型USB端口”、“按住以打开或关闭电路”和“心率”监测”。所以我想在项目中添加一些ML，与电子产品相比，它应该很容易，它只是一堆代码，我们必须从堆栈溢出中复制粘贴。如果您想了解有关在嵌入式系统上实施ML的更多信息，请查看2个链接TinyML和手势检测。一个解释了如何在Arduino中使用TinyML张量流，另一个解释了如何在Arduino上使用基本的ML算法。我从后一个链接中引用了很多内容，它非常易于遵循，并且可以与非常低内存资源的微控制器（如ArduinoNANO和UNO）配合使用。第2步：PCB组装我收集了该项目的所有SMD组件，然后将它们安排在一个我可以轻松访问而不会乱七八糟的地方。然后剩下的就是焊接！只需按照电路图并相应地在PCB中焊接组件。为了使焊接更容易，从焊接较小的SMD元件[电阻器、电容器、调节器]到更大的通孔元件[MPU6050、OLED]。在焊接过程中，我还使用3M胶带将Lipo电池固定在电路板和OLED显示器之间。我很难找到适合项目使用的调节器，所以在我过去的视频中，我只使用AMS1117，因为它更便宜且容易找到。但是为了使这个项目比以前的构建更高效。我在PCB中给出了2个选项，您可以使用MCP1700或LSD3985。就我而言，我使用的是LSD3985而忽略了MCP1700。您可以根据可用性使用任何选项。第3步：对手表进行编程为了简化编程，我在PCB上留出了一些空间，这样您只需插入FTDI模块即可开始编程。要对电路板进行编程，您必须先将esp8266置于闪烁模式，因此在连接到PC时，只需按住连接到esp12E的GPIO-0的按钮即可。要测试开发板是否正常工作，只需上传我之前的教程[Github链接]中的代码，然后测试所有功能（如NTP时间、轻弹唤醒和更改屏幕）是否有效。如果一切正常，您就完成了硬件部分。第4步：机器学习？[第1部分]机器学习听起来很花哨和复杂，但相信我，ML中的少数算法比其他少数非基于ML的算法更容易理解。对于大多数算法，当它需要找到问题的答案时，我们需要告诉算法它必须执行的过程序列才能获得最终结果。简单的例子是乘法。如果你想找到乘法问题的答案，比如说2乘以5我们可以告诉计算机执行多次加法来得到答案。你可以在这里看到，我们正在告诉计算机如何做才能得到答案。第5步：机器学习？[第2部分]ML的工作原理没有什么不同，我们只是给计算机一堆问题和相应的答案，然后让计算机找出方法或流程，这样它就可以回答任何新问题，而无需我们手动编程流程。举个例子，在照片中找到一个苹果，对于人类来说是非常容易的，但是我们很难编码并让计算机理解苹果的所有特征，这不是不可能，但它非常乏味和困难.相反，如果我们可以编写一种算法，该算法只需查看1000张苹果图片即可自行学习，那不是很好吗？使用ML算法还有另一个好处，那就是他们甚至可能想出一种我们从未想过的在照片中寻找苹果的新方法。因此，ML是一个非常有趣的探索领域。我真的不是解释机器学习和人工智能的最佳人选，我只是写下我学到的东西。但是如果你读了这么久，你应该看看我的YouTube频道，如果你还没有订阅这个频道，你可能应该立即订阅！相信我，这绝对值得！第6步：分类机器学习中有很多方法和技术可以解决问题，在我们进行手势检测的案例中，我将使用一种称为分类的技术。为什么要分类？在重复运动一段时间后，人眼似乎可以预测数据。现在，如果我在屏幕外执行相同的动作，您仍然可以通过查看图表来猜测它是什么动作，最好的部分是您甚至可以对其他手势和动作执行此操作。那是因为我们的大脑为不同的模式分配了不同的名称。类似地，如果我们可以多次向ML算法显示此数据模式，那么它会尝试理解这些数据并将它们放在不同的组中，或者可以说算法将数据样本分类为不同的类。因此，下次当它在数据中看到类似的模式时，它会弄清楚它是哪种运动或手势。这就是我们需要做分类的原因。第7步：收集用于训练的传感器数据由于我们现在对ML有了基本的了解，我们可以首先从收集用于训练ML算法的数据开始。我遵循的教程有一种非常笨拙的数据收集方式，通过串行监视器，因为我必须在手势期间将设备戴在手腕上。为了解决这个问题，我将数据收集无线化。我使用了esp8266的片上闪存，为了更方便，我在OLED显示屏上显示了采集和保存数据的状态。如果您想做同样的编译并将Data_collection.ino文件上传到您的手表。一旦你上传了代码，为了测试它，设备一启动就让你的手保持静止，它最初会校准加速度计和陀螺仪。完成后，您就可以开始收集数据了！只需按下连接GPIO-0的按钮，设备就会创建一个新功能，然后只需开始移动您的手即可记录运动。使数据采集无线化的努力绝对值得！毫无问题地收集每个运动大约25-30次要容易得多（您拥有的样本数量越多，算法的性能就越好）。第8步：处理数据您现在可以将收集到的数据转储到串行监视器，只需关闭电路电源并连接FTDI，然后在PC中打开串行监视器时再次按下程序按钮。这会将所有数据转储到串行监视器。然后只需将其复制粘贴到txt文件中即可。每个动作都会被一个短语“新功能”分开，因此您将知道哪些数据与哪个动作相关。然后使用excel将文本文件分成3个csv文件，分别用于向左滑动手势、向右滑动手势和猛击手势。这样就完成了数据收集部分。这些数据不应直接使用；必须对其进行处理以去除噪声，以便算法可以更准确地进行预测。但我没有做任何让整个项目变得更复杂的事情，所以我只是跳过所有这些并直接进入培训部分。第9步：训练模型这是您教您的ML算法检测手势的部分。为了训练数据，我使用python来训练模型并将其转换为C文件，我们可以在arduinoIDE中使用该文件。您可以从我的github存储库中获取此文件并打开“Python训练代码”文件夹中的“Classifier.py”文件，我们将读取csv文件并训练模型以学习我们之前记录的手势。如果您有不同的文件名，只需更改名为fileName的python列表，以便它会根据您收集的数据训练模型。运行此代码后，我们将创建一个“model.h”文件。该文件包含经过训练的模型，用于识别我们捕获的3个手势。如果您只想测试模型，请将您的“model.h”文件粘贴到“测试手势检测”文件夹中，然后打开该文件夹中的arduino文件。然后只需编译并将代码上传到您的手表。第10步：推断模型一旦代码上传到微控制器，我们的ML算法就不再学习，它只是使用我们之前创建的预训练模型，这称为推断模型。一旦代码上传成功，做出任何手势，oled显示器应该会显示你正在执行什么手势。在我的例子中，模型95%的时间都在工作，只是有时很难找到正确的滑动手势。可能是我收集的数据嘈杂，或者我在收集数据时没有正确进行运动。不管怎样，95%对我来说还是有好处的，我们可以通过这个手势检测做很多事情！以上就是关于这个项目的全部分享了，欢迎留言交流。

我们使用的汽车正在向着绿色节能、网络化、智能化的方向发展，车载电子设备的计算能力越来越高，作为人机界面的屏幕显示效果越来越好，内容越来越丰富。因为未来汽车那看得见的美好，各种资源都在向着这个领域汇聚，部分造车新势力的市场价值远远超越传统车企，能够完全实现自动驾驶的好日子似乎很快就要到了，想起来还是有点让人期盼的，我就盼着自己还在使用的车子能够顽强一点，熬到符合我理想的车子出现时再去更换。车载电子设备的能力越高，其内部资源也越多，耗电必会大幅增加，这对电源管理而言其实是个挑战。以先进制程打造出来的CPU、GPU能以更低的电压工作，但由于其内部资源的增多和运算速度的提高，需要消耗的电流也在大幅增长，再加上这些复杂器件的内部资源并非总是处于平稳的工作状态，按需启动的它们在一启一停之间便把瞬态的冲击施加到了电源上，加大了电源稳定其输出的难度，因而要求电源器件在有更大的负载能力、更高的调节精度的同时还要有更低的纹波指标和更快的应变能力，同时也要有更高的可靠性，能够耐受各种恶劣环境的考验，能够顺利通过严格的车规认证。RTQ2134-QA是通过了AEC-Q100Grade1认证的电源管理器件，它的内部包含有4路可以合并输出或单独输出的同步Buck转换器，其中的每一路都具有5.5A的电流输出能力，只需在其内部包含的一次性可写入存储器里写入特定的数据即可将其配置为2+2或2+1+1的形式，可分别提供10A+10A或10A+5A+5A的两组或三组输出，而每组输出的电压都可通过I2C接口进行动态调节以满足负载各种运行模式的需求。当两路以上的Buck合并运行时，合并在一起的各路以不同的相位运行是最合理的安排，这样可以使输入、输出纹波最小化，使整个系统的性能最优化，这便是RTQ2134-QA采用的多相运行模式，下图是其规格书里出示的Buck1和Buck4两相运行时的波形图，在负载电流为11A的情况下，输出纹波的峰峰值只有几个mV。现今的高性能处理器通常由多个内核构成，假如是FPGA则包含了大量可编程的逻辑单元，各内核或根据功能的需要而划分为区块的逻辑单元仅在有任务运行需求时才会进入工作状态，其他时候则处于待机状态，这样的一进一出对电源转换器来说便是负载的大幅跳变，必会造成其输出电压的下坠或隆起，逼得转换器必须以极快的速度对此进行响应，以便能将输出电压迅速拉回到原来的稳定状态，RTQ2134-QA解决此问题的办法是采用ACOT™（AdvancedConstant-On-Time,改进型固定导通时间）控制架构，它能在发现反馈电压低于参考电压时迅速开启导通时段以实现对输出端的能量补充，最大时延仅为100ns。在经过固定的导通时间后，如发现输出电压还没有恢复则又会在最多100ns以后再次进入导通时段，因而可以用最快的速度将输出电压修正到预设状态。上图所示的便是RTQ2134-QA分别在两相或单相运行时面对负载的突然增加的反应过程，很显然是两相运行时的输出电压修复能力会更强一些。对于负载的突然降低，Buck转换器的响应是尽快结束上桥开关的导通时段，RTQ2134-QA因为采用ACOT®控制架构而能立即进入这一状态，但是暂时失去原有出路的电感储能仍会因为向输出电容的转移而造成输出电压的隆起，这部分能量需在负载将其消耗以后输出电压才会自然回到稳定状态。将两个以上的Buck转换器组合成为多相运行状态的目的是提高负载能力、降低单个转换器所用元件的负担并使整体性能更优，但是每个转换器的运行都会造成一定的损耗。为了平衡这样的矛盾，RTQ2134-QA在以组合方式运行的两相转换器中加入了自动增相、减相的功能，能在负载大于一定水平（3A）时自动进入两相运行模式，又能在负载降低到一定水平（2.6A）时自动切换回单相运行模式，尽量把不必要的消耗自动降下来，因而具有低消耗、高供给的能力。为了进一步降低损耗，RTQ2134-QA还具有用户可选的轻载节能模式，这是一种电流不连续的运行方式，自然会带来输出纹波变大的结果，如果这是不可接受的，用户可在需要时将其设定为强制电流连续模式，这时便可以得到输出电压调节精度最高的状态。对于需要在运行中改变工作电压的应用，RTQ2134-QA支持以最高3.4MHz的时钟速度通过其I2C接口对其输出电压在0.3V~1.85V的范围内进行动态调节，也可以通过一个外接的输入信号对两个寄存器里设定的输出电压数据进行选择以实现快速的输出电压切换，而输出电压由一个水平变化到另外一个水平的速度是可以由用户进行设定的。作为一款车用电源管理芯片，RTQ2134-QA使用了方便进行光电式焊接状态检查的WET-WQFN-30L4.5x4(FC)封装，其中的FC说明其内部使用的是晶粒倒装结构，具有很好的功率耗散能力。其引脚布置是经过FMEA即失效模式及其影响分析的结果，可以防范相邻引脚短路、外部电路故障等可能带来的恶劣影响，可避免发生燃烧等严重事故。RTQ2134-QA的设计中也包含了许多故障防范措施如过流保护、欠压保护、超时保护、软启动和过热保护等，在各种故障发生时均可以发出中断信号的方式向控制系统发出通知以方便其进行处理，而暂存于寄存器里的数据则容许其查询故障所在，使问题处理过程能够更直接、更方便。RTQ2134-QA的输入电压范围为3V~6V，用于车机系统时可以利用我们介绍过的RTQ2965-QA等高压Buck器件作为电压预调节器去承接来自车辆电池总线的高压，高低搭配的结果是可以带来最佳的性能和成本效益，也使这些不同的器件能够各得其所，为人类的幸福生活做出最大的贡献。以上内容转载自RichtekTechnology。

日益增长的数据加速需求对硬件平台提出了越来越高的要求，FPGA作为一种可编程可定制化的高性能硬件发挥着越来越重要的作用。近年来，高端FPGA芯片采用了越来越多的HardIP去提升FPGA外围的数据传输带宽以及存储器带宽。但是在FPGA内部，可编程逻辑部分随着工艺提升而不断进步的同时，内外部数据交换性能的提升并没有那么明显，所以FPGA内部数据的交换越来越成为数据传输的瓶颈。为了解决这一问题，Achronix在其最新基于台积电（TSMC）7nmFinFET工艺的Speedster7tFPGA器件中包含了革命性的创新型二维片上网络（2DNoC）。这种2DNoC如同在FPGA可编程逻辑结构之上运行的高速公路网络一样，为FPGA外部高速接口和内部可编程逻辑的数据传输提供了大约高达27Tbps的超高带宽。作为Speedster7tFPGA器件中的重要创新之一，2DNoC为FPGA设计提供了几项重要优势，包括：提高设计的性能，让FPGA内部的数据传输不再成为瓶颈。节省FPGA可编程逻辑资源，简化逻辑设计，由NoC去替代传统的逻辑去做高速数据传输和数据总线管理。增加了FPGA的布线资源，对于资源占用很高的设计有效地降低布局布线拥塞的风险。实现真正的模块化设计，减小FPGA设计人员调试的工作量。本文用了一个具体的FPGA设计案例，来体现上面提到的NoC在FPGA设计中的几项重要作用。这个设计的主要目的是展示FPGA内部的逻辑如何去访问片外的存储器。如图1所示，本设计包含8个读写模块，这8个读写模块需要访问8个GDDR6通道，这样就需要一个8x8的AXIinterconnect模块，同时需要有跨时钟域的逻辑去将每个GDDR6用户接口时钟转换到逻辑主时钟。除了图1中的8个读写模块外，红色区域的逻辑都需要用FPGA的可编程逻辑去实现。图1传统FPGA实现架构对于AXIinterconnect模块，我们采用Github上开源的AXI4总线连接器来实现，这个AXI4总线连接器将4个AXI4总线主设备连接到8个AXI4总线从设备，源代码可以在参考文献2的链接中下载。我们在这个代码的基础上进行扩展，增加到8个AXI4总线主设备连接到8个AXI4总线从设备，同时加上了跨时钟域逻辑。为了进行对比，我们用另外一个设计，目的还是用这8个读写模块去访问8个GDDR6通道；不同的是，这次我们将8个读写模块连接到Achronix的Speedster7tFPGA器件的2DNoC上，然后通过2DNoC去访问8个GDDR6通道。如图2所示：图2Speedster7t1500的实现架构首先，我们从资源和性能上做一个对比，如图3所示：图3资源占用和性能对比从资源占用上看，用AXI总线连接器的设计会比用2DNoC的设计占用多出很多的资源，以实现AXIinterconnect还有跨时钟域的逻辑。这里还要说明一点，这个开源的AXIinterconnect实现的是一种最简单的总线连接器，并不支持2DNoC所能提供的所有功能，比如地址表映射，优先级配置。最重要的一点是AXIinterconnect只支持阻塞访问（blocking），不支持非阻塞访问（non-blocking）。阻塞访问是指发起读或者写请求以后，要等到本次读或者写操作完成以后，才能发起下一次的读或者写请求。而非阻塞访问是指可以连续发起读或者写请求，而不用等待上次的读或者写操作完成。在提高GDDR6的访问效率上面，阻塞访问会让读写效率大大下降。如果用FPGA的可编程逻辑去实现完整的2DNoC功能，包括64个接入点、128bit位宽和400MHz的速率，大概需要850kLE，等效于占用了Speedster7t1500FPGA器件56%的可编程资源。而2DNoC则可以提供80个接入点、256bit位宽和2GHz速率，而且不占用FPGA可编程逻辑。从性能上来看，使用AXI总线连接器的设计只能跑到157MHz，而使用NoC的设计则能跑到500MHz。如果我们看一下设计后端的布局布线图，就会有更深刻的认识。图4所示的是使用AXI总线连接器的设计后端布局布线图。图4使用AXIinterconnect的设计后端布局布线图从图中可以看到，因为GDDR6控制器分布在器件的两侧（图中彩色高亮的部分），所以AXI总线连接器的布局基本分布在器件的中间，既不能靠近左边，也不能靠近右边，所以这样就导致了性能上不去。如果增加pipeline的寄存器可以提高系统的性能，但是这样会占用大量的寄存器资源，同时会给GDDR的访问带来很大的延时。如果再看一下图5中使用了2DNoC的布局布线图，就会有很明显的对比。首先，因为用2DNoC实现了AXI总线连接器和跨时钟域的模块，这就节省了大量的资源；另外，因为2DNoC遍布在整个器件上，一共有80个接入点，所以8个读写模块可以由工具放置在器件的任何地方，而不影响设计的性能。图5使用2DNoC设计的后端布局布线图从本设计的整个流程来看，使用2DNoC会极大的简化设计，提高性能，同时节省大量的资源；FPGA设计工程师可以花更多的精力在核心模块或者算法模块设计上面，把总线传输、外部接口访问仲裁和接口异步时钟域的转换等工作全部交给2DNoC吧。转载自电子技术应用。

随着集成电路的飞速发展，在图像处理，通信和多媒体等很多领域中，数字信号处理技术已经被广泛应用。快速傅立叶变换（FFT）算法的提出，使得数字信号处理的运算时间上面缩短了好几个数量级。因此对FFT算法及其实现方法的研究具有很强的理论和现实意义。1FFT算法及其实现方法现场可编程门阵列FPGA是一种可编程使用的信号处理器件，其运算速度高，内置高速乘法器可实现复杂累加乘法运算；同时其存储量大，无需外接存储器就可实现大量数据运算；而且算法实现简单，通过VHDL编程语言可轻松实现功能开发，缩短了开发周期。FPGA已经在通讯、视频、图像处理等领域被广泛使用。本次设计采用FPGA实现8点32位的FFT变换，现场可编程门阵列FPGA是一种可编程使用的信号处理器件，用户可以通过改变配置信息对其功能进行定义，以满足设计需求。与DSP相比，FPGA实现FFT具有速度高，存储容量大，硬件实现简单，I/O带宽高等特点。FFT处理器被分成一下几个主要的功能模块：数据地址产生单元、蝶形运算单元、数据选择单元、控制单元、存储单元等。通过VHDL语言在CycloneII系列芯片上编程实现。运算方案采用顺序处理的方法。傅立叶变换实现时首先进行基2、基4分解，一般来说，如果算法使用基2实现，虽然使用的资源较多，但速度优势明显。设计中采用基-2DIT-FFT算法来实现整个系统的设计，如图1所示。图1在FFT模块的设计中，旋转因子与输入数据进行的是一个小数乘法的蝶形运算，需要将旋转因子表示成小数的二进制形式。为了保证运算结果的正确性，还需要将输入和输出数据进行小数点的调整。在此次设计中采用定点小数的方法，所谓定点小数，就是小数点的位置是固定的。设计中统一将小数点放在了Q6的位置，在仿真的结果图中显示的输出数据均是小数点经过移位后的结果即结果均扩大了64倍。复数乘法器采用FPGA内部IP核的例化与调用来设计实现了蝶形处理，这样就可以提高蝶形运算单元的的运算速度，降低了运算复杂度。控制单元的设计通过一个有限状态机来实现控制器。通过有限状态机状态的输出分别控制ROM因子表、随机存储器RAM和蝶形处理器。使它们可以协调一致地工作，从而实现FFT运算的正确输出。将系统设计的各个模块连接起来，利用顺序处理的FFT设计结构，将输入数据的8个点放到RAM中进行处理。经过元件例化和调用操作完一级蝶形之后对其结果进行存储；之后完成二级蝶形操作及存储；最后进行三级蝶形的操作。若输入8点数据为[5,8,3,2.0,6,1,2].其仿真结果经转换后的值为（即结果扩大了64倍）：[1728,410-j218,64-j640,230+j38,-576,230-j38,64+j640,410+j218],与MATLAB仿真的结果一致。如图2所示，图中的x0,x1,x2……x7是输入信号，分别给它们输入的值为[5,8,3,2,0,6,1,2];y0_i,y0_r……y7_i,y7_r是仿真中得到的输出信号。经过运算，输出结果与理论计算结果一致。图22总结通过仿真验证此次利用FPGA实现的FFT设计采用内置双端口RAM、ROM单元，实现了存取数据、旋转因子计算、蝶形计算，系统结构简单，运算可靠性高，速度得到了进一步提升。转载自唯样电子资讯。

数字电位器(digiPOT)功能多样，应用广泛，例如，用于滤除或生成交流信号。但是，有时频率必须能够有所变化，并根据应用需求调整。在此类设计中，支持通过适当的接口调整频率的可编程解决方案极为有用，在有些情况下，非常有助于开发。本文介绍一种简单易行的可编程振荡器构建方法，其中，振荡频率和幅度可以通过使用digiPOT来彼此独立地调节。图1.振幅稳定的可编程文氏电桥振荡器，其中电阻由digiPOT代替。图1显示的是典型二极管稳定文氏电桥振荡器，可用于在输出端(VOUTPUT)产生约10kHz至200kHz的精确正弦波信号。文氏电桥振荡器有两个桥路，一个由带通滤波器构成，另一个由分压器构成。除了ADA4610-1轨到轨精密放大器之外，本示例还使用了AD5142digiPOT，其包含两个独立可控的电位器，每个具备256步进分辨率。电阻值通过SPI编程设置，如图2所示。或者，可以使用由I²C控制的AD5142A。两种都可用作10kΩ或100kΩ电位器。图2.AD5142的功能框图。在图1所示的经典振荡器电路中，R1A、R1B、C1和C2的路径形成正反馈，而R2A、R2B和两个并联二极管D1和D2或其电阻RDIODE则形成负反馈。在这种情况下，可以使用公式1：为了实现持续稳定的振荡，需要消除环路增益中的相移。用公式表示，振荡频率：其中，R表示AD5142上的可编程电阻值：D表示AD5142中可编程数字代码的十进制等效值，RAB表示电位器的总电阻。为了保持振荡，文氏电桥振荡器应当相对平衡，也就是说，正反馈增益和负反馈增益必须协调一致。如果正反馈（增益）过大，振荡幅度或VOUTPUT将增加，直至放大器饱和。如果负反馈占主导，则振荡幅度将相应衰减。在此处所示的电路中，增益R2/R1应设置为2左右或更大些。这会确保信号开始振荡。但是，交替开启负反馈环路中的二极管也会导致增益暂时小于2，从而使振荡稳定下来。一旦确定所需的振荡频率，就可以通过R2，不受频率影响地调谐振荡幅度。可以通过下式计算：所以，变量ID和VD分别代表通过D1和D2的二极管正向电流和二极管正向电压。如果R2B出现短路，会产生约±0.6V的振荡幅度。R2B的幅度量级正确时，则可达到平衡，从而使VOUTPUT收敛。在图1所示的电路中，R2B采用了一个单独的100kΩdigiPOT。结论通过采用所述的电路和10kΩ双digiPOT，可以分别以8kΩ、4kΩ和670Ω的电阻值调谐8.8kHz、17.6kHz和102kHz振荡频率，频率误差低至±3%。提高输出频率可能会影响频率误差。例如，200kHz时，频率误差将增至6%。在频率相关应用中使用此类电路时，必须注意不要超过digiPOT的带宽限值，因为该值与可编程电阻呈函数关系。此外，图1所示的频率调谐要求R1A和R1B的电阻值相同。但是，两个通道只能依次设置，并会导致瞬时临界中间状态。对于某些应用，这种情况是不可接受的。在这些情况下，可以使用支持菊花链模式的digiPOT（例如AD5204），以便能够同时更改电阻值。转载自电子技术应用。

USBType-C接口的出现对电子产品用户来说真是太好了，不仅能得到好的性能，使用起来也很方便，正插、反插都可以，既不用担心插不进，也不用担心插错了，很多问题都被设计本身包容了。图：电缆连接方式1图：电缆连接方式2图：兼容不同连接方式的系统实现示意图由于PD（电源传输）协议的加持，USB-C型接口可以传输的最大功率为100W，VBUS上的最高电压达到了20V，相应的电流就不会太大，降低了对连接器和电缆的低阻抗要求，最新的USB4还将雷电接口、PCIe和DisplayPort也兼容了进去，为设备间的互联带来了巨大的方便，人们的生活将变得越来越方便。虽然好处多多，USBType-C接口的设计中也存在一些隐患，主要是两个CC端和两个SBU端与VBUS靠得太近了，插拔和摇动的时候容易发生短路的状况，而VBUS的最高电压达20V，这就给与CC和SBU端子连接的内部器件带来了风险，使它们很容易受到伤害，这个问题已经在应用中反复出现。立锜科技的USBType-C/PD产品都具有CC端高压防护能力，但这只能确保自身器件的安全，不能确保没有使用立锜产品的应用也是安全的。USB端口面临的另外一个风险来自静电，它们积聚在机壳上或外部物体上，一有机会就可能通过它的金属端子得到泄放，这个过程也很可能对其内部连接的芯片造成损害。为了防范上述风险，将RT1738连接在USBType-C接口和与接口相关的芯片之间就行了。RT1738的内部电路结构如下图所示：RT1738给与之连接的每个信号线都提供了静电泄放通道，在CC线和SBU线上插入了过压保护开关，前者可让静电自然流动消失而不带来损害，后者在接口端出现过压状况时可即时切断信号通路，避免内部主芯片受到高压的损害。如上图所示，当RT1738与连接器相连的CON_CC1端出现了从0V开始逐渐上升到最高24V的电压信号时，最初这个信号是可以直接传递到与主芯片相连的CC1一侧的，但在该信号电压上升到大约6.5V时CC1的电压就掉头向下了，因为连接在其间的信号开关已经被切断了。按照RT1738规格书的定义，CC信号过压保护的触发阈值为5.9V，过压保护开关断开的响应时间为60ns，从上图所示信号的变化过程来看，该开关的响应特性是符合此规格的。我们之所以看到CC1处的信号在大约6.5V左右才掉头向下，这是因为CON_CC1处的信号在这几十ns的时间里还是处于上升状态的，其影响必然会在CC1端反应出来。由于过压保护开关需要时间进行关断，出现在CON_CC1端的电压很可能在这段时间里被快速拉升，因此就有可能在CC1端出现可能危害主芯片的高电压，RT1738就在CC1端放置了一个阈值电压为7V的电压钳位单元，绝不让这个地方的电压超过7V。由于在信号线上插入了开关，信号通过的时候就会被衰减，线路的电流通过能力也会受到影响，为了将这种影响降到可以接受的程度，RT1738在CC线上插入开关的导通阻抗在25℃时的典型值仅为255mΩ，最大也不会超过390mΩ，容许的最大电流通过能力为±1.25A，而它们的-3dB信号带宽则高达400MHz，完全可以满足300Kbps的BMC信号传输的需求。RT1738为SBU信号线提供的处理方法与CC线类似，但是相应的参数略有区别。在实际的应用中，USBType-C接口的SBU1/2很可能被用于传输音频信号，它所要求的信号带宽可能会更宽，RT1738给此信号线提供的带宽高达1.1GHz，两个通道之间的串扰低达-80dB，满足常规应用的需求应该是没有问题的。现在把RT1738的抗静电指标列于下图，需要更多信息的读者可以到立绮官网查看规格书。转载自RichtekTechnology。

电阻器自发热的计算是一个非常基本的概念，但很多工程师对它并不熟悉，或经常被他们忽略。在我阐述最近设计的高精度电阻式温度检测器（RTD）采集系统的原理时，我意识到了它的重要性。对于图1中的简化设计，需要考虑信号路径中电阻器自发热引起的误差，才能防止它们所导致的不希望出现的误差级。图1:简化的比率计RTD系统该设计针对比率计测量设计，因此模数转换器（ADC）的最终转换结果直接取决于参考电阻器RREF的绝对值。由于RREF上有激励电流经过，因此它会消耗电源并发热，从而可引起电阻变化，影响系统精确度。此外，电阻器自发热影响在电流感应或功率测量等众多其它应用中也很重要，其取决于电阻器绝对值，因为在电阻器消耗电源时它可能会改变阻值。电阻器的温度系数（或TC）规定了电阻器温度变化时电阻的变化范围。电阻器TC的单位一般是每摄氏度百万分之一（ppm/°C）。一个1%电阻器具有大约+/-100ppm/°C的TC,而高精度金属箔电阻器则提供不足0.1ppm/°C的TC。公式1和公式2是温度从25°C到125°C变化时，如何使用电阻器TC规范计算1kΩ、±100ppm/°C电阻器阻值ΔRTC变化的实例。一般来说，较小表面安装组件（0201、0402、0603等）在功率耗散方面效率较低，因此具有极高的自发热系数θSH,有时高达1000°C/W以上！这些较小电阻器的额定功率级通常小于0.1W，但其温度会随功率耗散极其快速地变化。公式3可计算功率耗散所引起的电阻器温度增加量ΔTSH。公式4将ΔTSH插入公式1替代ΔT，以确定100°C/W适度自发热和0.5W功率耗散情况下自发热所引起的电阻变化。尽管电阻器产品说明书中通常不提供自发热系数，但通常都包含功率额定值下降曲线，您可通过该曲线反向计算出自发热系数。功率额定值下降曲线可在不超过最大指定温度情况下，针对环境温度规定电阻器的最大功耗。图2是0.5W电阻器的电阻器功率额定值下降曲线实例。图2:0.5W电阻器的功率额定值下降曲线您可以从图2的曲线中轻松确定最大工作温度TMAX，也就是在额定耗散等于0%时x轴上的值。在所示实例中，最大工作温度是150°C。另外，电阻器也不可能在100%额定耗散（TMAX_PWR100%）、85°C下工作。您可通过该温度、最大工作温度以及电阻器的功率额定值计算出针对θSH的值，公式如下。您现在可凭借计算得出的自发热系数确定热增加量，从而可使用公式3和公式4计算功率耗散所引起的电阻变化。因此，您可根据电阻变化确定对最终系统精度的影响。因此下次再设计需要高精度电阻器值的系统时，一定要考虑电阻器自发热因素！来源：维库电子市场网

近几年来，在苹果公司iPhone手机的带动下，智能手机市场迅速扩大。智能手机等便携产品的一个重要特点是功能越来越多，从而支持更广泛的消费需求。但智能手机等便携产品内部用于支持不同功能的集成电路(IC)或模块的工作电压往往不同，如基带处理器和应用处理器电压一般在1.5V至1.8V之间，而现有许多外设工作电压一般为2.6至3.3V，如USIM卡、Wi-Fi模块、调频(FM)调谐器模块工作电压为2.8V，而相机模块为2.7V。图1：逻辑电平转换器应用示意图因此，智能手机等便携产品中的不同IC与外设模块之间存在输入/输出电压失配问题，要使这些器件与模块之间互相通信，需要高效的逻辑电压电平转换。所谓的逻辑电平转换器即连接不同工作电压的IC与模块或印制电路板(PCB)，提供系统集成解决方案。传统逻辑电平转换方法及其优缺点表1：传统逻辑电平转换方法及优缺点由于晶体管-晶体管逻辑(TTL)和互补金属氧化物半导体(CMOS)是逻辑电路中的标准电平，因传统逻辑电平转换方法中，TTL-CMOS输入转换很常见。这种转换方法简单，成本低，主要用于低电平至高电平转换，也能用于转换高电平至低电平。这种转换方法也存在一些缺点。其它传统逻辑电平转换方法还有过压容限(OVT)电压转换、漏极开路(OD)/有源下拉转换和分立I2C转换等，各有其优缺点，参见表1。双电源逻辑电平转换及应用逻辑电平转换中会消耗功率。例如，在低至高电平转换中，为了输出高逻辑电平，输入电压(Vin)低于VCC，电源电流变化(ΔICC)始终较高，因此功耗也较高。为了解决高功耗的问题，可以采用双电源电压(VCCA及VCCB)逻辑电平转换器，在逻辑电源电压(VL)等于Vin时，ΔICC就为0，从而降低功耗。常见双电源逻辑电平转换包括单向转换、带方向控制引脚的双向转换、自动感测双向转换(推挽型输出)及用于漏极开路应用(如I2C)的自动感测双向转换等，结构示意图如图2所示。图2：几种双电源逻辑电平转换器的结构示意图在这些双电源逻辑电平转换方法中，单向逻辑电平转换的原理就是在输出启用(OutputEnable，)为低电平时，提供A点至B点转换;而在输出启用为高电平时，A、B之间呈现高阻态(Hi-Z)，通常当作电阻无穷大来处理，相当于没有接通。常见的双电源单向逻辑电平转换器有如安森美半导体的NLSV1T34AMX1TCG、NLSV2T244MUTAG、NLSV4T3234FCT1G、NLSV8T244MUTAG、NLSV22T244MUTAG等。这些双电源单向逻辑电平转换器的应用包括通用输入输出(GPIO)端口、串行外设接口(SPI)端口和通用串行总线(USB)端口等。带方向控制引脚的双向逻辑电平转换器的工作原理是：引脚和方向控制(DIRection，T/)引脚均为低电平时，提供B点至A点转换;引脚为低电平、T/引脚为高电平时，提供A点至B点转换;而在引脚为高电平时，A点至B点方向和B点至A点方向均处于高阻态，相当于没有接通。安森美半导体即将推出带方向控制引脚的双向逻辑电平转换器。这类转换器的常见应用是以字节(byte)访问的存储器及I/O器件。自动感测双向逻辑电平转换器(推挽型输出)的工作原理是：启用(EN)引脚为低电平时，转换器处于待机状态;EN引脚为高电平、I/O电平不变时，转换器处于稳态;EN引脚为高电平、I/O电平变化时，转换器检测到变化，并产生脉冲，I/O藉P沟道MOSFET(PMOS)上拉至更快。典型的自动感测方向双向逻辑电平转换器(推挽型输出)有如安森美半导体的NLSX3012MUTAG、NLSX3013FCT1G、NLSX3013BFCT1G、NLSX4014MUTAG和NLSX3018MUTAG等。这类转换器的常见应用包括通用异步收发器(UART)、USB端口、4线SPI端口和3线SPI端口等。用于漏极开路应用(如I2C)的自动感测双向逻辑电平转换器同样包含3个状态：EN引脚为高电平、NMOS导通时，处于工作状态，输入端I/O电平下拉至地，即输入低电平;EN引脚为高电平、NMOS处于高阻态时，处于工作状态，输出端I/O电平上拉至VCC，即输入高电平;EN引脚为低电平时，转换器处于待机状态。典型的用于漏极开路应用(如I2C)的自动感测双向逻辑电平转换器有如安森美半导体的NLSX4373MUTAG、NLSX4348FCT1G和NSLX4378BFCT1G等。这类转换器的常见应用包括I2C总线、用户识别模块(SIM)卡、单线(1-Wire)总线、显示模块、安全数字输入输出(SDIO)卡等。上述几种双电源逻辑电平转换器中，不带方向控制引脚的自动感测转换器和带方向控制引脚的转换器各有其优劣势。自动感测转换器的优势主要体现在将微控制器的I/O线路减至最少，是用于异步通信的简单方案，劣势则是成本高于及带宽低于带方向控制引脚的转换器。带方向控制引脚的转换器优势是作为大宗商品元件，成本低，是用于存储器映射I/O的简单方案，劣势则是微控制器引脚数量多。而在不带方向控制引脚的自动感测转换器中，也有集成方案(如NLSX3373)与分立方案(如NTZD3154N)之区别。集成方案NLSX3373为单颗IC，估计占用的印制电路板(PCB)空间仅为2.6mm2;分立方案NTZD3154N采用双MOSFET及4颗01005封装(即0402)的电阻，估计占用的PCB总空间为3.3mm2。集成方案提供低功率待机模式，而分立方案则不提供高阻抗/待机模式。这两种不同方案的低压工作特性、带宽及电路特性也各不相同。来源：维库电子市场网

实时视频图像处理中，低层的预处理算法处理的数据量大，对处理速度要求高，但算法相对比较简单，适合于用FPGA进行硬件实现，这样能兼顾速度及灵活性。高层的处理算法结构复杂，适用于运算速度高、寻址方式灵活、通信机制强的DSP芯片宋实现。DSP+FPGA架构的最大特点是结构灵活、有较强的通用性、适合于模块化设计，从而能够提高算法效率，同时其开发周期短、系统易于维护和升级，适合于实时视频图像处理。系统采用模块化的设计方法，将整个系统划分为三部分：视频采集单元、视频处理单元和视频传输单元。整个系统以FPGA作为核心控制单元并完成视频信号的中值滤波工作;以DSP作为整个系统的核心处理单元对采集的视频图像信息进行JPEG压缩;在视频传输单元设计了以PDIUSBD12芯片为基础的USB总线，负责视频信号的传输。1系统硬件总体架构一个完整的视频处理系统，主要由视频采集单元、视频处理单元及视频传输单元三部分组成。在进行系统设计时须确保各部分的无缝衔接。图像采集单元由FPGA和MB86S02视频采集芯片组成，包括视频信号的采集和预处理，把输入的视频信号转换成系统能够处理的数字图像数据，并按照一定的格式存储在确定的存储区域。图像处理单元是本系统的核心，对图像数据进行压缩处理，实现系统要达到的功能。图像传输单元采用FPGA+USB的方式实现视频数据的传输，通过基于PDIUSBD12芯片的USB总线，将压缩后的视频图像信息发送到接收端，在接收端使用在PC上编写的应用程序将图像解压缩并显示出来。整个硬件系统由FPGA和DSP两个分系统组成，FPGA作为视频采集单元，将采集到的视频信号预处理后传给DSP，DSP作为图像处理单元是本系统的核心，对FPGA预处理后的视频图像信息进行JPEG压缩处理，DSP单元的性能决定着整个系统的性能，DSP完成图像处理任务后，将把结果返回给FPGA，FPGA将经过压缩处理后的图像信息写入接口控制芯片的数据缓冲区，由接口控制芯片负责信息的传输，系统总体框图如图1所示。图1系统总体结构图如图1所示，MB86S02视频图像传感器在FPGA的控制下进行视频图像信息的采集，在收到PC机的采集命令后MB86S02开始视频信号的采集FPGA作为系统的核心控制单元不仅负责视频图像的采集，而且负责视频图像信息的预处理和系统各单元模块之间的数据交互。针对视频图像数据量大的特点，为了保证系统的实时性要求，系统采用大容量的片外SDRAMR对采集到的视频图像信息进行缓存，SDRAM控制器由FPGA实现，视频图像信息经过SDRAM缓存后首先要由FPGA对其进行滤波处理，以消除图像信息中的噪声干扰，本系统中采用中值滤波的方式对采集到的视频信息进行处理，滤波后的数据通过FPGA内部FIFO进入DSP进行下一步的压缩处理。DSP上电后首先进行引导程序的自加载，等待FPGA发送请求，在收到FPGA的请求后，DSP建立EDMA通道从FPGA获取视频数据，存满一帧后，开始对视频图像进行JPEG压缩处理，压缩处理后的视频图像信息经过FIFO缓存后，在FPGA的控制下写入USB接口控制器的数据缓存区，等待PC机的读数请求，USB接口控制器在收到PC机的读数请求后将数据写入PDIUSBD12的端口1，以便PC机下一步读取数据。2系统软件总体设计系统的软件设计根据硬件结构的总体划分，也可以分为两大部分来描述。整个系统的运行如图2所示，FPGA和DSP各自的程序独立运行，通过中断信号完成数据的实时交互。FPGA向DSP方向的指令是通过FPGA发送一个EDMA请求，DSP通过响应EDMA请求，建立EDMA通道，开始从FIFO中进行预处理后数据的读取，DSP向FPGA传输数据时，通过向FPGA发送一个中断信号，让其从FIFO中把压缩后的图像数据读出来。图2系统软件软件流程图如图2所示，整个系统工作流程可以简单描述如下：系统上电后，首先DSP由flash实现自举，并运行引导程序，之后转入EDMA等待状态，FPGA初始化后等待外部图像采集命令，收到图像采集命令后开始进行图像采集，并对采集到的图像进行预处理，预处理后的图像经过FIFO缓冲，在存储一定量的数据之后，FPGA通过半满信号向DSP发送EDMA请求，等待DSP响应，DSP一旦收到来自FPGA的EDMA请求，立即建立EDMA通道，从FIFO中读取数据到L2存储器，存满一帧图像后DSP开始图像压缩，等待一幅图像压缩完成之后，DSP会向FPGA发送中断信号，FPGA在收到中断信号后开始从FIFO中读取压缩后的图像数据。一帧数据读完后，判断编码信号是否有效，如果有效则按同样的规则对下一帧图像进行压缩，如果无效则通知DSP结束。3结论本设计方案已经经过了硬件验证，达到了预定的设计要求，实现了大数据量的实时处理。系统体积仅为70×70mm,功耗小于5W,中值滤波速率平均20F/S,JPEG压缩速率平均25F/s以上。不仅满足了视频处理系统的实时性要求，且体积小、功耗低，而且基于FPGA的可编程性，本系统具有良好的灵活性和扩展性。来源：维库电子市场网

在SoC系统的设计及使用过程中，对其内部行为的实时监控十分重要，目前普遍通过监控端和目标系统间的监控信息通信来实现，UART常用作通信信道。目标SoC系统常使用中断方式或轮询方式获取监控通信数据包，对其解析并进行相应数据操作后回复应答信息。中断方式中SoC需完成保存中断现场、调用中断服务程序、恢复现场系列任务，上下文的切换占据了系统额外开销；轮询方式中，系统定时检查设备请求，若有数据到达则调用相应处理程序，固定的轮询周期增加了数据等待处理时间，数据量较小时频繁查询造成对CPU资源的浪费。针对上述问题，提出一种的新监控方法，设计一个FPGA通信系统，由其作为SoC与监控计算机数据交互的桥梁，负责完成在线监控的通信过程，保证被调试系统和调试主机之间调试信息和命令的交互可靠性，可避免目标SoC频繁的处理通信中断，提高其控制性能。监控功能实现机制与通信系统主要模块的设计方法将被讨论，通过对比嵌入式CPU在不同监控方法中的通信时间消耗，说明该方法具有一定实用价值。1系统组成结构基于FPGA设计片上通信系统如图1所示，其主要组成部分为Modbus解析模块和双口RAM存储模块。上位机发出监控命令帧数据时，由Modbus模块完成命令帧的接收、解析过程，并将待操作地址、数据等信息存入双口RAM中，目标CPU据此将自身内存映像区的相应数据一次搬入双口RAM，搬移完毕后，Modbus协议模块进行应答数据组帧，并向监控上位机发回应答数据，实现对监控数据的实时可靠采集。图1通信系统组成结构2基于双口RAM的数据交互设计2.1双口RAM定制及内存映射设计目标SoC中的待监控数据状态量在内存中的存储方式，可抽象表示为如图2中内存映像。图2双口RAM的内存映射机制双口RAM中存储当前待监控数据对象集合，是目标CPU内存映像区的一个数据子集。由于当前监控对象可随机落在内存映像区的任意存储块上，双口RAM的内存映射方式选取为随机映射，如图2所示。分散存放于CPU内存映像区的监控对象，映射为双口RAM中的连续存储区。上位机基于Modbus协议与FPGA片上系统通信时，访问连续的地址单元，保证了数据访问速度，提高系统的通信效率。2.2双口RAM中的数据操作设计2.2.1上位机对双口RAM的读写操作PC上位机为通信发起方，通过串口与FPGA片上系统连接，采用Modbus-RTU协议进行数据通信，完成对运行参数的读取和写入等操作，实现监控功能。表1监控通信过程占用CPU时间用户在人机界面输入本次待监控对象信息，后台软件依据Modbus帧结构及约定的双口RAM内存映射机制，组成监控命令帧并通过串口发出。FPGA片上系统对收到的命令帧进行解析，获取操作功能码、目标地址、数据包大小等信息，据此向双口RAM区写入待操作数据地址集，写入完毕后向目标CPU申请通信中断。根据Modbus命令帧中给出的数据操作长度，一次可对多个数据单元进行读/写操作。2.2.2目标CPU对双口RAM的读写操作目标CPU收到通信中断请求后，读双口RAM区的中断邮箱，邮箱信息包含本次申请功能(读或写)及申请的数据项个数等。根据申请地址集，将自身内存映像区相应数据集一次搬入双口RAM，或将双口RAM中数据集一次搬入内存映像区相应地址处，搬移完毕后，清空中断邮箱，向监控模块发出中断应答。3Modbus协议栈模块的设计与实现采用自顶向下的设计方法，根据功能需求设计Modbus协议栈顶层原理框图如图3。使用VHDL硬件描述语言编程实现各组成子模块，功能如下述。图3Modbus协议栈顶层框图(1)时钟生成模块：通过分频和相移产生位时钟clk和1/16位时钟bclk，作为控制其他模块的运行节拍，保证系统运行同步。(2)串口接收模块：以bclk作为控制时钟，对接收的位数据作中点采样，进行串并装换得到字节数据。(3)串口发送模块：以bclk作为控制时钟，发送使能信号有效时，输入端的字节数据进行并串装换，通过串口发出。(4)接收控制模块：判断帧的起始、结束、是否接收错误；提供地址数据，接收的字节数据被存储至RAM1中相应存储单元。(5)CRC校验/生成模块：使用基于字节的CRC_16校验码运算方法。接收端的校验过程与数据接收同步进行，接收控制模块每收到一个字节数据，CRC校验模块对其作一次CRC码计算；CRC生成模块运行机制类同。同步运算可有效减少一次对帧数据的遍历。(6)解析主控模块：作为系统的核心，负责解析收到的命令帧，根据解析信息进行数据读写操作，组成应答帧，控制串口发送模块发送应答数据等多项任务。收到一个校验无误的命令帧后，控制读取接收缓存区RAM1中数据，比照Modbus帧格式解析命令帧含义，通过对外数据、地址等接口完成对双口RAM的读写操作；解析及操作完毕后，控制应答帧组帧过程，将应答数据依次写入RAM2发送缓存区，全部写入后，将CRC生成模块中CRC_16校验值按低位在前高位在后顺序，依次存放到发送缓存的下两个地址位置处，此时应答帧准备完毕；控制发出应答帧，依次读取出发送缓存区数据(读脉冲间的时间间隔至少大于串口发送单个字节所需时间)，每取出一个数据，提供发送使能脉冲供串口发送模块工作，脉宽等于串口发送单个字节所需时间，直至应答帧全部发送完毕。(7)接收缓存RAM1/发送缓存RAM2：存储串口接收模块收到的字节数据/存储待发送的应答帧。4性能分析分析监控通信对Soc系统性能的影响，设定一系列参数如下：时间基数T(min)、监控频率m(帧/min)、监控命令帧平均长度n(byte/帧)、Soc主循环平均周期k(ms)、通信波特率B(bit/s)、中断处理指令数r(条)、查询语句指令数s(条)、处理器主频f(HZ)。针对常用的轮询监控、中断监控，及该文所提出的基于FPGA的DRAM监控方法，可按照表1公式计算其监控通信过程占用的CPU时间。对于常用ARM处理器，可例举部分参数值f=72M，r=15，s=5。设定其余参数值T=1，m=100，n=30，k=0.05，B=115200。在当前设定下，计算得出三种监控方法对CPU的时间占用百分比，如表1所示。对比应用单一的中断或轮询方式，使用该文提出的监控方法时，嵌入式系统CPU的利用率得到了明显的提高。5结语该文提出一种针对嵌入式片上系统的在线监控方法。利用FPGA技术设计了辅助监控系统，由该系统完成监控通信过程中的接收通信命令帧、解析命令帧及组成应答数据帧等任务，加快了对通信数据的处理速度。SoC有效减少了处理监控所需时间，更集中于其控制功能的执行，从而获得更高的实时性。设计工作在Altera公司的QuartusII开发平台上采用VHDL语言完成，使用CycoloneII系列芯片作功能验证，通信系统的Modbus接口与上位机在115200的波特率下收发正确，双口RAM内数据交互稳定，达到了预计效果。转载自——EDNChina电子技术设计

任意波形发生器在雷达、通信领域中发挥着重要作用，但目前任意波形发生器大多使用静态存储器。这使得在任意波形发生器工作频率不断提高的情况下，波形的存储深度很难做得很大，从而不能精确地表达复杂信号。本文介绍的基于动态存储器（SDRAM）的设计能有效解决这一问题，并详细讨论了一种简化SDRAM控制器的设计方法。1、任意波形发生器的总体方案工作频率、分辨率和存储长度是任意波形发生器最关键的三个性能参数。高的工作频率意味着高的输出信号频率和带宽，高的分辨率通常意味着高的信噪比，而存储长度决定了信号的精确程度。下面介绍的方案是实际开发的一款任意波形发生器/卡（如图1所示），它的工作频率为300MHz，分辨率为14位，存储长度为8M字，现已得到了广泛地应用。该电路主要有两种工作状态：写数据状态和读数据状态。下面简单描述其工作过程。写数据状态：CPU根据所要设计的波形计算波形数据，并转换成14位的无符号数；打开总线开关，屏蔽FIFO操作，在SDRAM控制器的配合下，将波形数据通过接口电路交替写入SDRAM1和SDRAM2中，即SDRAM1中依次存放数据0，2，4，6.。.；SDRAM2中依次存放数据1，3，5，7.。.（如表1所示）。读数据状态：开启FIFO通道，关闭总线开关以断开SDRAM与CPU之间的数据连接；在SDRAM控制器的控制下，将SDRAM1/2中的数据同时（并行）读出；经过FIFO的缓冲得到连续的数据流，再经32位向16位的并串转换，将数据速率提升2倍后，供给DAC进行数-模转换，即可得到所编辑的信号。图1中用两片SDRAM并行工作，是因单片SDRAM不可能提供300MSPS的数据流。实际使用的器件是K4S641632C-TC60，工作时钟为166MHz。FIFO缓存SDRAM的输出数据，将突发数据流转换成连续数据流，使得在SDRAM处于刷新状态时，仍能维持正常的数据输出。实际使用的器件是两片并行工作的IDT72V263L6PF，写入时钟为166MHz，读出时钟为150MHz。并串转换的作用是提升数据的速率，在DAC器件内部完成，笔者采用具有良好动态性能的AD9755AST。CPU及控制接口是一个基于PC的ISA设备，可改进为PCI设备；时钟电路用来产生166MHz和150MHz的同步时钟。下面重点研究SDRAM控制器的设计，它是本系统的主要特色之一。2、SDRAM控制器的设计2.1SDRAM的主要特点与静态存储器（SRAM）相比，SDRAM的容量大（通常是几倍至几十倍的关系）；与DDRSDRAM或RDRAM相比，它的控制又相对简单，因而它依然是大容量存储器工程项目的良好选择。下面描述的几个重要基本概念反映了它的主要特点。行列地址：SDRAM的地址是行列复用的，此举有效减少了芯片的引脚。预充电：读写操作只对预充电过的行有效。也就是说，在数据读写操作跨行时，需要先进行至少一次的预充电操作。自动刷新：众所周知，只要是动态RAM，就存在刷新问题，SDRAM也不例外。通常每隔64ms需要将所有存储单元刷新一遍。自刷新：当需要保留芯片内的数据，而暂时又不需要操作时，可以设置芯片进入自刷新状态。工作模式寄存器：控制SDRAM工作方式的寄存器（如表2所示）。2.2SDRAM的状态流程SDRAM的完整状态机由17个状态构成，且状态转移是非随机的（如图2所示）。正是如此众多的状态及其复杂的转换关系，导致SDRAM的控制较为复杂。需要特别说明的是，SDRAM的状态转移有自动转移与人工转移之分（图2中以粗细箭头加以区别）。自动转移在当前状态结束后立即进入下一个状态；而人工转移在当前状态结束后即停留在当前状态，只有一条当前状态允许的命令才能进入下一个状态。可以想象，自行设计如此复杂的控制流程绝非易事。值得庆幸的是，在大多数应用中并不需要完备的状态机。下面讨论一种简化的SDRAM状态机。2.3简化的状态流程根据任意波形发生器的特点，对SDRAM的功能进行了以下简化：（1）省略随机存取功能，固定为顺序读写；（2）省略待机、自刷新、普通读/写功能；（3）省略所有的挂起功能；（4）工作模式固定为突发式读、单个式写；（5）数据延时固定为3个时钟周期；（6）刷新模式只使用自动刷新方式，器件空闲时即处于连续的自动刷新状态；（7）器件仅在上电后进行一次初始化，不能改变工作模式；（8）突发方式固定为顺序方式，突发长度固定为整页；（9）只使用带预充电的读/写指令；在每次读/写操作完成后，即启动一个自动刷新周期。经过以上简化的状态机如图3所示。2.4SDRAM控制器的EPLD实现为了实现上述简化的SDRAM控制功能，采用一片ALTERA公司生产的EPLD器件MAX7256ATC144-6。图4是任意波形发生器SDRAM控制流示意图。由于具体编程要涉及许多细节问题，在此不做赘述，其主要功能如下：（1）通过ISA总线，实现与CPU的接口，接收波形数据和读命令；（2）上电自动初始化；（3）生成23位（8M字存储器空间）的线性地址，并按行列复用的方式输出；（4）生成SDRAM的控制信号，完成读、写和自动刷新功能；（5）控制FIFO，以解决SDRAM刷新和波形长度不是页长度的倍数问题。虽然完全应用SDRAM确实比较复杂，但只要本着“够用就行”的原则，对其功能进行合理的简化，设计出具有特殊需求、适用于特定条件的SDRAM控制器是完全可行的。目前，笔者已将基于SDRAM的任意波形发生器应用到多个研发项目中。转载自——维库电子市场网

前言目前卫星技术已广泛应用于国民生产的各个方面。通讯卫星，气象卫星以及遥感卫星，科学探测卫星等与人们的生活密切相关。卫星所收集的大量数据资料能否及时准确地下传、接收和存储是卫星技术的一个重要方面。其传送过程如图1所示。从卫星上高速下传的数据由地面卫星接收站转发为基带信号，通过光缆传送至数据中心，速度可达上百兆波特率，要求系统正确接收，经过同步和预处理，然后存入计算机系统，供数据中心使用。其特点是：数据下传速度高，数据量大，持续时间长，并且要求具有差错控制功能。而本文介绍了为了满足此要求而设计的数据接收和存储系统。系统设计数据接收和存储系统主要包括数据接收和预处理，数据传送，数据存储等部分。本文主要介绍CPLD，PCI总线结构，总线控制器PCI9054。其系统组成如图2所示。基带串行信号由复杂可编程逻辑器件（CPLD）进行串并转换，变为8位数据信号后根据编码方式找到同步帧，并进行预处理，然后传到先入先出存储器FIFO，在逻辑控制下将数据送入PCI总线控制器PCI9054，由9054采用DMA突发方式传输至内存，再存储到RAID磁盘阵列。采用复杂可编程逻辑器件（CPLD）可大大减少复杂的控制，通过VHDL语言即可灵活设置控制逻辑。而且随着超大规模集成电路的发展，可编程逻辑器件的发展非常迅速，现已达到数十万门，速度《1ns（管脚之间）。由于高速电路设计中的干扰问题非常严重，因此要尽可能地减少线路设计，所以采用CPLD不仅可满足系统要求的复杂的逻辑关系，而且可大大减少布线干扰，调试和更改也非常方便，是今后逻辑控制的发展方向。在本系统中，CPLD不仅实现串并转换和同步的功能，同时还用以实现数据进入FIFO以及由FIFO传入PCI9054的传输控制逻辑，中断逻辑以及主机对数据传输通道的前端控制。在总线结构上，由于数据传输速度高，以往的ISA总线不能满足要求（ISA总线最大传输速度5MB/S），必须采用更快的PCI总线结构。PCI总线协议是Intel公司1992年提出的，为满足高速数据输入/输出要求而设计的一种低成本，高性能的局部总线协议。它是一种独立于处理器的总线结构，具有32位或64位的复用的数据地址总线，总线上的设备可以以系统总线的速度在相互之间进行数据传输，或直接访问系统内存，可以达到132MB/s的数据传输速率（64位则性能加倍）。采用PCI接口的设备必须满足PCI接口规范V2.2标准。PCI总线结构具有非常明显的优点，但其总线规范十分复杂，要求非常严格的时序关系，接口的设计难度较大。因此，为了减少PCI总线在实际应用中的复杂性，许多公司设计出了专门针对PCI总线接口的控制芯片。PCI9054就是其中比较先进的一种。PCI9054是PLX公司推出的一种33M，32位PCI接口控制器，可同时支持3.3V和5V两种信号环境，并且具有电源管理功能。其结构框图如图3所示。它提供了三种物理总线接口：PCI总线接口，LOCAL总线接口，及串行EPROM接口。LOCAL总线的数据宽度为32位，时钟频率可达到50MHZ，并且支持数据预取功能。9054的LOCAL总线与PCI总线之间数据传输有三种方式：主模式（DirectMaster），从模式（DirectSlave），DMA方式。其内部具有两个DMA数据通道，双向数据通路上各有6个FIFO进行数据缓冲，可同时进行高速的数据接收和发送。8个32位Maibox寄存器可为双向数据通路提供消息传送。9054还有2个32位Doorbell寄存器，用来在PCI和Local总线上产生中断。用户通过设置其内部寄存器，即可完成各种控制功能。9054内部寄存器的配置信息可以写在一片串行EPROM中，在加电时9054自动加载串行EPROM配置信息，并由PCIBIOS通过PCI总线对配置寄存器读写。9054可方便地与各种存储设备相连接，在本设计中，它与FIFO及EPROM的设计接口如图4所示。在本系统中，数据传输是单方向的，因此只设计PCI9504从FIFO中读数据的情况，只用到与读FIFO有关的信号，如REN，RCLK等。其中的CPLD逻辑关系如下：REN平时为高电平（无效电平），当ADS#为低（有效），BLAST为高（无效），LW/R为低（有效）时，表明9054开始了一个有效的读数据周期，CPLD产生一个低电平信号REN（有效电平）给FIFO，同时作为Ready信号返回给9054，通知9054设备已准备就绪。此信号持续到ADS#为高（无效）且BLAST为低（有效）时，表明9054已经开始最后一个周期，此时REN信号再次变高电平（无效）。OE信号与REN信号可同样设置，在读信号允许的同时使能FIFO芯片。本设计中采用了PCI9054的DMA工作方式，在此方式下，9054作为PCI总线的主设备，同时也是Local总线的控制者，通过设置其DMA控制器内部的寄存器即可实现两总线之间的数据传送。表1显示了与DMA传输相关的寄存器在PCI总线上的地址分配：PCI9054的DMA传输过程可由以下几个步骤实现：1．设置方式寄存器：设置DMA通道的传输方式，寄存器DMAMODE0或者DMAMODE1的位9:0-表示块传输，1-表示散/聚传输；2．设置PCI地址寄存器：设置PCI总线侧的地址空间。3．设置LOCAL地址寄存器：设置LOCAL总线侧的地址空间。4．设置传输计数寄存器：以字节位单位设置传输数据量。5．设置描述寄存器：设置DMA传输的方向；在散/聚方式下，位0表示传输参数的加载地址，0-PCI地址，1-Local地址；位1表示传输链结束，0-未结束，1-结束；位2设置当前块传输结束后中断；位3指示DMA的传输方向，0-从PCI总线到Local总线，1-从Local总线到PCI总线；高28位［31:4］表示传输参数表的地址指针。6．设置命令/状态寄存器：启动或停止DMA操作，并读此寄存器返回DMA状态。通过PCI9054的DMA传输方式，高速数据可以较容易地实现从PCI接口板上传入计算机，不必考虑PCI总线接口的实现，从而大大简化了设计中的复杂度，加快了设计周期。结语随着数字技术的发展，要求的数据传输速率将会越来越高，CPLD技术和PCI总线将会越来越多地应用在数据传输的设计中，PCI9054总线控制器有着较高的性能/价格比，将来的应用将会更加广泛。转载自——维库电子市场网

1、超级电容简介超级电容，又名电化学电容，双电层电容器、黄金电容、法拉电容，是从上世纪七、八十年代发展起来的通过极化电解质来储能的一种电化学元件。它不同于传统的化学电源，是一种介于传统电容器与电池之间、具有特殊性能的电源，主要依靠双电层和氧化还原赝电容电荷储存电能。但在其储能的过程并不发生化学反应，这种储能过程是可逆的，也正因为此超级电容器可以反复充放电数十万次。2、超级电容的结构超级电容器结构上的具体细节依赖于对超级电容器的应用和使用。由于制造商或特定的应用需求，这些材料可能略有不同。所有超级电容器的共性是，他们都包含一个正极，一个负极，及这两个电极之间的隔膜，电解液填补由这两个电极和隔膜分离出来的两个的孔隙。超级电容器的结构如图所示．是由高比表面积的多孔电极材料、集流体、多孔性电池隔膜及电解液组成。电极材料与集流体之间要紧密相连，以减小接触电阻；隔膜应满足具有尽可能高的离子电导和尽可能低的电子电导的条件，一般为纤维结构的电子绝缘材料，如聚丙烯膜。电解液的类型根据电极材料的性质进行选择。上图中各部分为：（1）：聚四氟乙烯载体；（2）（4）：活性物质压在泡沫镍集电极上；（3）：聚丙烯电池隔膜。超级电容器的部件从产品到产品可以有所不同。这是由超级电容器包装的几何结构决定的。对于棱形或正方形封装产品部件的摆放，内部结构是基于对内部部件的设置，即内部集电极是从每个电极的堆叠中挤出。这些集电极焊盘将被焊接到终端，从而扩展电容器外的电流路径。对于圆形或圆柱形封装的产品，电极切割成卷轴方式配置。最后将电极箔焊接到终端，使外部的电容电流路径扩展。3、均压控制原理文中超级电容均压部分采用逆变器和变压器均压技术实现。如图2所示，均压电路由超级电容组、变压器、逆变器和升压斩波电路4部分组成。图中的二极管起到反向保护作用。通过控制信号S1、S2、S3、S4即可实现电压均衡，并可将电压高的超级电容中的能量转移到电压低的超级电容中。假设有N个超级电容串联，将串联超级电容组两端总电压通过升压斩波电路接到逆变器的输入端，以补偿MOSFET及续流二极管上的导通压降，逆变器的输出接到匝数比为N的降压变压器的高压侧，则低压侧将产生振幅为N个超级电容单体电压平均值的方波。以该方波作为电压源再次对每个超级电容单体进行充电。此时由于二极管的作用，只有单体电压低于变压器低压侧电压值的超级电容才能进行充电。逆变器工作一段时间以后，即可完成超级电容的均压。升压斩波电路的输出电压，即逆变器的输入电压Vi满足：Vi=Vc+N*Vd+2Vs（1）式中：Vc为N个串联超级电容两端总电压；Vd为续流二极管上的正向导通压降；Vs为MOSFET上的导通压降。逆变部分采用5kHz的50％占空比的PWM波加入一定的死区时间来实现，S1，S4采用同一组信号驱动，S2，S3采用另外一组信号驱动。升压斩波电路的控制信号采用20kHz的PWM波。Boost变换器占空比公式2DC／DC主电路及控制方式控制电路采用一端稳压一端稳流的方式进行充放电控制，当电路工作在buck充电方式时，超级电容端进行先恒流充电到Vsc，再恒压充电；当电路工作在boost放电方式时，直流母线电乐端进行稳压控制。充放电环节采用PI控制法进行恒流或恒压充、放电。采用双向buck／boost电路拓扑，控制策略是：（1）当超级电容电压Vc高于电容额定电压Vcmax时，封锁buck充电控制信号；当超级电容电压Vc下降到电压下线Vcmax时，封锁boost放电控制信号。（2）当超级电容电压Vc在电压下限Vcmax与最高电压Vcmax之间时，DC／DC变换器能够进行buck充电控制，或boost放电控制：进行buck还是boost需要根据直流母线电压Vdc、电流Idc来决定。（3）直流母线电压Vdc高于设定高压Vdcmax，进行buck充电控制；低于设定低压Vdcmin，进行boost放电控制。母线电压Vdc介于Vdcmax和Vdcmin之间是不动作，既不充电也不放电。4、控制系统软件流程按照上述控制策略，得到如图4的程序流程图，其中5kHz逆变为均压电路中的逆变器，采用50％的PWM脉冲波来实现，不需要复杂的控制算法。20kHz升压模块完成开关管S1信号的产生。需要通过电压采集电路，得到串联电容的总电压。4个判断模块通过判断Vdc和Vc的电压范围决定对电容的充放电控制。5、仿真分析C1、C2初始电压为2．7V，C3、C4为1V，仿真70s的时候基本均压结束，电压均衡到1．81V，由于电容并联二极管的影响，电压均衡点并没有在算数平均值1．85V，并且升压斩波器也消耗一部分能量。70s之后两电容电压基本保持同步变化。图6为均压系统实物图，由FPGA控制板，H桥逆变器以及驱动电路和Boost升压电路组成，FPGA控制板采用实验室自主开发的基于EP2C80208C8N芯片的开发板来完成控制信号的中生成，5个开关管采用IRF640，驱动芯片TR2103。通过仿真验证了均压系统的可行性。6、结束语文中简要介绍了应用超级电容所需要的几项关键技术，并通过仿真和实物验证，逆变采用50％占空比是为了使电压较高的降压速度与低压电容的升压速度相匹配，减少电能浪费。DC／DC充、放电模块能实现对超级电容器组快速可靠充、放电，输入功率大，保护可靠，充分发挥了超级电容的优势。转载自——维库电子市场网

0引言传统数据采集卡多采用PCI或ISA总线接口，这种方式安装麻烦、价格昂贵，且受计算机插槽数量、地址、中断资源限制，有扩展性差等缺点。而USB通用串行总线则具有安装方便、高带宽、易扩展等优点，其中USB2.0标准具有480Mbps的最高数据传输率，这使USB成为本系统所选接口的主要类型。控制方面，传统数据采集通常使用单片机或DSP作CPU来进行控制和数据处理。其中单片机的时钟频率低，无法适应高速数据采集；DSP虽能满足速度要求，但在速度提高的同时，也提高了成本。而用FPGA实现的SOPC则具有时钟频率高、内部延时小和配置灵活等优势。数据显示方面，采用虚拟仪器不但可按要求设计且变换灵活，还能执行传统仪器无法实现的许多功能。为此，本系统使用FPGA实现SOPC数据采集系统，并利用Labview实现系统的显示与控制。1数据采集系统总体设计基于SOPC的高速数据采集系统总体框图如图1所示。图中，ADC(Analogt0DigitalConverter)模数转换器采用的是8位高速模数转换器TLV5580。调理电路用于实现对输入信号的限幅、限压、滤波，并用增加输入阻抗的措施来获取预期有效信号，同时保护后端AD转换芯片。FPGA采用ALTERA公司的EPIC6Q240芯片来实现ADC控制及FIFO数据缓存；基于FPGA芯片的控制系统可直接用逻辑实现，也可在其基础上实现SOPC对数据的采集、传输的控制。USB采用CYPRESS公司可支持USB2.0协议的高速芯片CY7C68013。FPGA可控制TLV5580的连续采样，并将数据送到FIFO数据缓存。当采集到一定量的数据后，CY7C68013便采用slavefifo方式将数据送给PC端，并由PC端软件Labview实现的虚拟仪器进行显示和控制等处理。2数据采集系统硬件设计2.1?模数转换器TLV5580及其控制TLV5580是一款高速8位模拟／数字转换器，它具有80Msps采样速率，是一款3.3V工作电压的低功耗6级流水线结构高速A／D芯片。它的采样信号每1个时钟周期可通过一个STAGE，完成连续转换到数据输出共需6个时钟周期。此流水线结构由6个ADC／DAC级和一个终极快闪ADC构成。采用A／D-D／A两次变化以及纠错逻辑的目的在于进行差错校正，以保证流水线上各个阶段在满操作温度范围下，ADC的偏移量能够得到补偿且不丢失代码。TLV5580的时序图如图2所示。可以看出，该A／D转换器时序简单，容易控制。当输出使能(OE)为低电平时，一旦数据流水线满，其数据将在每一个时钟周期的上升沿输出。2.2USB芯片CY7C68013(FX2)为了满足对USB传输速度较高的需要，本设计选择了Cypress公司内置USB接口的微控制器芯片EZUSBFX2。FX2系列芯片独特的结构使其数据传输速度最高可达56Mbps，故可最大限度地满足USB2.0的带宽。此外，CY7C68013提供有一个串行接口引擎(SIE)，可负责大部分USB2.0协议的处理工作，从而大大减轻USB协议处理的工作量，并可提供4KB的FIFO，以保证数据高速传输的需要。CY7C68013可配置成三种不同的接口模式：Ports、GPIFMaster和SlaveFIFO。本项目采用SlaveFIFO模式。在该模式下，外部逻辑或外部处理器直接连接到FX2的端点FIFO，因为外部逻辑可以直接控制FIFO，所以，FIFO的基本控制信号(标志、片选、使能)均由FX2的引脚引出。其外部控制可以是同步，也可以是异步，可以使用内部时钟，也可以使用外部时钟。2.3FPGA器件EPIC60240C6FPGA(FieldProgrammableGateArray)即现场可编程门阵列。本设计选用的是ALTERA公司的EPIC60240芯片，该芯片的工作电压为1.5V，存储器密度可达5980个逻辑单元，它包含20个128x36位RAM块，总的RAM空间达92160位，此外还内嵌了2个锁相环电路和一个用于连接SDRAM的特定双数据率接口，故可支持多种不同的I／O标准。事实上，这里的FPGA除了可以直接编程以进行逻辑控制外，也可在此基础上构建SOPC系统，以便使用软、硬件协同方法，与SDRAM构成一个大容量的FIFO来对SDRAM以及MD转换器进行控制，同时完成与USB器件的协同工作。2.4SOPC及其设计SOPC(SystemonaProgrammableChip)即可编程片上系统。它可以由单个芯片完成整个系统的主要逻辑功能；这种可编程系统具有灵活的设计方式，而且可裁减、可扩充、可升级。本设计采用ALTERA公司率先推出的SOPC解决方案，来将处理器、存储、I／O口等系统所需集成到一个FPGA器件上，并对其进行软、硬件配置，从而实现对数据的采集、传输、显示控制。图3所示是其SOPC系统框图。3数据采集系统软件设计本系统软件包括SOPC系统程序、USB固件程序、驱动程序和应用程序等4个方面的设计。其中SOPC系统程序和USB固件程序是整个程序设计的核心。3.1SOPC系统程序设计基于QuartusII和Nios的SOPC设计流程如图4所示。本系统中的SOPC系统软件设计是指在FPGA中配置ALTERA公司NiosII嵌入式处理器的硬件环境。其中NiosII处理器的配置可基于QuartusII，它是ALTERA公司的大规模FPGA／CPLD开发工具。为了进行Nios处理器的开发，通常要在Quartus里装入NiosII的软硬件开发工具，同时在提供的开发包中使用软件SOPCBuilder开发工具加载NiosII核和外围接口，并定义相应的指令，然后对系统进行综合后，再下载到FPGA中，就可以完成特定功能的处理器设计。3.2USB固件程序设计CY68013芯片的固件程序主要负责处理PC机发来的各种USB设备请求，并与外围电路进行数据传输。CYPRESS公司提供的固件程序框架中的两个程序分别是FW．C和PERIPH．C。其中FW．C是固件运行的主程序文件，负责处理各种USB设备请求，包含程序框架的MAIN函数，它可管理整个51内核的运行。而对于PERIPH．C，则必须将PERIPH．C实例化，以实现所需的功能。固件程序中最重要的是TD_init()和TD_poll()两个函数。TD_Init函数负责对CY7C68013的初始化，它一般在固件运行开始时调用；TD_poll函数是数据采集的执行子程序，它首先判断内部端点6的缓冲区和外部FIFO缓冲器是否非空，如满足条件，则启动A／D转换，并根据USB设备工作在高速和全速的不同来设置不同的传输计数。本设计中将接收数据端点6设为SLAVEFIFO模式，并使用AUTOIN模式来接收FPGA发来的数据，数据流由外部FIFO控制器控制，并直接传人端点6的FIFO，以等待主机提取。这里，CY7C68013仅作为数据通道，CPU不参与此过程。因此，只需在固件的初始化程序中配置好端点6的SLAVEFIFO接口模式，剩下的传输控制和其它的工作则可由FPGA来完成。以下是针对本设计的部分固件程序：VoidTD_Poll(void)／／在设备运行时反复被调用，主要完成外部FIFO状态检测和数据传输3.3USB驱动程序设计Windows下的USB驱动程序通常由3部分组成：USB设备驱动程序、USB总线驱动程序和USB主控制器驱动程序。其中，Windows操作系统已经提供了处于驱动程序栈底的USB总线驱动程序和USB主控制器驱动程序。而USB设备驱动程序则要由设备开发者编写。它应能通过向USB总线驱动程序发送包含URB(USBRequestBlock)的IRP(I／ORequestPacket)来实现USB外设之间的信息交换。本设计采用Jungo公司的WinDriver进行驱动程序开发，并根据WinDriver提供的驱动向导和用户需要，来自动生成代码框架，从而简化驱动程序的开发。3.4应用程序设计本设计采用NI公司的虚拟仪器(VI)开发平台Labview来进行应用程序的设计。VI包括三部分：前面板、框图程序和图标／连接器。其中前面板用于设置输入数值和观察输出量。每一个前面板都对应着一段框图程序。框图程序可用Labview图形编程语言—G语言来编写。图标／连接器是子VI可被其它Ⅵ调用的接口。图标是子VI在其它程序框图中被调用的节点表现形式；而连接器则是节点数据的输入／输出口。连接器端口与前面板的控制和显示一一对应。4结束语本文介绍了一种基于SOPC和USB2.0接口的高速数据采集系统及其虚拟仪器的设计方法。实验表明，基于本设计的高速数据采集系统具有抗干扰、可靠性高、失码率低等优点.转载自——维库电子市场网

ROHMRASMID瞬态电压抑制器二极管为ROHM采用击穿技术的超紧凑RASMID系列产品，拥有±8kV双向ESD防护等级。其典型应用包括蜂窝手持设备和配件、便携式电子设备、数据线路以及音视频设备。特性l高可靠性lWL-CSPl双向ESD防护l±8kVESD防护等级（IEC61000-4-2接触放电）l±10µm的尺寸公差l超小型0402和0603封装相关器件推荐：制造商商品型号分类描述简介免费申请ROHMSemiconductorVS5V0BA1EST15R可编程逻辑ROHMRASMID瞬态电压抑制器二极管为ROHM采用击穿技术的超紧凑RASMID系列产品，拥有±8kV双向ESD防护等级。其典型应用包括蜂窝手持设备和配件、便携式电子设备、数据线路以及音视频设备。免费样片申请ROHMSemiconductorVS5V0BB1EST15R可编程逻辑ROHMRASMID瞬态电压抑制器二极管为ROHM采用击穿技术的超紧凑RASMID系列产品，拥有±8kV双向ESD防护等级。其典型应用包括蜂窝手持设备和配件、便携式电子设备、数据线路以及音视频设备。免费样片申请ROHMSemiconductorVS3V3BB1EST15R可编程逻辑ROHMRASMID瞬态电压抑制器二极管为ROHM采用击穿技术的超紧凑RASMID系列产品，拥有±8kV双向ESD防护等级。其典型应用包括蜂窝手持设备和配件、便携式电子设备、数据线路以及音视频设备。免费样片申请ROHMSemiconductorVS3V3BA1EST15R可编程逻辑ROHMRASMID瞬态电压抑制器二极管为ROHM采用击穿技术的超紧凑RASMID系列产品，拥有±8kV双向ESD防护等级。其典型应用包括蜂窝手持设备和配件、便携式电子设备、数据线路以及音视频设备。免费样片申请转载自唯样电子资讯。唯样商城-电子元器件采购网（www.oneyac.com）是本土元器件目录分销商，采用“小批量、现货、样品”销售模式，致力于满足客户多型号、高质量、快速交付的采购需求。唯样自建高效智能仓储，拥有自营库存超70,000种，提供一站式正品现货采购、个性化解决方案、选型替代等多元化服务。应用l蜂窝手持设备和配件l便携式电子设备l数据线路l音视频活动

ROHM2Sx双极结型晶体管（BJT）设计用于工业和消费类应用。这些BJT有PNP和NPN两种极性。2SxBJT器件采用多种封装，专为中等功率表面贴装应用而设计。2SxBJT具有-55ºC至150ºC的宽存储温度（Tstg）范围，结温（TJ）为150ºC。典型应用包括通用小信号放大器，电源，高速开关和低频放大器。特性：集电极-发射极电压范围为-400V至+400V集电极电流（连续）范围从-6A到+6A集电极功耗范围从0.12W到40W宽存储温度Tstg为-55ºC至150ºC结温TJ为150ºC应用：电源；低频放大器；高速切换相关器件推荐：制造商商品型号分类描述简介免费申请ROHMSemiconductor2SC5585TL可编程逻辑ROHM2Sx双极结型晶体管（BJT）设计用于工业和消费类应用。这些BJT有PNP和NPN两种极性。2SxBJT器件采用多种封装，专为中等功率表面贴装应用而设计。免费样片申请ROHMSemiconductor2SCR553RTL可编程逻辑ROHM2Sx双极结型晶体管（BJT）设计用于工业和消费类应用。这些BJT有PNP和NPN两种极性。2SxBJT器件采用多种封装，专为中等功率表面贴装应用而设计。免费样片申请ROHMSemiconductor2SCR544RTL可编程逻辑ROHM2Sx双极结型晶体管（BJT）设计用于工业和消费类应用。这些BJT有PNP和NPN两种极性。2SxBJT器件采用多种封装，专为中等功率表面贴装应用而设计。免费样片申请ROHMSemiconductor2SCR522UBTL可编程逻辑ROHM2Sx双极结型晶体管（BJT）设计用于工业和消费类应用。这些BJT有PNP和NPN两种极性。2SxBJT器件采用多种封装，专为中等功率表面贴装应用而设计。免费样片申请转载自唯样电子资讯。唯样商城-电子元器件采购网（www.oneyac.com）是本土元器件目录分销商，采用“小批量、现货、样品”销售模式，致力于满足客户多型号、高质量、快速交付的采购需求。唯样自建高效智能仓储，拥有自营库存超70,000种，提供一站式正品现货采购、个性化解决方案、选型替代等多元化服务。

ROHM肖特基势垒二极管具有各种高可靠性，低损耗器件。它们有各种包装。肖特基二极管提供低正向电压和反向电流，具有高ESD抗性。即使在高温下也会阻止热失控，使其成为汽车系统和电源的理想选择。二极管符合标准或AEC-Q101标准。RBE二极管具有更高的效率和更低的VF。这些二极管占用的空间减少了80％，并提供了大电流处理能力。特性：l低VFl占用空间减少80％l大电流处理能力l高速反向恢复时间（trr）l软恢复特性确保高效运行，低损耗应用：防回流电路/DC-DC转换器电路应用：相关器件推荐：制造商商品型号分类描述简介免费申请ROHMSemiconductorRB521AS-30T2R可编程逻辑ROHM肖特基势垒二极管具有各种高可靠性，低损耗器件。它们有各种包装。肖特基二极管提供低正向电压和反向电流，具有高ESD抗性。即使在高温下也会阻止热失控，使其成为汽车系统和电源的理想选择。免费样片申请ROHMSemiconductorRB521AS-40T2R可编程逻辑ROHM肖特基势垒二极管具有各种高可靠性，低损耗器件。它们有各种包装。肖特基二极管提供低正向电压和反向电流，具有高ESD抗性。即使在高温下也会阻止热失控，使其成为汽车系统和电源的理想选择。免费样片申请转载自唯样电子资讯。唯样商城-电子元器件采购网（www.oneyac.com）是本土元器件目录分销商，采用“小批量、现货、样品”销售模式，致力于满足客户多型号、高质量、快速交付的采购需求。唯样自建高效智能仓储，拥有自营库存超70,000种，提供一站式正品现货采购、个性化解决方案、选型替代等多元化服务。

嵌入式系统与桌面PC结构非常不同，但其底层技术发展却是一样的，而且遵循着类似发展趋势。当桌面PC转向64位架构来满足不断增长的存储器要求时，嵌入式系统也由于同样的原因快速转向32位处理器。桌面/服务器计算市场主要是围绕x86架构，大多数创新和差异都在系统级，如双核、四核或多核中央处理架构、集成图像处理器单元和存储器控制器等等。同样，嵌入式系统则主要围绕简单的32位RISC处理器，多核架构、集成外设以及可配置处理等系统级发展，使得设计人员能够快速适应不断变化的应用要求。根据iSuppli的研究报告，2007年32位微控制器(MCU)市场将超过8位MCU市场。如图1所示，32位MCU市场的增长速度超过了半导体市场其它部分的增长速度，而8位MCU市场的份额过去几年时间里则有所下降。这一趋势的主要推动力是嵌入式系统中软件内容和复杂性的不断增加，因此直接产生的后果是需要更宽的存储器总线(32位)来满足软件程序所使用的代码和数据要求。与传统微处理器不同，32位处理器不需要分段等存储器管理技巧就可以处理更大的存储器空间，因此使编程更容易。8位MCU必须采用难学难用的汇编语言来满足小存储器空间限制(少于32K字节)，而许多32位嵌入式应用则可以利用C/C++来编程，从而提高了嵌入式软件开发人员生产力。更为重要的是，越来越多的操作系统(实时和非实时)都提供现成的驱动程序和软件库，从而使软件开发人员能够集中于应用本身的开发。集成降低成本在摩尔定律的指引下，越来越细的硅工艺线宽使得32位嵌入式解决方案的成本不断降低，从而可以满足更多的应用对价格的要求。此外，集成外设和片上存储器进一步降低了元器件和总体材料清单成本。通过集成针对手机和游戏机等垂直应用而优化的外设，许多器件的价格大大降低，直接推动了市场增长。价格压力还导致只能在这些系统中集成一组固定的外设，因此通常的外设组合是面向大批量应用的。然而，不可能有适用于所有应用的万能器件，因此许多小批量、中等规模甚至大批量应用都无法直接利用成品集成解决方案。其结果是设计人员必须采用额外的芯片来扩展外设、分流处理器的负担，或增加胶合逻辑。这也是可配置处理解决方案产生的原因。可配置32位处理根据GartnerDataquest的报告，如图2所示，基于FPGA嵌入式处理方案的应用正在增长，到2010年，约40%的FPGA设计将包括嵌入式处理器。因为能够定制满足特定应用或产品的要求，嵌入系统设计人员正在越来越多地采用基于FPGA的可配置处理解决方案。这一方法的主要优点是可通过集成降低成本，同时还可实现产品在市场上的差异化。通过选择同一FPGA系列中的不同器件，或者将设计重新适配到新的FPGA器件中，能够针对更高性能、更低成本、或者不同的I/O标准进行个性设计。这样可以降低设计过时的风险，从而保证设计是未来可用的。对于必须有长使用寿命的产品(如汽车或工业应用)，这是特别关键的一个因素。图1：32位MCU市场的增长速度超过了其它类型的MCU的增长速度。可配置处理系统的配置(或定制)的层面包括：处理器配置1.乘法器、除法器、浮点单元以及其它。2.指令或数据缓冲配置。3.协处理器或硬件加速器。系统配置1.I/O外设选择、定制、DMA选择。2.存储器外设选择、定制。应用配置1.RTOS选择、定制。2.应用库/中间件定制。许多产品都包括需要某种形式网络或通信接口的嵌入式系统。由于以太网成本低、几乎无处不在，并且可以利用TCP/IP等互联网协议连接互联网，因此以太网是目前在嵌入式产品中应用最广泛的网络接口之一。根据目标应用的不同，网络子系统的要求变化也相当大。简单的远程控制和监控应用只需要每秒数千比特的传输能力，而高端存储或视频应用则需要持续的千兆比特级的吞吐能力。为简单起见，我们将使用TCP载荷吞吐能力做为性能比较的主要指标。表1列出了一些典型应用以及相应的TCP/IP载荷吞吐能力要求。表一：不同应用的网络吞吐量要求可配置的嵌入式网络基于FPGA的处理解决方案提供的强大灵活性允许您根据需要开启或禁止处理器、IP内核以及软件平台的高级功能，并且可以对许多独立参数进行精细调整，直到在软件一级满足应用的要求。此外，利用建模工具可以识别任何性能关键的软件功能并将其分流至适当的硬件加速器或协处理器来完成。让我们来分别看一下可利用IP内核满足典型应用性能要求的三种以太网子系统的例子。每种设计具有不同的系统架构:包括处理器配置、以太网MACIP配置以及存储器接口。此外，这些例子还突出了可与这些硬件子系统配合使用的不同TCP/IP软件协议栈。由于硬件构建模块和软件层都是可定制的，因此您可以根据应用的需要对这些系统进行增减。简化以太网子系统对于远程监视或控制应用中所需要的简单网络接口来说，如图3所示的最小化网络子系统就足够了。在此类应用中，TCP/IP性能要求较低(图3：规模最小的以太网系统。这可以使用不间断的以太网LiteIP在简单的查询模式下实现。全部软件，包括简单的应用层，可全部存储在FPGA中的本地存储器中。如图3中所示，其它需要的I/O接口，RS-232UART和GPIO，可以增加到基本子系统中。图4：典型的10/100以太网系统架构。通过对图3中的最小系统做一定的修改，可以实现更高TCP/IP吞吐能力(10-50Mbps)，并转向如图4所示的更为典型的10/100以太网解决方案。主要的变化有：1.为以太网MAC增加直接存储器访问(DMA)引擎，实现中断驱动；2.为系统增加外部存储器，为处理器增加缓存；3.更复杂的TCP/IP栈，如Linux(Clinux)系统TCP/IP协议栈。对于需要100Mbps以上TCP/IP吞吐能力的应用，可以考虑硬IP或软IP内核方式提供的三模式以太网MAC(图5)。为获得高端应用所需要的500Mbps以上的吞吐能力，需要像分散/汇聚DMA(SGDMA)等高级DMA技术，以及包括数据重排引擎(DRE)和校验和卸载(CSO)等FPGA硬件加速器技术。为满足千兆以太网对更高数据吞吐率的需求，可能需要更高性能的嵌入式(硬)处理器或FPGA上实现的可定制软处理器，以及更大的缓冲容量、如16Kbit指令和数据缓存。就软件平台来说，Linux、VxWorks、Integrity和QNX等软件平台中的高级TCP/IP栈支持诸如零拷贝和校验和旁路等功能。包括硬件和软件在内的许多因素都会影响到TCP性能，并进而影响系统TCP吞吐能力。这些因素包括：1.处理器，包括频率、功能和缓存a.频率：TCP/IP协议通常需要将载荷从用户缓存拷贝到协议栈控制的缓存，然后再将其拷贝到以太网MAC的FIFO中去。这些存储器拷贝操作有些是以软件方式完成的，因此需要处理器的处理周期。同时处理器还参与TCP校验和的计算，计算过程中需要将整个数据包从存储器读出。更快的处理器配合更快的存储器能在更短的时间内完成这些操作，从而可以保持较高的数据速率；b.功能：TCP/IP协议栈需要对数据包的包头和载荷进行访问处理。做为包头处理的一部分，典型的访问包括读取包头信息的特定位。因此每个数据包的处理过程都需要相当多的移位操作。此外在处理每个数据包时都需要进行乘法操作。在可配置的处理器中，必须开启完成移位或乘法的指令才能获得更高的性能；c.缓存：数据包从以太网MAC被拷贝到存储器中之后，将会通过TCP/IP协议栈的不同层。然后TCP/IP栈中的数据包处理代码会被执行。将所有代码和数据包读到缓存中会大大提高处理器效率并提高以太网带宽。2.存储器存储器访问时间和延迟对于系统性能有巨大的影响。典型应用中，TCP/IP应用并不存储在本地存储器中，程序和数据存储在外部存储器中。存取数据和指令所花费的时间对于性能有很大影响。存储器因素通常与缓存大小有关。提高指令和数据缓存大小有助于减轻外部存储器延迟和存取时间所带来的影响。3.以太网MAC在FPGA中实现的以太网MAC外设提供了很大的灵活性，特别是在工作模式(无DMA与SGDMA)、数据包FIFO深度、DRE支持、CSO支持以及超大帧支持方面。每一项都会影响到MAC所需要的资源，以及其能够从处理器分流的功能多少，从而对整体性能造成影响。4.TCP/IP协议栈灵活的优化TCP/IP协议栈是影响系统性能的重要因素。对硬件CSO和零拷贝API(数据不需要从应用拷贝到协议栈缓存)以及可配置栈选项等TCP/IP栈功能的支持可帮助提高系统性能。5.信息多少信息(应用数据)的大小是影响性能的另一个因素。随着信息减少，TCP/IP协议头(如TCP、IP和以太网头)的开销增加，从而会减小总体的数据载荷吞吐能力。大多数应用对于成本、性能和功能都有一组基本的需求。当为特定应用设计产品时，设计人员必须在这些需求之间进行正确的折衷，然而，为了适应市场条件，这些要求在产品生命周期内可能会发生变化。采用灵活可配置的平台能够在不改变设计平台或供应商的情况下根据需要对这些要求进行重新平衡。转载自——维库电子市场网

在非关键的低预算情况下，例如10美元的大众市场电子温度计，这个时钟可以由一个简单的电阻/电容（RC）振荡器制成。然而，对于绝大多数更为关键的情况，振荡器基于石英晶体（图1）。这是一种成熟（80年以上）且高效的技术，可支持从kHz到数百MHz的各种频率，性能从优秀到卓越，具体取决于晶体切割，制造，封装和其他考虑因素。图1：古老的石英晶体（但不是整个振荡器）由标准原理图符号表示;b）等效电路从所示的简化模型开始，但随着工作频率的增加可能会变得更加复杂。然而，晶体的进步已达到稳定水平，同时对时序功能的性能，尺寸和成本提出了要求，整合正在增加。为了满足这些需求，一种新的破坏性方法开始侵蚀基于硅MEMS（微机电系统）技术的石英器件，该技术可提供石英级性能，并且性能和成本水平适用于许多应用。MEMS器件已经高度发展，大量用于感应压力，运动和加速度，现在它们正在扩展到新的角色。对射频应用中的定时功能的要求尤其具有挑战性，振荡器不仅仅是处理器的时钟，而且可以容忍一点点抖动。在RF中，它建立了数百MHz和GHz范围内的基本载波/信道调谐，以确保A/D和D/A转换器的正确时钟。对于转换器，任何抖动都会转换为转换器噪声和失真，因此是RF设计中的关键规范。振荡器操作晶体定时器件的结构和操作基于众所周知的压电原理，即电信号在晶体中产生应力，反之亦然：施加的应力使晶体产生微小的电压。通过使用微小的石板或石英坯料以及合适的电路，石英作为调谐谐振器，为整个电子系统提供精确间隔的时钟信号。在基于MEMS的器件中，使用完全不同的方法。芯片核心处的蚀刻硅就像一个音叉，它以所需的频率谐振，而芯片上的额外电子电路则管理和放大这个时钟信号（图2）。图2：MEMS振荡器技术使用蚀刻在硅片中的一种类似音叉的谐振器，以及支持电路。（由SiTime提供）有许多第一，第二，甚至第三层参数用于评估任何振荡器，无论是晶体还是其他振荡器。当然，所需的最小值或最大值取决于应用，但这些参数的相对权重随设计而变化。关键参数包括标称工作频率，绝对精度，老化相关稳定性，短路和长期漂移（温度系数和补偿），抖动，工作温度范围，封装和尺寸，工作电压，电源灵敏度，功耗，抗冲击/振动，启动时间，供应商变化和成本，引用a少数。根据应用需求以及任何历史背景，大多数这些都是以不同方式和不同条件合法测量的。MEMS优势和现实基于石英晶体振荡器由多个部件组装而成，包括精心切割和抛光的石英毛坯，将其固定在封装中的安装，同时还提供电接触（以及一些抗冲击/振动），以及外壳封装本身（有关更多背景，请参阅CTS产品培训模块“CrystalClockOscillators”）。相比之下，MEMS振荡器是一种IC，采用标准工艺CMOS生产线制造，在大多数情况下使用8英寸晶圆。在探测，修整和测试之后，该设备被包装;再次，就像任何IC一样。因此，MEMS器件受益于用于传统IC的批量生产批量技术和工艺。（有关MEMS振荡器的其他背景，请参阅ASFLM1系列上的Abracon产品培训模块）。基于MEMS的器件的其他优点包括：最终器件比石英版小。这不仅可以节省宝贵的PC板空间，而且可以使定时器件更靠近它所支持的器件，以获得更好的信号完整性和降低EMI。MEMS振荡器可以构建有源电路在芯片上，可用于补偿电路，改善性能与温度或电源轨的变化。它也可用于提供完整的振荡器功能，因为石英晶体和MEMS谐振器本身都不是完整的振荡器（尽管该术语通常以这种方式使用）;每个都需要一些相关的电路来驱动核心定时元件并调节/缩放输出。许多振荡器还需要PLL将基本振荡器频率乘以所需的载波频率，这也可以成为IC的一部分。完整的MEMS振荡器内核，振荡器电路和接口功耗较低此外，正在开展工作以允许MEMS器件芯片与其驱动的IC（例如A/D转换器）以与存储器IC相同的方式共同封装。现在与他们的微控制器或微处理器堆叠和共同封装。这将带来多种好处：需要更少的电路板空间，简化的BOM，改进的单一完整性，以及振荡器和转换器的经过测试和保证的性能，而无需考虑PC布局问题（这些问题在GHz的RF范围内具有挑战性且经常令人沮丧鉴于所有这些优点，MEMS设备没有取代晶体振荡器的原因有几个：可用的MEMS器件的性能可能不是这样的。RF设计人员非常谨慎，因为时序功能对系统性能至关重要。虽然晶体有缺点和伪影，但这些相当不错了解。相比之下，MEMS器件的微妙之处和变幻莫测只是开始为RF设计人员所接受的前沿设计所知。新的RF设计通常包含一个或几个新产品上市组件，如高性能LNA或A/D和D/A转换器，但设计人员不愿意尝试太多新组件。这是关于风险管理以及设计师一次使用多少不熟悉的设备，即使每个设备都有潜在的益处。成本，当然：作为一种成熟的技术，晶体供应商已经设法带来了成本通过经验和数量来降低。虽然MEMS器件具有降低成本的潜力，但这必须根据具体情况进行评估。MEMS振荡器成为现成的标准件一些可用的MEMS定时设备说明了这些组件的功能。例如，SiTimeSiT8209高频，超高性能振荡器（图3）可以订购80.000001和220MHz之间的任何频率，精确到小数点后六位。为了过渡方便，它被封装为石英振荡器的引脚对引脚直接替代，具有仅0.5psec的超低相位抖动，以及低至±10ppm的频率稳定性。此外，SiTime还提供了许多适用于不同应用设计要求的MEMS器件系列。图3：SiTimeSiT8209提供极低的抖动，至关重要许多通信应用;图中显示的是当采用LVCMOS输出工作在3.3V时，相位噪声为156.25MHz。SiliconLabs提供四个系列（Si501，Si502，Si503，Si504），其成员在额外功能方面有所不同，性能保证10年的频率稳定性，包括焊料偏移，负载牵引，电源变化，工作温度范围，振动和冲击;该供应商声称这是可比石英设备的10倍保证。这些单元提供32kHz至100MHz之间的任何频率，频率稳定性选项包括商用（-20°C至70°C）和工业（-40°C至85°C）温度范围内的±20，±30和±50ppm。四引线器件（图4）可在+1.71V至+3.63V之间的任何电源轨上工作。图4：Si501的成员SiliconLabs的/2/3/4系列具有相同的基本性能规格，但输出使能和频率选择等额外功能的可用性不同。Micrel的MicrelMEMS振荡器单元（图5）可以在2.3到460MHz的频率下工作（例如，DSC1123的频率为156.25MHz）。典型RMS相位抖动低于1psec，而稳定性可订购±10，±25或±50ppm额定值。LVDS输出器件采用2.5×2.0,3.2×2.5,5.0×3.2和7.0×5.0mm封装，适合现有封装，需要2.25至3.6V电源。该供应商声称MTF（平均故障时间）比石英设备好20倍。图5：Micrel的DSC单元是标准6引脚LVDS石英晶体振荡器的“直接”替代品;器件的不同之处仅在于使能使能控制引脚。总结很难预测基于MEMS的定时器件将在何种程度上取代历史悠久的石英基晶体RF设计中的单位，以及这种转变需要多长时间。毫无疑问，MEMS单元的优势及其在性能，尺寸，成本和封装方面的未来潜在优势使它们在较低频率下具有极具吸引力的竞争，并且越来越多地进入更高的RF频谱。市场研究公司IHS最近预测，2016年将出货超过10亿个MEMS定时装置，主要用于手机和消费类电子产品。供应商看到了机会，MEMS技术已经在大众市场中使用，它正在推进和成熟，只要任何权衡-显然会因应用而变化-用户都可以接受，用户就会受益。转载自——维库电子市场网

随着LED在发光性能、成本等几乎各个方面的改进，LED的应用范围越来越广，但在各应用领域渗透的比例高低不一。如可寻址标志和建筑物照明这样的商业应用领域中，LED凭借在色彩、总体拥有成本、工作寿命、可靠性和便利性方面的优势，应用非常广泛。如在建筑物装饰照明应用中，使用LED可在建筑物外墙上营造出丰富的色彩，及更好地彰显建筑物的结构。在移动标志应用中，还可以实时更新交通显示屏、视频图像及广告牌上的信息。安森美半导体身为应用于高能效电子产品的首要高性能硅方案供应商，针对各种LED应用提供宽范围的LED驱动器方案，其中就包括用于可寻址标志和建筑物装饰照明两类常见应用的系列线性驱动器（详见下表）。这些驱动器能够精确地稳定LED电流，并包含可编程接口，利于软件控制。本文将以CAT4008、CAT4103和CAT9552为例，分别阐述其主要功能和基本工作原理，便于工程师的选型设计。表1：安森美半导体应用于标志及建筑物装饰照明的系列智能LED控制/驱动器。针对LED广告牌等应用的恒流汲入型LED驱动器诸如广告牌标志、滚动横幅、智能车辆标志和体育计分板等LED应用需要采用多颗LED，通常包含多串LED，要求LED驱动方案提供恒定的光输出，不同通道间的电流匹配精度要高，要提供易用的接口来控制不同LED通道，并且要具备可靠的保护功能。安森美半导体针对这类应用的方案包括CAT4008和CAT4106等恒流LED汲入型驱动器，其中前者支持8通道，后者支持16通道。以CAT4008为例，典型LED通道匹配精度达±1.5%，且LED通道能够在输出电压低至0.4V（当LED电流为2~100mA时）时保持稳流状态，在应用设计中可以此实现更高的电源效率。图1左侧显示的是CAT4008的框图，不同引脚的详细功能说明参见参考资料［1］。这器件使用8路紧密匹配的汲电流来对每个通道的LED电流进行稳流，而外部电阻RSET用于将LED通道电流设定为RSET电流的约51倍。由于每个通道包含独立电流感测电路，故CAT4008能够为所有通道都提供紧密的稳流。在大多数电流和电源电压条件下LED通道的最大压降为0.4V，帮助改善散热及提升LED驱动器能效。上电时，欠压锁定电路清除所有闩锁及移位寄存器信息，并将所有输出设置为关闭。一旦达到欠压锁定阈值，就可以设定器件。驱动器将每个连续LED输出通道的激活时间各延迟17纳秒（典型值），即LED2相对LED1延迟17纳秒，LED3相对LED1延迟34纳秒，并依次类推。延迟在闩锁（LATCH）引脚激活时引入，从而将LED电源上的浪涌电流降至最低，从而能够使用更小的旁路电容。速度高达25MHz的高速、四线（4-Wire）串行接口通过移位寄存器和锁存架构控制8通道中的每一个LED通道。串行数据输出引脚允许多个器件通过同一个串行接口串联使用。CAT4008还有输出关闭引脚，该引脚可被用来关闭所有LED通道，而不必依赖串口发送数据。此外，CAT4008还具备热保护功能，在芯片温度超过许可限度时关闭LED输出。图1：安森美半导体8通道恒流LED汲入型驱动器CAT4008框图及应用示例。高亮度、高视觉冲击力建筑物照明应用的RGBLED像素驱动器某些旨在营造高视觉冲击力效果的建筑物装饰照明应用使用高亮度的LED，要求LED驱动器能够驱动高亮度的RGBLED，并且要具备高速接口，从而支持高数据率并确保维持高数据完整性，还需要具备超低的压降，从而提供更高的能效。安森美半导体适合这类应用的LED驱动器包括的带独立电流控制功能的三通道恒流RGBLED像素驱动器CAT4103和CAT4109。其中，CAT4103为高端、多色彩、“智能”LED建筑物照明应用而设计，具有高速串行接口，能支持达25MHz的数据率，提供完全缓冲的数据输出，确保在分布式（长距离）、菊花链型照明系统中维持最高的数据完整性。而CAT4109使用并行接口，每条通道具有专门的脉宽调制（PWM）控制，非常适合更常规的LED视觉效果应用，如混色和建筑物重点照明。图2：安森美半导体CAT4103框图、典型应用电路图及应用示例。CAT4103和CAT4109都支持每通道达175mA的宽广范围LED恒流驱动，电流为60mA时压降电平至0.3V，确保在驱动长串LED时提供最高性能。这些驱动器每通道支持25V的电压电平，能够以超过10瓦（W）的高亮度功率电平支持RGB像素。CAT4103和CAT4109是安森美半导体恒流低压降驱动器（LDO？）产品线的两款产品，这产品线还包括CAT4101和CAT4104等，其中，CAT4101提供高精度的1A电流驱动能力，而CAT4104是一款四通道的恒流LED驱动器，适合通用及建筑物照明、汽车照明、LCD背光等应用。I2C指示器驱动器及端口扩展器市场上可以看到诸如由闪烁LED组成的广告销售标牌和具备开/关LED指示器的各种消费或工业用设备，这些应用需要能够控制各个LED单独导通/关闭或以某种频率来闪烁的驱动方案，安森美半导体的16通道I2CLED指示器及端口扩展器CAT9532和CAT9552就是适合这类应用的两款产品。CAT9532和CAT9552提供16位并行输入/输出（I/O）端口扩展器，优化用于LED调光控制，输出能够直接驱动并联的16颗LED（每通道电流25mA），每个LED都可以单独导通、关闭，或以两种可编程速率中的一种来闪烁。两款器件的I/O均可用作通用I/O（GPIO），未被用于控制LED的端口能够当成普通端口来使用（参见图3）。图3：CAT9552典型应用电路图。这两款器件适合于需要限制总线流量或清空总线主控定时器的I2C和SMBus应用。两款器件都包含内部振荡器和驱动LED输出的两个脉宽调制（PWM）信号，用户可以设定每个独立PWM信号的周期和占空比。CAT9532的可选可编程闪烁频率范围为0.593Hz至152Hz，CAT9552为0.172Hz至44Hz，两款器件的占空比为0%至99.6%，适合的具体应用包括背光、RGB混色、传感器控制、电源开关/按钮、报警系统、办公设备、家电控制面板和销售点（POS）显示屏等。总结：本文分析了常见的LED控制应用及其对驱动/控制方案的基本要求，介绍了安森美半导体用于这些应用的主要产品及其特点。而安森美半导体身为应用于高能效电子产品的首要高性能硅方案供应商，提供涵盖1至数百瓦功率范围的LED照明驱动及PFC解决方案，适合包括本文所述LED控制应用在内的宽广应用范围，而无论LED照明应用采用的是AC-DC电源、DC-DC电源或是电池供电，并满足客户对低成本、高性价比、高能效的要求。转载自——维库电子市场网

本文从实际生产设计出发，讨论了与分立电阻相关的一些缺点，包括增益精度、增益漂移、交流共模抑制(CMR)和失调漂移等方面。图1.经典分立差动放大器该放大器电路的传递函数为：若R1=R3且R2=R4，则公式1简化为：这种简化有助于快速估算预期信号，但这些电阻绝不会完全相等。此外，电阻通常有低精度和高温度系数的缺点，这会给电路带来重大误差。例如，使用良好的运算放大器和标准的1%、100ppm/°C增益设置电阻，初始增益误差最高可达2%，温度漂移可达200ppm/°C。为解决这个问题，一种解决方案是使用单片电阻网络实现精密增益设置，但这种结构很庞大且昂贵。除了低精度和显著的温度漂移之外，大多数分立差动运算放大器电路的CMR也较差，并且输入电压范围小于电源电压。此外，单片仪表放大器会有增益漂移，因为前置放大器的内部电阻网络与接入RG引脚的外部增益设置电阻不匹配。解决所有这些问题的最佳办法是使用带内部增益设置电阻的差动放大器，例如AD8271。通常，这些产品由高精度、低失真运算放大器和多个微调电阻组成。通过连接这些电阻可以创建各种各样的放大器电路，包括差动、同相和反相配置。芯片上的电阻可以并联连接以提供更广泛的选项。相比于分立设计，使用片内电阻可为设计人员带来多项优势图2.增益误差与温度的关系——AD8271与分立解决方案比较交流性能在电路尺寸方面，集成电路比印刷电路板(PCB)小得多，因此相应的寄生参数也较小，对交流性能有利。例如，AD8271运算放大器的正负输入端有意不提供输出引脚。这些节点不连接到PCB上的走线，电容保持较低，从而提高环路稳定性并优化整个频率范围内的共模抑制。性能比较参见图3。图3.CMRR与频率的关系——AD8271与分立解决方案CMRR比较差动放大器的一项重要功能是抑制两路输入的共模信号。参考图1，如果电阻R1至R4不完全匹配（或者当增益大于1时，R1、R2和R3、R4的比率不匹配），那么部分共模电压将被差动放大器放大，并作为V1和V2之间的有效差压出现在VOUT处，其无法与实际信号相区分。如果电阻不理想，那么部分共模电压将被差动放大器放大，并作为V1和V2之间的有效差压出现在VOUT处，其无法与实际信号相区分。差动放大器抑制这一部分电压的能力称为共模抑制。该参数可以表示为共模抑制比(CMRR)或转换为分贝(dB)。分立解决方案的电阻匹配不如集成解决方案中的激光调整电阻匹配那么好，这可以从图4中输出电压与CMV的关系曲线看出来。图4.输出电压与共模电压的关系——AD8271与分立解决方案比较假设使用理想运算放大器，则CMRR为：其中，d为差动放大器的增益，t为电阻容差。因此，对于单位增益和1%电阻，CMRR为50V/V或约34dB；使用0.1%电阻时，CMRR增加到54dB。即使采用具有无限大共模抑制的理想运算放大器，整体CMRR也会受电阻匹配的限制。某些低成本运算放大器具有60dB至70dB的最小CMRR，使误差更为糟糕。低容差电阻放大器在其指定工作温度范围内通常表现良好，但必须考虑外部分立电阻的温度系数。对于带有集成电阻的放大器，电阻可以进行漂移调整和匹配。布局通常使电阻相互靠近，因此它们会一同漂移，从而降低其失调温度系数。在分立情况下，电阻在PCB上散开，匹配情况也不如集成方案，产生的失调温度系数会更差，如图5所示。图5.系统失调与温度的关系——AD8271与分立解决方案比较无论是分立式或是单芯片，四电阻差动放大器的使用都非常广泛。由于只有一个器件放置在PCB上，而不是多个分立元件，因此可以更快速、更高效地构建电路板，并节省大量面积。为了获得稳定且值得投入生产的设计，应仔细考虑噪声增益、输入电压范围和CMR（达到80dB或更高）。这些电阻均采用相同的低漂移薄膜材料制成，因此在一定温度范围内可提供出色的比例匹配。转载自——维库电子市场网

现在市面上存在着各种PCI接口芯片，如AMCC公司的S5933，PLX的9080系列等。专用芯片可以实现完整的PCI主设备与从设备模式的接口功能，将复杂的PCI总线接口转化相对简单的用户接口，但系统结构受接口芯片的限制，不能灵活地设计目标系统，且成本较高。本文使用符合PCI电气特性的FPGA芯片进行简化的PCI接口逻辑设计，实现了33MHz、32位数据宽度的PCI从设备模块的接口功能，节约了系统的逻辑资源，且可以将其它用户逻辑集成在同一块芯片，降低了成本，增加了设计的灵活性。另外，还给出了Windows9x系统下的设备驱动程序，可以与应用程序接口，形成一个完整的系统。目前，本系统已经被印染企业应用在数据采集和处理等方面。1系统构成与功能描述系统的总体框图如图1所示。由图1可见，系统的硬件平台为一块PCI卡。此卡的结构十分简洁，主要由FPGA芯片、RAM芯片和输出接口三部分组成。其中，FPGA芯片集成了PCI接口模块和数据处理模块。PCI接口模块实现了33MHz工作时钟、32位总线宽度的接口功能，支持I/O空间、内存空间及配置空间的读写和PCI中断功能。由于简化的PCI接口占用的逻辑资源较少，可在同一块芯片中集成其他用户逻辑。作为一个应用实例，本文加入了一个数据处理模块，对PCI接口传送来的数据进行处理，通过片外的输出接口输出到下位机。RAM芯片为数据处理提供缓存功能。2从设备模式下的简化PCI协议的实现为了实现PCI接口的基本功能，必须完成以下几个模块：（1）PCI配置空间设置。PCI协议支持三种地址空间：I/O空间、内存空间和配置空间。配置空间提供了支持PCI设备自动配置的机制，是必需的。（2）PCI从设备状态机。PCI总线状态机是具有PCI总线的计算机系统状态流，是由一个已知状态到另一个状态的条件、时序的描述。这是PCI接口设计中最基本也是最重要的部分。（3）地址译码和命令译码。地址译码用来确定PCI设备是否应当响应当前总线的操作；命令译码则用来指示PCI设备根据不同的总线命令作出相应的动作。本文采用ALTERA公司的Max+PlusII软件平台，硬件描述语言使用ALTERAHDL语言，也可以方便地转换民VHDL或VerilogHDL语言。在此之前，先引入PCI总线信号的定义。2.1总线信号定义根据PCI总线协议2.2版，从设备模式下PCI接口至少包含47根引脚。图2给出了按功能划分的引脚分布，左边是必需引脚。右边是可选引脚。为简化起见，本文采用了如下引脚，其他引脚均不使能或置为高阻态。（1）由系统提供的33MHz的同步时钟信号CLK和复位信号RST#（#表示低电平有效）；（2）关于数据传输的核心信号：32位地址/数据复用线AD[31:0]、总线命令/字节使能复用线C/BE[3:0]#和偶校验信号PAR；（3）接口控制信号FRAME#、TRDY#、IRDY#、STOP#、DEVSEL#和IDSEL。其中，FRAME#为数据传输起止信号，TRDY#为主设备准备好信号，IRDY#为从设备准备好信号，STOP#为从设备停止请求信号，DEVSEL#为设备选择信号，IDSEL为配置空间读写时的片选信号；（4）中断引脚INTA#。为简化PCI协议，本文只实现了最重要的总线命令，表1给出了所支持的总线命令对应的C/BE[3:0]#编码值。表1支持的总线命令C/BE[3:0]#命令类型说明001000110110011110101011I/O读I/O写存储器读存储器写配置空间读配置空间写2.2配置空间设置配置空间大小为256字节，前64字节必需，记录了PCI设备的基本住处，比较重要的有：（1）VendorID、DeviceID和ClassCode域：分别表示设备的生产厂商、设备编号和类型；（2）Command和Status域：分别给出了对PCI设备的控制命令和当前状态；（3）BaseAdressRegister域：指示此PCI设备按I/O方式还是内存方式进行读写以及需要的地址空间大小；（4）InterruptLine和InterruptPin域：分别指明了设备使用的断号和中断引脚。在对配置空间的访问中，用AD[7:2]寻址一个双字DWORD。在本设计中，配置空间设置如表2所示。2.3简化的从设备状态机在PCI协议中，标准的从设备状态机包含五种状态，而且各状态的跳转条件比较复杂。本文在不违反PCI协议的前提下，简化了从设备的状态机，如图3所示。图3中，状态转移条件信号a、b、c定义如下：a代表配置空间访问条件,b代表I/O空间或内存空间访问条件，c代表总线传输开始条件。这三个条件的实现由后面的命令译码模块给出。表2配置空间设置（均为十六进制）字段值或含义字段值或含义VendorID1172ClassCode040000，即视频卡DeviceID8901BaseAdressRegister映射到I/O空间Command0082InterruptLine中断号AStatus0400InterruptPin使用INTA中断引脚IDLE是系统的缺省状态，表示总线当前空闲。通常，设备处在IDLE状态时，要检测来自PCI总线和后级设备的信号，便设备作出合适的响应。设备处于S_DATA状态时完成第一次数据传输，直接无条件跳到BACKOFF状态。设备在BACKOFF状态时进行多个数据传输，直到主设备断开访问。需要注意的是：任何对I/O空间、配置空间以及内存空间的突发传输的地址超过了设备映射地址的范围时，从设备要在此状态建立STOP信号，断开访问。当帧信号无效或主设备终止传输时，设备回到初始的IDLE状态。BUS_BUSY状态时总线忙，表示总线正在被其它设备使用。有两条转移路径，若总线仍然被占用，则停留在BUS_BUSY状态，否则返回空头状态IDLE。2.4地址译码和命令译码模块地址译码模块主要检测PCI地址与本PCI卡的基地址是否匹配，可以通过AD[31:00]信号线上的值与设备的基地址作比较判断。如果PCI地址落在设置的基地址范围内，则PCI卡响应当前的总线操作。命令译码模块指示PCI卡响应不同的总线命令，通过检测C/BE[3:0]#信号线上的值，与表1列出的总线命令作比较，完成命令译码。3Windows9x系统下驱动程序的设计对PCI设备而言，驱动程序提供了获取PCI卡的配置空间信息、勾挂PCI中断、总线数据传输等功能。本文介绍使用Numega公司的VtooIsD软件进行驱动设计的方法。3.1寻找PCI卡并读取配置空间信息配置空间包含了系统初始化PCI设备所必需的信息，首先需要遍历整个硬件树结构来寻找指定的PCI设备。对于每一个设备，比较其厂商号（VendorID）和设备编号（DeviceID），如果与设计的PCI卡的信息匹配，则读取它的配置空间信息。3.2I/O方式下的读写操作I/O方式下的读写比较简单。在得到PCI设备基地址信息后，通过C++语言中的端口读写函数inpd和outpd即可完成。举例如下：Temp=_inpd(gBaseAddresses);//Temp中得到读出的数据_outpd(gBaseAddresses,Data)；//向基地址写入数据其中，gBaseAddresses为基地址值，Data为写操作时的数据。3.3内存方式下的读写对于内存方式下的读写，一个重要问题就是地址的映射。因为硬件设备读写的是物理内存，但应用程序读写的是虚拟地址，所以存在着将物理内存地址映射到用户程序线性地址的问题。映射功能通过调用VtoolsD软件的标准库函数完成。根据给定的物理地址和所要求的空间大小，在系统内存中分配相应空间。首先，用PageReserve函数分配当前保留页的线性地址空间，再利用PageCommitPhys函数的服务对开始的线性地址空间分配相应的物理地址空间。程序如下：ULONGnPages=_NPAGES_(PhysAddress,SizeInByte)；Linear=PageReserve(PR_SYSTEM,nPages,PR_FIXED);PageCommitPhys(PAGENUM(Linear),nPages,PAGENUM(PhysAddress),PC_INCR|PC_WRITEABLE|PC_USER);LinPageLock(PAGENUM(Linear),nPages,0);其中，PhysAddress为给定的物理地址，SizeInBytes为需要的空间大小。建立了物理RAM到系统内存的映射后，就可以利用C++语言中的文件操作基类CFile类完成数据的读写。首先使用CFile类的成员函数Open打开文件，为保证数据读写的准确无误，必须使用二进制方式打开；接下来使用Read和Write成员函数进行文件读写；完毕后用Close成员函数关闭文件。3.4中断的勾挂和处理首先在ON_DEVICE_INIT函数中完成中断的初始化。即通过前面读取的PCI设备的中断号，使用VPICD_Virtualize_IRQ函数进行中断勾挂，外调用VPICD_Physically_Unmask函数开中断。RTCIRQHandle=VPICD_Virtualize_IRQ(&IRQdesc)；VPICD_Physically_Unmask（RTCIRQHandle）；然后在RTCInt_Handler函数中进行中断处理，可以进行各种操作，例如向应用程序发送自定义的消息来通知中断的发生。3.5与应用程序的通信一般地，应用程序通过CreateFile函数调用VxD驱动程序，得到一个VxD的文件句柄。使用如下的语句可以打开一个名为mydriver.VXD的文件，得到的句柄保存在hVxD中。hVxD=CreateFile(.mydriver.VXD,0,0,0,CREATE-NEW,FILE-FLAG-DELETE-ON-CLOSE,0)；通过句柄hVxD和DeviceIoControl函数就可以与驱动程序进行数据传输。本文采用ALTERA公司的FLEX6000系列芯片，型号为EPF6016TC144-3，实现了简化的从设备模式PCI协议，并在Windows9x系统下实现驱动程序的设计。整个系统工作良好。资源占用情况如下：可用I/O引脚113根，占用51根，占用率45%；可用逻辑单元数1320个，占用151个，占用率11%。简化的PCI协议的实现占用较少的逻辑资源，可以灵活方便地进行功能添加和改进，同时可以在同一块芯片中集成其他用户模块，实现不同功能，以降低成本。目前，本系统已经应用在数据采集处理、图像处理等方面。转载自——维库电子市场网

现代FPGA是有史以来最复杂的集成电路之一，它们采用最先进的晶体管技术和顶尖的架构，以实现令人难以置信的灵活性和最高的性能。随着时间的推移和技术的进步，这种复杂性决定了，在用FPGA设计和实现系统时，需要做出某些妥协。这一点在电源中最为明显，FPGA每次更新换代，电源都要提高精度、灵活性、可控性、效率和故障感知能力，还要减小体积。可能有些读者会质疑本文的标题，乍一看，说“FPGA的护理和喂养(careandfeeding)”似乎完全不合适。然而，对于这种反对意见的答案很简单：英语是一个有趣的语言。虽然人们对于“careandfeeding”这一说法何时开始流行莫衷一是，但人们都知道，这个说法起源于简单的农业时代，目前已经被人们普遍使用（滥用），指任何脆弱或不稳定的东西。在本文中，这一说法可谓一针见血。虽然对于FPGA是否需要“喂养”，人们充满争议，但我们可以肯定的是，FPGA的确需要“护理”！FPGA电源要求（解读数据手册）工程师应该将大部分时间用于编程——他们不希望花费时间和精力去考虑如何设计合适的电源。实际上，最佳供电方案就是采用一种既能满足项目当前需求，又能达到项目升级发展需求的，强大、灵活且行之有效的设计方案。在此，我们将仔细考察一些重要的电源规格及其含义。电压精度内核电源电压是平衡FPGA功耗和性能的、最重要的关键要素之一。规格文档给出了一系列可接受的电压，但总的电压范围并不是问题的全部。与所有事物一样，需要进行权衡和优化。表1是当下流行的AlteraArria10FPGA的内核电压规格示例。虽然这些数字是Arria10特有的数据，但它们代表了其他FPGA内核电压要求。电压范围为标称电压另加±3.3％的容差。在此电压窗口内，FPGA会正常运行，但问题的全貌要复杂得多。表1.AlteraArria10内核电压规格注意标有“SmartVID”的行，其电压范围为0.82V至0.93V。这表示，当FPGA通过SmartVID2接口（详见后文）请求自身的内核电压时，FPGA可以接受的各种电压。该SmartVID规格表明了有关FPGA的一个基本事实：FPGA可以在不同电压下运行，具体取决于其特定的制造容差以及采用的特定逻辑设计。FPGA的静态电压可能各不相同。电源必须具备响应和适应能力。设计目标是产生恰好能满足编程功能需求的性能水平，不消耗不必要的功率。根据半导体的物理特性以及Altera、Xilinx®（图1）和其他公司公布的数据可知，动态和静态功率会随着内核VDD的增加而显著提高，因此我们的目标是确保，给FPGA提供的电压刚好达到其时序要求即可。功耗过大无助于提高性能。实际上，功耗过多会使情况变得更糟，因为晶体管泄漏电流随着温度的升高而增加，从而消耗更多不必要的功率。由于这些原因，当务之急是优化设计和工作点的电压。图1.XilinxVirtexV功率与内核VCC。这种优化过程需要非常精确的电源才能获得成功。必须将调节器误差纳入误差预算，并从可用于优化的可用电压范围中减去。如果内核电压降至要求电压以下，则FPGA可能因时序错误而发生故障。如果内核电压漂移至最大规格值以上，结果可能会损坏FPGA，或者可能会在逻辑中形成保持时间故障。为了防止所有这些情况，必须考虑电源容差范围，并且指令电压必须保持在规格限值以内。问题是大多数电源调节器都不够准确。调节电压可能是指令电压容差范围内的任何电压，可能随负载条件、温度和老化而漂移。保证±2％容差的电源可以在4％的电压窗口内任意调节电压。为了补偿电压可能比下限值低2％的问题，必须将指令电压提高到比时序要求2％的水平。如果调节器然后漂移到比指令电压高2％的水平，它将在比该工作点所需的最小电压高4％的水平运行。这仍然符合FPGA的指定电压要求，但却浪费了大量功率（图2）。图2.电源调节器容差权衡。解决办法是选择能支持更严格的电压容差的电源调节器。容差为±0.5％的调节器可以在要求工作频率下，在更接近最小规格要求的范围内工作，并且保证与所需电压的偏离幅度小于1％。这种情况下，FPGA会正常工作，并且其功耗将达到该工作条件下的最低水平。LTC388x系列电源控制器可在较宽的可配置电压范围内，保证调节输出电压容差优于±0.5％。LTC297x系列电源系统管理器可保证调整后的电压调节器容差优于±0.25％。在这些精度条件下，对于FPGA，显然都能使其功耗与性能之间达到最佳平衡。热管理就电源精度而言，一个更微妙的意义体现在热预算当中。由于静态功耗远远没有达到可以忽略不计的程度，因此FPGA即使在无所事事的情况下也会升温。温度升高会导致更多的静态功耗，从而进一步提高工作温度（图3）。向电源添加不必要的电压只会使该问题变得更加糟糕。不准确的电源需要工作电压保护段，确保有足够的电压来完成此项工作。由容差、系统组件变化和工作温度的变化引起的电源电压不确定性可能产生明显高于所需最小值的电压。当施加到FPGA时，这种额外的电压可能导致热效应，甚至可能在高处理负载下导致热失控。图3.电源电流与工作温度的关系。补救措施是选择一种非常精确的电源，该电源仅产生恰当且不超过必要的电压，这正是ADI电源系统管理(PSM)器件所擅长的。SmartVIDSmartVID是Altera公司出品的一种技术，该技术用于按照FPGA本身的要求，为每个FPGA提供最佳电压。FPGA内部有一个寄存器，其中包含一个因器件而异的电压（已在出厂中编程），可保证FPGA高效运行。FPGA内部编译的一项IP功能可以读取该寄存器，并通过外部总线向电源发出请求，要求提供这个精确的电压（图4）。一旦达到电压要求，它就会在运行期间保持静止。图4.AlteraSmartVID结构。SmartVID应用对电源的要求包括特定的总线协议、电压精度和速度。总线协议是FPGA用于将其所需电压传送到功率调节器的几种方法之一。在可用的方法中，PMBus最为灵活，因为它可以满足最广泛的电源管理IC的需求。SmartVIDIP使用两个PMBus指令：VOUT_MODE和VOUT_COMMAND，用于命令符合PMBus标准的功率调节器达到正确的电压。调节器的电压精度和速度要求包括自主引导电压（在PMBus激活之前），能每10毫秒接受一个新电压指令，在电压调整阶段每10毫秒能步进10mV，并且能在10毫秒的步进时间内稳定在目标电压30mV(~3%)范围内，最终升至指令电压并在FPGA工作期间保持静止。虽然Altera使用的是SmartVID技术，但业界使用的其他类似技术也可以完成相同的任务。一种最简单的方法是在工厂测试每块电路板，并在电源的非易失性存储器中编程一个精确的电压，优化该特定电路板的性能。使用该技术时，不需要进一步干预，电源就能在正确的电压下工作。这是搭载EEPROM的电源管理器或控制器的优点之一。LTC388x系列电源控制器可满足AlteraSmartVID的所有要求。此外，LTM4675/LTM4676/LTM4677µModule调节器可以轻松满足这些要求，而且通过单一紧凑的形式提供了完整的解决方案。时序收敛任何逻辑模块的计算速度均取决于其电源电压。在限值范围内，电压越高，性能越快。我们已经看到，为什么不能采用简单的办法，即在最高电压下运行，保证获得最佳速度。另一方面，我们必须使工作电压足够高，能满足应用需求，如图5所示。图5.FPGA工作频率与VDD之间的平衡关系。图5的一个重要启示是，当特定设计达不到其逻辑时序要求并处于故障区域时可以采取哪些措施。通常，在将设计转化成硬件之前，很难准确定义正常工作与故障之间的界限，也无法预先确定它将在哪个特定电压下超过时序要求。唯一的选择是提前确定一个远高于最小值的电压，以浪费功率为代价来保证功能；或者设计一种灵活的电源，以在测试时适应硬件需求，甚至在采用SmartVID技术的情况下，能在加电时适应硬件需求。适应未知需求的能力使得ADIPSM器件的精度更具价值，因为FPGA设计师可以在实际设计阶段和任何开发阶段在功耗与性能之间进行权衡。转载自唯样电子资讯。

1、并行流水结构FIR的原理在用FPGA或专用集成电路实现数字信号处理算法时，计算速度和芯片面积是两个相互制约的主要问题。实际应用FIR滤波器时，要获得良好的滤波效果，滤波器的阶数可能会显著增加，有时可能会多达几百阶。因此，有必要在性能和实现复杂性之间做出选择，也就是选择不同的滤波器实现结构。这里运用并行流水线结构来实现速度和硬件面积之间的互换和折衷。在关键路径插入寄存器的流水线结构是提高系统吞吐率的一项强大的实现技术，并且不需要大量重复设置硬件。流水线的类型主要分为两种：算术流水线和指令流水线。对FPGA设计，逻辑功能是面向特定应用的，因此，采用需要较少额外控制逻辑的算术流水结构。流水线结构就意味着将数字处理算法分割成时间上前后相连的多个处理片段．并且在段与段之间加信号寄存器来缓冲。这些段和段之间的缓冲就构成了流水线。系统原来的运算量被分割成k个部分，分别由流水线的k个段来外理。一旦前面的任务通过了流水线的第一段，新的任务就可以进入流水线。设系统不加流水时的延时是D，则加上流水后，每隔D／k个时间单位就可以启动新的任务。要实现流水线的性能提升应满足3个条件：①运算量均匀分成延时一致的k个部分；②输人数据有大量重复的运算；③重复的运算前后没有相关性。并行结构就是以重复相同的结构，对同时满足并行运算条件的并行算法在硬件上进行实现的结构。并行结构运用起来的主要难点如下：一，并行结构占用更多的面积。二，相互并行的各计算部分在相互交换数据时，需要额外的控制和互联结构。但是，在芯片工艺尺寸不断减小的今天，并行结构成为设计高速、低延时数据处理系统的首选。控制和互联结构的复杂性取决于算法和对算法的划分方法。FIR滤波器本身就适合并行处理，但是对于占用时间和芯片面积都很大的乘法器来说，用全并行来实现FIR滤波器是不经济的。FIR滤波器以其设计简单、稳定性好、方便实现、线性相位等优点往往成为首选，甚至是唯一的选择。FIR滤波器用差分方程表示为：FIR滤波器直接型结构如图1。2、实现方法现场可编程门阵列（FPGA）具有体系结构和逻辑单元配置灵活、集成度高以及设计开发周期短等优点，因此，选用FPGA来验证并实现本滤波器结构。VHDL是一种硬件描述语言，主要用于描述数字系统的结构、行为、功能和接口，与FPGA相结合后，表现出更加强大与灵活的数字系统设计能力。用VHDL完成数字系统的功能描述，用FPGA来实现是一种实用方便的软、硬件结合方式。从硬件描述语言到FPGA配置数据文件是由综合工具以及布局、布线工具来完成的。数字系统的功能最终能否实现以及性能如何，取决于数字系统的算法结构，也取决于综合工具、布局和布线工具，还有器件性能。但是，如果数字系统的算法设计不好，就会有更多的设计反复。这里对FIR滤波器提出一种处理时间和所用芯片面积可以互换的结构，在最初的设计时，就能对其处理能力有所估计，减少了设计的反复。对于FIR滤波器，Xilinx提供了两个软核，一个是基于分布式运算的，另一个是基于单路的乘加运算。对于大阶数、高采样率的滤波器，这两种滤波器结构都不太适合。为了提高FIR滤波器的吞吐量，可用并行加流水线的结构来实现FIR滤波器，如图2所示。流水结构用于提高吞吐量率，并行结构可以减小处理延时。利用流水和并行结构调整滤波器性能使其满足实际应用要求。这里实现三级流水和二路并行的FIR滤波器。三级流水分别对应取数、乘法和累加。主要由双口RAM、乘法器、累加器、控制逻辑和流水线间的寄存器组成，还有数据写入模块（图中未画）。用两块RAM分别存放FIR系数和数据的前N个样值点，这两个RAM要求有一个写数据和一个读数据的双端口RAM。数据写入模块负责把所要滤波的数据轮换地写入两个双口RAM；FIR的系数也按偶数下标和奇数下标分别写入两个系数RAM，实现时是预先配置的。在实现滤波时，如图1所示对数据移位是不现实的。因此，用交联网络结合控制模块实现第一级流水--取数，完成给下一级流水线正确送数的目的。第二级流水是两个并行的乘法器，完成乘法运算。第三级流水是一个累加器；在控制逻辑的控制下，对乘法器输出结果进行正确的累加运算。完成结构设计后要进行时序设计。数据写入模块的时钟是根据数据源产生数据的速率而定的。而流水线的工作时钟频率要求大于数据产生时钟频率的N／2倍，N是滤滤器阶数，2是并行度。也就是要求流水线在数据产生的一个周期内能完成一次FIR滤波器输出的计算。其中的控制逻辑是流水线正常运行的关键。数据流水线上的各种时序要求都要由其产生，包括读数据地址、读系数的地址、交联网络的控制和流水线结构的输出。其VHDL的端口描述如下：系数地址由计数器产生，计数器周期是滤波器的阶数除以并行度，由first_data_address的第0位的边沿触发，以重新从0开始计数。数据RAM的地址加上计数器的值。两个RAM地址因当前输入滤波数据的存放位置，可能相同也可能相差1。交联网络的控制信号是计数器的最低位。累加器输出的使能信号是在计数到滤波器的阶数时产生的，而后经过延时给到累加器。累加器清零信号在这里产生要比累加器中用其他方法方便得多。交联网络也是设计的重点。对于并行处理结构，各单元之间数据的共享和通信是限制并行度的主要原因。在并行度为2的结构中，只要轮流交换系数就可以了。但是对更高的并行度，这一通信网络的延时是相当大的，这也是把它单独列为滤波器的流水线的一级的主要原因。还要注意的是：有符号数常用补码表示。在对有符号数进行扩展时，要扩展最高位。对乘法器的输出一般要进行扩展，以避免累加器溢出。对于乘加运算，有一种分布式计算方法，也就是把乘法进一步分解为部分和（二进制系数的每一位和输入数据相与的结果）。当乘加运算的一个乘数是已知常数时，分布式乘加运算会很节省资源。因为系数固定，与运算的结果是在运算前可知的，这样零位与数据相与的结果是不参与加运算的，从而实现无乘法器的滤波器。这里不选用这种方法，原因有二：其一，分布式运算将使滤波器难以重配：其二，基于FPGA的硬件乘法器较综合得来的乘法器性能更佳。3、仿真及测试用VHDL语言描述全部电路模块后，输入系数1、2、3、4、5和数据-l、-2、3、4等进行测试．用Mod-elsim进行仿真，其结果如图3所示。可以看出，模块能正确进行计算，从数据输入到数据输出约延时2个数据时钟．这主要是前面的数据输入模块的延时。乘加部分采用数据时钟的N／2倍，其延时与滤波器的阶数成比例，但不会超过一个数据时钟周期。然后，对VHDL描述就Xilinx的Spartan-3进行综合和测试。可以得出表1所示的测试结果，其中第一行为并行流水结构所设计的滤波器，第二行是采用Xilinx提供的软核设计的滤波器。可以看出，除了增加一个乘法器外，逻辑块和触发器都增加了一倍多。用这种结构设计的滤波器面积增加了一倍，速度性能也提高了一倍。以上两种滤波器可以应用在语音信号处理中--让语音信号通过低通滤波器以获取语音的低频分量。相对而言，并行流水结构能实现比Xilinx软核更高阶数的滤波器。在听觉上，经过两种滤波器（相同阶数）的语音信号没有太大差别。4、结束语本文在运算层次上，依据流水和并行运算结构实现直接型FIR滤波器。如果在设计滤波器时，结合级联型和直接型两种滤波器结构，那么也能实现同样的并行和流水的效果。实际上，还可在更低层次的乘法运算时，对部分和也用并行和流水结构来实现。这些结构的选择都依据性能要求和实现的复杂性来具体确定。作为实现现代高性能处理器的方法，并行和流水结构各有特点。并行是以面积换速度。流水是以延时换速度，采用这两种结构，就能在面积、速度、延时之间灵活互换。转载自——维库电子市场网

测试设备中的通道数最大化至关重要，因为通道越多，可以并行测试的器件就越多，进而压缩最终客户的测试时间和成本。测试仪通过开关来分享其资源以支持多个被测器件(DUT)，故开关是增加通道数的关键元件。但是，并行控制的开关数量越多，控制线路也就越多，占用的电路板空间相应地增加，这严重制约了可以实现的通道密度。在此情况下，使用SPI控制的开关在解决方案尺寸和通道数方面具有显着的优势。SPI开关可以采用菊花链形式布置，相比于传统解决方案，此举可大幅减少所需的数字线路数。本文将详细说明通道数最大化过程中会遇到的问题，讨论用于控制一组开关的传统方法及其缺点，提出SPI控制的模拟开关解决方案，最后介绍同类产品中性能最佳的ADISPI控制精密开关。通道数最大化的常见问题当模块开发的主要目标是通道数最大化时，板空间就会变得很珍贵。开关是提高系统通道数的关键，但随着开关数目增加，开关本身、逻辑线路及生成这些逻辑信号所需的器件会占用大量板空间，使可用空间减少。最终，受制于控制开关本身所需的相关因素，只能实现很有限的通道数。传统并行开关解决方案提高通道密度的最常见解决方案是使用由并行逻辑信号控制的开关。这需要大量GPIO信号，标准微控制器无法提供如此多的信号。为了生成GPIO信号，一种解决办法是使用串行转并行转换器。这些器件输出并行信号，并由I2C和SPI等串行协议进行配置。图1中的布局显示了8个ADG1412四通道、单刀单掷(SPST)开关，采用4x8交叉点配置，位于一个6层板上。这些开关由两个串行转并行转换器控制，串行线路来自一个控制板。每个转换器提供16条GPIO线路，这些线路分布到8个开关。布局显示了器件、电源去耦电容和数字控制信号（灰色）的占地大小。采用并行控制开关的4x8矩阵解决方案的尺寸为35.6mmx19mm，占用面积为676.4mm2。图1.并行控制开关4x8矩阵布局从图1可以明显看出，很大比例的面积被串行转并行转换器和数字控制线路占用，而不是被开关本身占用。对板空间的这种低效使用是很糟糕的，会大幅减少模块中的开关数目，进而影响系统通道数。SPI开关解决方案图2显示了一个4x8交叉点配置，8个四通道SPST开关位于一个6层板上。不过，这次开关是SPI控制的ADGS1412器件。像之前一样，图中显示了器件尺寸、电源去耦电容和SDO上拉电阻。该解决方案展示器件以菊花链形式配置。所有器件共享来自SPI接口的片选和串行时钟数字线路，菊花链中的第一个器件接收串行数据。然后，该数据被传送至链（像一个移位寄存器）中的所有器件。这个示例解决方案的尺寸是30mmx18mm，面积为540mm2。以菊花链形式使用SPI接口可大大减少串行转并行转换器和数字线路占用的板空间。采用这种开关配置，总电路板面积可减少20%，这使得通道密度大大提高。系统平台也得到了简化。当电路板上的开关数目提高时，节省的面积随之增加，包含数百个开关的电路板可节省50%以上的空间。这说明在更小的面积中可以放入更多开关，相比于传统串行转并行转换器方案，同样面积的电路板将能支持更多通道。图2.菊花链开关4x8矩阵布局图3.SPI开关和并行开关解决方案的面积对比ADISPI开关特性ADI公司的新型SPI开关系列可用来实现更高通道密度，如上例所示。通过创新的堆叠式双芯片解决方案（图4），ADI公司目前业界领先的精密开关可以利用工业标准SPI模式0接口进行配置。这意味着不仅可以节省空间，而且不会对系统性能造成不利影响。下面是ADI新型SPI开关的主要功能总结。图4.ADI公司创新堆叠式双芯片解决方案菊花链模式如上所述，ADISPI开关能以菊花链模式工作。采用菊花链配置的ADGS1412器件连接如图5所示。所有器件共享CS和SCLK数字线路，而器件的SDO与下一器件的SDI形成连接。利用单个16位SPI帧指令菊花链中的所有器件进入菊花链模式。在菊花链模式下，SDO是SDI的8周期延迟版本，故期望的开关配置可以从菊花链中的一个器件传递到另一个器件。图5.采用菊花链配置的两个开关错误检测功能当器件处于寻址模式或突发模式时，可以检测SPI接口上的协议和通信错误。有三种错误检测方法，分别是SCLK错误计数、无效读取和写入地址以及最多3位的CRC错误检测。这些错误检测功能确保数字接口即使在恶劣环境下也能可靠工作。ADISPI开关系列ADGS1412是ADI公司正在开发的SPI开关系列中的首款产品。得益于ADI公司开发的创新双芯片解决方案，ADGS1412不仅具有与并行控制器件ADG1412相同的同类最佳的低RON性能，而且具备串行接口带来的优势。该系列将以ADI公司的高性能开关为基础构建，提供现有、业界领先的开关的SPI控制版本。表1列出了ADI新型SPI开关系列当前和计划发布的产品。产品型号代表何种模拟开关芯片与SPI转并行转换器进行多芯片封装，附加的S表示其为SPI控制版本。这些产品将在2017年陆续发布。表1.计划中的新型SDISPI器件优化产品结语在高通道密度应用中，与使用并行控制开关相比，使用SPI控制开关有很多优势。它能减少每个开关占用的电路板空间，进而实现更高的开关密度。这是因为它减少了所需的数字控制线路，并且不再需要其它器件来提供这些控制线路。ADI公司的创新精密SPI开关解决方案支持提高通道密度。这些器件提供的菊花链模式有利于实现上述目标。由于采用双芯片解决方案，ADI公司当前开关产品的业界领先开关性能得以传承到新产品。ADGS1412是新型SPI控制开关系列中的首款产品，完整产品系列将于2017年和2018年陆续发布。转载自——维库电子市场网

现在的MCU程序可能别人花几百块钱就能破解，为了防止大家的程序不被剽窃，今天给大家分享点加密的内容。一、常见加密方法本节不讲加密具体实现算法，只讲常见加密方法。1.程序写保护这种方法是最常见，也是最简单的一种。现在的MUC基本都有写保护功能，但是这种容易被人破解。2.烧断数据总线这个方法听起来不错，但有损坏的风险，同样也能破解。3.软件加密是一些防止别人读懂程序的方法，单一的这种方法不能防止别人全盘复制，须配合其他的加密算法。4.添加外部硬件电路的加密方法这个方法效果看起来比较好，但会增加成本。5.芯片打磨改型这个方法改了型号能误导，但同时也增加成本，解密者一般也能分析出来。6.通过通过联网加序列号加密通过连接网络，在你的MCU中生成一个唯一的随机长序列号，并加入复杂的特种算法，或加入你们重新编码的企业信息在里面，每个芯片内不同，复制者只能复制到一个序列号。7.通过MCU唯一的标识加密以前很多MCU没有唯一标识码，现在的很多MCU都具有唯一标识码了。这个方法比较好，简单省事，能很好的防止复制。二、读保护+唯一ID加密使用读保护+唯一ID的加密是最常用的一种方法，也是推荐大家使用的一种方法。1.唯一ID现在正规的芯片，每颗出厂的时候都带了一个唯一标识码，这个号码是唯一不重复的，比如STM32的就使用96位作为唯一ID。和我们每个人的身份证号码一样，现在刚出生的婴儿，上户的时候就给他一个身份证号，那么每个芯片一生产出来，也就具备了这个身份证号。2.加密原理读保护就不用说了，增加被破解难度。使用唯一ID加密的方法很多，这里说一种简单的方法：出厂时程序读取唯一ID并保存在一个位置，以后程序执行之前，要读取并匹配这个唯一ID，一致才执行程序。当然，这种方法是最基础的原理，但也存在被破解的风险。所以，存储的数据，以及读取验证这两个地方需要进一步添加一些算法。这样操作之后，即使别人读取了你的程序，也是无法正常执行。

PCM1864圆形麦克风板（CMB）是低成本，易于使用的参考设计，适用于需要清晰语音的应用，例如语音触发和语音识别。此TI设计使用麦克风阵列捕获语音信号，并将其转换为数字流，DSP系统可使用该数字流从嘈杂的环境中提取清晰的音频。特性使用两个PCM18644通道音频ADC与八个麦克风阵列接口，以从嘈杂的环境中提取清晰的扬声器声音用于信号存在和丢失的EnergySense通知–低功耗，高性能音频解决方案的核心部分使用麦克风阵列，TI提供的软件和评估模块提供完整的系统参考设计

JTAG模式与AS模式FPGA是SRAM型结构，本身不能固话程序。因此FPGA需要一片Flash结构的配置芯片来存储逻辑配置信息，用于上电配置。以Altera公司的FPGA为例，配置芯片分为串行（EPCSx系列）和并行（EPCx系列）其中EPCx为老款配置芯片，体积大，价格高，现在常用EPCSx系列芯片。JTAG模式是直接将程序下载到FPGA芯片上运行，可以无限擦写，AS模式是将程序下载到编程配置芯片上，然后再配置FPGA。

高速SDRAMSDRAM可作为软嵌入式系统的(NIOSII)的程序运行空间，或者作为大量数据的缓冲区。SDRAM是通用的存储设备，只要容量和数据位宽相同，不同公司生产的芯片都是兼容的。常用的有HY57V系列、三星K4S系列和美光MT48LC系列。

电源设计：AMS11117可以提供1A电流，线性电源（适用于144管脚以下、5万逻辑门以下的FPGA）。AS2830(或LT1085/6)可以提供3A电流，线性电源（适用于240管脚以下，30万逻辑门以下的FPGA）。TPS54350可以提供3A电流，开关电源（适用于大封装大规模的高端FPGA）。硬件调试方法（1）先焊接电源部分，使用万用表测试，排除电源短路等情况后，上电测试电压是否正确。（2）然后焊接FPGA及其相关的下载电路，排除引脚粘连，再次测了电源地之间是否有短路现象，上电测试电压是否正确，然后将手排除静电后触摸FPGA有无发烫现象。如果出现FPGA发烫现象，一般是出现总线冲突的现象。这种情况下需要检查外围总线是否出现竞争问题，通常是多片存储器片选信号同时选通造成。（3）以上步骤通过后，连接JTAG，上电运行，打开QuartusII，并打开Programmer，点击AutoDEtect看能否检测到FPGA。（4）焊接时钟电路、复位电路，并向FPGA下载一个程序，检查是否正常工作。

具有I/O和电源管理功能：MachXOFPGAMachXOFPGA具有数百个I/O，对需要GPIO扩展、接口桥接和上电管理功能的各种应用而言，可谓绝佳选择。系列中的最新产品旨在符合NIST标准，另增安全功能以确保系统硬件和固件的安全性。MachXOFPGA具有一组功能强大的GPIO，包括“热插拔”等功能，因而无论电源轨状态如何，都可向I/O施加电压。此外，虽然多数FPGA输入默认为上拉状态，但MachXO输入默认为下拉状态，因此非常适合控制功能应用。MachXOFPGA具有不足10ms的即时启动功能，可作为“先启后停”控制器件的理想解决方案，在系统上电和断电期间用于对其他元器件进行管理和排序。MachXO器件的配置数据存储在闪存中。这类器件也包含基于SRAM的配置单元。器件上电后，存储于闪存的配置数据将以并行传输方式自动复制到基于SRAM的配置单元中。此外，器件运行时，可将新配置加载至闪存中，之后可选择在适当的时候将新配置复制到SRAM单元中。MachXO器件的一个典型示例是LCMXO3LF-9400C-6BG256C，具有9,400个逻辑单元和206个I/O，总RAM位数为442,368。代表性开发板是LCMXO3LF-6900C-S-EVNMachXO3入门套件（MachX03L版本）。套件板具有SPI闪存，可用于评估外部启动或双重启动功能。评估MIPIDSI和CSI2I/O时，建议使用LCMXO3L-DSI-EVNMachXO3LDSI分线板；评估高速差分I/O时，建议使用LCMXO3L-SMA-EVNMachXO3LSMA分线板。LatticeSemiconductor的FPGA设计和开发伴随FPGA发展的最常见技术之一是语言驱动设计(LDD)。这涉及使用Verilog或VHDL等硬件描述语言(HDL)，在抽象级别（即寄存器传送级(RTL)）上捕获设计意图。通过逻辑仿真进行验证之后，该表达式将连同目标FPGA类型、引脚分配和时序约束（例如最大输入到输出延迟）等其他信息一并传输至合成引擎。合成引擎输出的配置文件可以直接加载至FPGA中，或者对基于SRAM的FPGA而言，可加载至外部存储器件中。LatticeDiamond属于这类工具，可提供完整的基于GUI的FPGA设计和验证环境，适用于CrossLink、MachXO和ECP器件。与LatticeDiamond一样，LatticeRadiant也可提供完整的基于GUI的FPGA设计和验证环境，但后者主要针对iCEFPGA和未来架构。LatticeRadiant功能众多：行业标准IEEE1735知识产权(IP)加密和Synopsys设计约束(SDC)，实现最佳互操作性集成的工具组环境，简化设计导航和调试功能全新的ProcessToolbar支持简单的“一键式”设计执行功能完整的物理到逻辑闭环设计流程，实现交叉探索IP数据打包功能，使开发人员和第三方IP提供商能够以适合分发的形式打包经加密的IP数据包LatticeMico系统开发工具Lattice推出了两款软处理器内核——LatticeMico8和LatticeMico32，两者均可应用于FPGA的可编程结构。LatticeMico8是一款8位微控制器，针对MachXO2可编程逻辑器件(PLD)系列进行了优化和全面测试。此外，该器件也可用于其他FPGA系列的参考设计。微控制器内核结合了完整的18位宽指令集与32个通用寄存器，在保留丰富功能的同时，最大限度地减少消耗的器件资源——最小配置中LUT少于200个。LatticeMico32是一款32位哈佛架构RISC微处理器。LatticeMico32结合了32位宽指令集与32个通用寄存器，因而性能和灵活性适合各种市场应用。采用RISC架构，在确保性能满足各种应用所需的同时，使内核消耗的器件资源最少。为了加速微处理器系统的开发，可将LatticeMico32与几种兼容WISHBONE控制器的可选外设元器件集成。LatticeMico系统开发工具具有图形用户界面，使用户可对LatticeMico处理器内核和外设进行拖放式操作，将其连接至总线，并为各元器件定义各种参数，例如在处理器地址空间中的位置。系统定义完成后，该工具即可自动生成相应的RTL以进行仿真和合成。此外，该系统提供的工具使用户能够生成软件，用以在处理器内核上运行。机器学习工具：LatticesensAI堆栈和神经网络编译器目前，机器学习(ML)和人工智能(AI)应用广泛部署于各种嵌入式系统和整个物联网(IoT)，包括工业物联网(IIoT)。LatticesensAI堆栈包含评估、开发和部署基于FPGA的ML/AI解决方案所需的一切功能，包括模块化硬件平台、示例演示、参考设计、神经网络IP内核，软件开发工具和定制设计服务。在消费类和工业物联网应用中，开发人员可借助该堆栈实现灵活的机器学习推断引擎，加快上市时间。Lattice卷积神经网络(CNN)加速器IP内核是用于深度神经网络(DNN)的计算引擎。该引擎针对卷积神经网络进行了优化，因此可用于分类、对象检测和跟踪等基于视觉的应用。CNNIP内核本身可执行所需的计算，因此无需额外添加处理器。同时，借助Lattice神经网络编译器，设计人员可使用TensorFlow、Caffe和Keras等通用开发框架下创建的神经网络，并将其编译以在LatticeCNN和紧凑型CNN加速器IP内核中实施。小结最佳设计解决方案常常是由处理器与FPGA的组合提供，或由FPGA单独提供，或以硬处理器内核作为部分结构的FPGA提供。作为一项技术，FPGA多年来发展迅速，如今已经能够满足灵活性、处理速度、功耗等多方面的设计需求，非常适合智能接口、机器视觉和AI等众多应用。如上所述，LatticeSemiconductor的FPGA产品范围覆盖低中端，专注于低功耗器件，应用遍及通信、计算、工业、汽车和消费类等迅速增长的市场，以此解决从边缘到云的网络问题。此外，Lattice还推出了若干设计和验证工具套件，适用于基于语言的设计、基于图形处理器的设计以及专注于机器学习和人工智能应用的设计等各种设计流程。文章来源网络

现场可编程门阵列(FPGA)具有诸多特性，无论是单独使用，抑或采用多样化架构，皆可作为宝贵的计算资产；但是许多设计人员并不熟悉FPGA，亦不清楚如何将这类器件整合到设计中。解决办法之一是深入研究主要供应商提供的FPGA架构及相关工具。本文则从LatticeSemiconductor产品系列开始着手。FPGA选件高级概述市场上有许多不同类型的FPGA，每种类型都有不同的功能和特性组合。可编程结构是所有FPGA的核心，并以可编程逻辑块阵列的形式呈现（图1a）。FPGA结构进一步扩展可包括SRAM块（称为块RAM(BRAM)）、锁相环(PLL)和时钟管理器等组件（图1b）。此外，还可以添加数字信号处理(DSP)块（DSP切片）和高速串行器/解串器(SERDES)（图1c）。外设接口功能（如CAN、I2C、SPI、UART和USB）可以实现为可编程结构中的软内核，但许多FPGA将其作为硬内核在硅片中实现。同样，微处理器也可以实现为可编程结构中的软内核，或作为硬内核在硅片中实现（图1d）。不同FPGA针对不同的市场和应用提供不同的功能、特性和容量集合。FPGA供应商有很多，包括Altera（被Intel收购）、Atmel（被MicrochipTechnology收购）、LatticeSemiconductor、Microsemi（也被MicrochipTechnology收购）和Xilinx。所有这些供应商都提供多个FPGA系列；有的提供片上系统(SoC)FPGA（包含硬处理器内核），有的则针对航天等高辐射环境提供耐辐射器件。由于产品系列众多，每个系列提供不同的资源，因此为眼前的任务选择最佳器件可能很棘手。本文着重介绍了LatticeSemiconductor推出的器件系列及相关设计工具。LatticeSemiconductor的FPGA介绍LatticeSemiconductor的FPGA产品范围覆盖低中端，专注于低功耗器件，应用遍及通信、计算、工业、汽车和消费类等迅速增长的市场，以此帮助客户解决从边缘到云的网络问题。Lattice推出了四个主要的FPGA系列：iCE（堪称世界上最小的超低功耗FPGA）CrossLink和CrossLinkPlus（针对高速视频和传感器应用进行了优化）MachXO（针对桥接、扩展、平台管理和安全应用进行了优化）ECP（针对连接和加速应用的通用器件）此外，Lattice还推出了诸多设计和验证工具套件，包括LatticeDiamond软件（用于CrossLink/CrossLinkPlus、MachXO和ECP器件）、LatticeRadiant软件（用于iCEFPGA和未来架构）、LatticeMico（用于创建基于软微处理器设计的图形工具），以及LatticesensAI堆栈和神经网络编译器（用于人工智能(AI)和机器学习(ML)设计）。传统：ECPFPGA许多设计人员都认为Lattice的ECP器件是“传统”FPGA器件。这类器件采用10mmx10mm封装，引脚间距0.5mm，最多可包含85,000(k)个四输入查找表(LUT)。静态和动态功耗较低，协议无关单通道SERDES功能器件的功耗低于0.25W，四通道SERDES功能器件则低于0.5W。除了SRAM块、数字信号处理(DSP)块、锁相环(PLL)和时钟管理器外，ECPFPGA还具有可编程I/O，支持LVCMOS33/25/18/15/12、XGMII、LVTTL、LVDS、Bus-LVDS、7:1LVDS、LVPECL和MIPID-PHY输入/输出接口。ECPFPGA的配置单元基于SRAM，因此与所有其他基于SRAM的FPGA一样，仅当系统通电时，才能由外部（例如闪存器件、微处理器、微控制器）加载配置。ECP器件的一个典型示例是LFE5UM5G-25F-8BG381C，支持ECP55GSERDES的FPGA，采用10mmx10mm封装。为了使设计人员能更好地研究和试验ECP5FPGA系列的特性，Lattice还推出了相应的ECP5-5G开发板LFE5UM5G-45F-VERSA-EVN（图2）。体积小巧，但功能强大：Lattice的iCEFPGAiCE器件是市面上现有体积最小的FPGA，该系列中最小的器件采用1.4mmx1.4mm封装，提供18个I/O。iCEFPGA采用灵活的逻辑架构，最多可包含5k个四输入LUT，具有高达128Kb的Lattice嵌入式sysMEMBRAM、1Mb的单端口RAM(SPRAM)、高性能DSP块，以及可定制I/O。iCEFPGA器件体积小、功耗低（对于多数应用，休眠电流低至75µA，有功电流范围从1至10mA），但功能却很强大。例如，这类器件可实现人工神经网络(ANN)，可用于模式匹配以实现边缘应用中“始终开启”的人工智能。iCEFPGA的配置数据存储在非易失性存储器(NVM)中，因而属于一次性可编程(OTP)器件。尽管如此，器件仍包含基于SRAM的配置单元。开发过程中，可将设计直接由外部加载至基于SRAM的配置单元来进行测试。设计提交后，即可将其加载至NVM中。器件上电后，存储于NVM的配置将以并行传输方式自动复制到基于SRAM的配置单元中。iCE器件的一个示例是ICE40UL1K-SWG16ITR1KiCE40UltraLite，它是世界上外形尺寸最小的FPGA（截至本文发布时），采用1.4mmx1.4mm封装，静态功率为42µW。代表性开发板包括HM01B0-UPD-EVNHimaxHM01B0UPduino扩展板和sensAI模块化演示板（图3）。该套件基于UPduino2.0开发板，这款Arduino外形尺寸的快速原型开发板，具有iCE40UltraPlusFPGA的性能和I/O功能。此外，套件还包括HimaxHM01B0低功耗图像传感器模块和两个I2S麦克风。专用：CrossLink和CrossLinkPlusFPGACrossLink和CrossLinkPlus系列都是专用FPGA，除了可编程逻辑和强大的I/O功能外，器件规格经过强化，因而可广泛适用于工业和汽车应用。其中包括移动行业处理器接口(MIPI)D-PHY高速数据通信物理层标准、相机串行接口2(CSI2)和显示串行接口2(DSI2)内核；封装分别采用6mmx6mm(CrossLink)和3.5mmx3.5mm(CrossLinkPlus)。与iCEFPGA一样，CrossLink器件的配置数据存储在OTPNVM中，也包含基于SRAM的配置单元，开发过程中可直接加载进行测试。设计提交后，则将其加载至NVM中。器件上电后，数据以并行传输方式自动复制到基于SRAM的配置单元中。相比之下，CrossLinkPlus器件的配置单元基于闪存，因此可根据需要对这些器件进行重新编程；此外，器件还具有不足10ms的即时启动功能。CrossLink器件的一个示例是LIF-MD6000-6JMG80I，具有5,936个逻辑单元和37个I/O，总RAM位数为184,320。在着手开始嵌入式视觉设计时，设计人员可借助LF-EVDK1-EVN嵌入式视觉开发套件，将基于CrossLink的MIPI输入与ECP5FPGA处理整合，用以进行嵌入式视觉设计的原型开发（图4）。文章来源网络

当固件在微控制器或微处理器上的运行速度过慢时，现场可编程门阵列(FPGA)可解决实时嵌入式设计的硬件问题。同时，FPGA还具有外设灵活性。然而，要使用FPGA，设计工程师就需要学习全新的编程语言（通常为Verilog或VHDL）以及全新的开发流程来生成FPGA比特流，而且可能需要投入大量资金用于购买FPGA开发板。由于这些障碍，尽管FPGA是设计工具箱中非常有用的工具，但许多设计工程师都不愿意使用。为帮助他们克服这种心态，一些供应商正在致力于缩短FPGA学习曲线。例如，Arduino推出了ArduinoABX00022MKRVidor4000FPGA开发板（参见“通过ArduinoMKRVidor4000快速轻松地应用FPGA”）。ArduinoMKRVidor4000提供了另一种FPGA编程方法，与广受欢迎的Arduino集成开发环境(IDE)无缝集成，并且可以使用专用Arduino库扩展获得FPGA级性能。现在又推出新产品以替代早前的产品，其中就包括ArduinoMKRVidor4000板。AloriumTechnology则开发了一种稍微不同的方法来将FPGA性能添加到Arduino嵌入式开发环境中。这种方法既支持预配置IP块进行I/O加速，也支持定制设计的IP块。本文首先简要介绍FPGA的传统使用方法，然后深入介绍Alorium的Arduino兼容型XLR8R22M08V5U0DI和SnōSNOR20M16V3FPGA模块。本文将说明Alorium如何以全新的理念在Arduino环境中使用FPGA，既支持预配置IP，又能构建定制IP，以及设计人员如何开始应用FPGA模块。如何加速Arduino现在，全球成千上万的设计人员、工程师、开发人员、DIY爱好者和创客都在使用Arduino开发板系列的不同版本，为各种各样的应用开发嵌入式系统。由于Arduino板和ArduinoIDE的使用和编程方法都非常简单，因此深受欢迎。随着Arduino用户不断将最初的Arduino架构推进到更加复杂的应用领域，性能问题开始出现。一部分性能问题是最初的Arduino微控制器的8位架构过于简单。另一部分问题是当Arduino的嵌入式微控制器不具备等效硬件块时，Arduino软件系统只能通过软件实现大量实时外设。这一性能问题的一种解决方法是使用功能更强大的微控制器，但软件在实时环境中能做的事情是有限的。一些高速实时外设必须在硬件中实现。此外，虽然也可以使用配备更多硬件外设的微控制器，但适用的外设组合则取决于具体的项目。对此，微控制器制造商常在一个微处理器系列中提供数十个甚至上百个版本，以此解决对于不同外设组合的需求。然而，这种方法对于Arduino等板级产品并不可行，因为必须使用具有足够I/O引脚的板载连接器来满足所有需求。尽管现在市面上有很多版本的Arduino板，但仍然不足以满足所有嵌入式项目的需求。FPGA可满足各种外设组合需求通过向嵌入式设计人员提供可编程硬件，FPGA能够满足因项目而异的外设组合需求。为嵌入式微控制器板添加FPGA功能的一种简单方法是，将FPGA添加到现有设计中。这也是Arduino在设计ArduinoMKRVidor4000板时采用的方法。该板结合了MicrochipTechnology的基于32位Arm®Cortex®-M0+的ATSAMD21G18A-AUTSAMD21低功耗微控制器与Intel的10CL016YU484C6GCyclone10FPGA。Arduino专为MKRVidor4000板向ArduinoIDE中添加了几个硬件IP块。这些外设可由两个主库提供：VidorPeripherals和VidorGraphics。当Arduino草图（Arduino用来表示程序或代码单元的名称）中包含相关外设库时，ArduinoMKRVidor4000上的IntelCyclone10FPGA会自动构建这些硬件IP块。目前的外设IP块清单包括：I2C端口SPI端口UART高频PWM控制器高速定时器高速正交解码器AdafruitIndustries的Neopixel可寻址RGB智能LED控制器其中一些外设（例如I2C和SPI）已经作为软件IP块用于早前的Arduino板。这些早期软件实现与ArduinoMKRVidor4000板的FPGA上实现的等效IP块的区别在于，FPGA版本的外设性能更好。例如，每个I2C和SPI实例化都是通过板上FPGA内部的独立可编程硬件块实现的。因此，实例化若干个这样的串行端口时没有性能损失。通过以FPGA硬件实现外设块，并借助Arduino草图编写人员已经熟悉的相同库机制使其可用，ArduinoMKRVidor4000板简化了FPGA的使用。无需学习VHDL或Verilog之类新的硬件描述语言(HDL)。实际上，对于程序员而言，基于FPGA的外设与任何其他C++对象并无二致。Arduino计划日后添加更多此类硬件IP块外设。然而，ArduinoMKRVidor4000板与通用的FPGA开发板仍有所不同，因为它不支持使用HDL代码对板载Cyclone10FPGA直接编程。Arduino正计划使用Intel面向FPGA的QuartusHDL开发工具，允许更多高级用户通过ArduinoMKRVidor4000板的FPGA来实现更多用途。Alorium迈出下一步对于Arduino兼容型XLR8R22M08V5U0DI和SNOR20M16V3SnōFPGA开发板，Alorium已通过OpenXLR8方法和XceleratorBlock(XB)迈出了这一步（图1和图2）。这两款板基于IntelMAX10FPGA系列的不同版本构建，该系列集成有闪存配置存储器。XLR8结合了Intel10M08SAU169C8GMAX10与8位ATmega328指令集兼容型微控制器。它的外形尺寸与最初的ArduinoUno开发板相同，因此与很多ArduinoShield和配件兼容。AloriumSnōFPGA开发板的尺寸相对小得多，该模块尺寸规格为0.7x1.7英寸，见图2。尽管SnōFPGA开发板的物理尺寸更小，但它集成了IntelMAX10FPGA的更高版本，配备的逻辑单元也多出一倍：10M16SAU169C8GMAX10FPGA有16K，而XLR8板上的10M08器件只有8K。前者的I/O引脚也是后者的两倍多（32个，对比XLR8板的14个）。Alorium还提供了SNOMAKRR10分线板，可将SnōFPGA模块转换为稍大的Arduino外形尺寸板，配备USB端口和来自FPGA的附加I/O分线引脚。SnōFPGA模块的一些引脚连到与Arduino兼容的SnōMAKR分线板扩展排针，而其他引脚连到USB连接器对面、沿开发板边缘分布的一排附加针座（图3）。XLR8和SnōFPGA开发板都在一个芯片—IntelMAX10FPGA中实现8位微控制器及其硬件外设。图4图解说明了实现方法。AVR兼容型微控制器内核（图4左下部分）与最初Arduino开发板中使用的AtmelATmega3288位AVR微控制器相同。然而，Alorium的AVR微控制器是以FPGA中的软内核方式实现，而不是另载于独立芯片之上。图4中，该微控制器内核上方共有五个AloriumXB（XB1至XB5）。XB是通过FPGA的片上资源实现的IP块。AVR微控制器可通过可寻址寄存器接口与这些片上XB进行通信。XLR8和Snō开发板随附了预安装的XB（也在GitHub中提供），它们相当于Arduino开发人员经常需要使用的外设，包括：正交解码伺服电机控制NeoPixelRGBLED控制12位增强型ADC浮点数学请注意，上面列出的最后一种XB其实并不是I/O外设块，而是浮点数学加速器。XB可以是任何类型的硬件加速器，而不只局限于I/O。选取任何块XLR8和SnōFPGA开发板都可现场更新，方法是选择不同的XB（或多个同类XB），使用Alorium的OpenXLR8开发流程在FPGA中实例化。开发人员也可以使用Alorium的OpenXLR8流程构建定制XceleratorBlock（图5）。目前，要构建定制的XB，设计人员必须具备Verilog或VHDL硬件描述语言的应用知识，并且熟悉IntelQuartusFPGA工具套件—尤其是QuartusPrimeLiteEdition17.1版和MentorGraphics的ModelSim仿真工具。HDL对于FPGA开发必不可少，因为它允许设计人员以一种标准的、定义完善的方式来表达多个任务的并行执行。C和C++等高级语言(HLL)实质上是顺序语言。HLL编译器获取HLL源代码，将其转换成一长串机器指令序列，通常一次只能执行一个指令。这也是FPGA比处理器快得多的原因所在—FPGA能够同时执行数千个任务，只要FPGA足够大。有一些HLL编译器能够将C或C++编写的代码转换为HDL，然后由常规的FPGA工具处理，但目前Alorium的OpenXLR8设计流程并不包括这些HLL编译器。然而，一旦使用HDL和FPGA开发工具设计并调试了XB，即可像任何其他Arduino库块一样在ArduinoIDE中使用。目前，Alorium也在为ArduinoIDE库开发更多的XB。总结在构建各自的FPGA开发板方面，Arduino和AloriumTechnology公司都认识到设计人员越来越多地需要这些经济实惠的开发板提供更多的嵌入式性能。尽管两家公司采取的策略虽有所不同，但最终目标却别无二致：努力让更多嵌入式开发人员更方便地使用FPGA。在最基础的层面上，Arduino和Alorium的方法让硬件设计就像选取块并运行脚本一样简单。目前，完整的设计流程尚不够简单。Arduino尚未向HDL开发人员开放完整的FPGA开发流程。虽然Alorium的设计流程确实包括HDL设计，但要求开发人员必须具备Verilog或VHSLFPGA设计语言和工具的知识。不过，这些产品已将大门开启，至少在理论上可以利用C和C++硬件编译器等其他FPGA开发方式。届时，将可以通过使用AloriumTechnology和Arduino开发的简单方法将这些功能添加到ArduinoIDE中，充分发挥FPGA的性能。文章来源网络